[发明专利]高速铁路实时生成应答器报文的系统和方法无效

专利信息
申请号: 201110421704.2 申请日: 2011-12-15
公开(公告)号: CN102437898A 公开(公告)日: 2012-05-02
发明(设计)人: 孙宁先;王连福;倪松华;史增树;何春明 申请(专利权)人: 北京和利时系统工程有限公司
主分类号: H04L1/00 分类号: H04L1/00;H04L12/56
代理公司: 北京安信方达知识产权代理有限公司 11262 代理人: 栗若木;曲鹏
地址: 100096 北京*** 国省代码: 北京;11
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摘要:
搜索关键词: 高速铁路 实时 生成 应答器 报文 系统 方法
【权利要求书】:

1.一种高速铁路实时生成应答器报文的系统,其特征在于,包括列控中心主控设备和接口编码板,所述列控中心主控设备与所述接口编码板之间通过DP总线相连;

所述接口编码板一端通过所述DP总线与所述列控中心主控设备相连,另一端与轨旁电子单元相连;

所述列控中心主控设备,用于生成列车行车许可命令报文,并通过所述报文传输接口将生成的列车行车许可命令报文发送给所述接口编码板;

所述接口编码板,用于接收所述列控中心主控设备通过所述报文传输接口发送的列车行车许可命令报文,并根据预置的算法对所述列车行车许可命令报文进行编码,将编码后的列车行车许可命令报文发送给所述轨旁电子单元(LEU)。

2.根据权利要求1所述的高速铁路实时生成应答器报文的系统,其特征在于,所述DP总线支持830位或1023位列车行车许可命令报文的传输。

3.根据权利要求1所述的高速铁路实时生成应答器报文的系统,其特征在于,所述接口编码板包括结构相同的第一套电路和第二套电路共两套电路,所述第一套电路与所述第二套电路均为二取二电路,所述第一套电路和所述第二套电路共同构成二乘二取二电路,所述第一套电路的CPU与所述第二套电路的CPU通过串行总线连接。

4.根据权利要求3所述的高速铁路实时生成应答报文的系统,其特征在于,所述第一套电路的CPU与所述第二套电路的CPU具体为FPGA。

5.一种高速铁路实时生成应答器报文的方法,其特征在于,包括:

列控中心主控设备生成列车行车许可命令报文,并将所述列车行车许可命令报文发送给接口编码板;

所述接口编码板根据预置的编码算法对所述列车行车许可命令报文进行编码,并将编码后的列车行车许可命令报文发送至LEU。

6.根据权利要求5所述的高速铁路实时生成应答器报文的方法,其特征在于,所述列控中心主控设备生成列车行车许可命令报文包括:

所述列控中心主控设备根据轨道电路区段物理数据、占用信息、进路信息、线路信息以及临时限速信息生成列车行车许可命令报文。

7.根据权利要求5所述的高速铁路实时生成应答器报文的方法,其特征在于,所述列控中心主控设备生成的列车行车许可命令报文的大小为830位(bit)或1023bit。

8.根据权利要求7所述的高速铁路实时生成应答器报文的方法,其特征在于,所述接口编码板根据预置的编码算法对所述列车行车许可命令报文进行编码包括:

在所述列控中心主控设备发送的列车行车许可命令报文为830bit时,将所述列车行车许可命令报文编码为1023bit,并将编码后的列车行车许可命令报文发送至LEU。

9.根据权利要求7所述的高速铁路实时生成应答器报文的方法,其特征在于,该方法还包括:

所述接口编码板在所述列控中心主控设备发送的列车行车许可命令报文为1023bit时,透传所述列车行车许可命令报文给所述LEU。

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