[发明专利]一种高梯度高介电低损耗压敏材料的制备方法无效

专利信息
申请号: 201010237477.3 申请日: 2010-07-23
公开(公告)号: CN101913857A 公开(公告)日: 2010-12-15
发明(设计)人: 雒风超;何金良;胡军 申请(专利权)人: 清华大学
主分类号: C04B35/462 分类号: C04B35/462;C04B35/622
代理公司: 北京清亦华知识产权代理事务所(普通合伙) 11201 代理人: 罗文群
地址: 100084*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 梯度 高介电低 损耗 材料 制备 方法
【说明书】:

技术领域

发明涉及一种高梯度高介电低损耗压敏材料的制备方法,尤其涉及一种高梯度高介电低损耗CCTO基压敏材料的制备方法,属于高介电陶瓷材料的技术领域。

背景技术

钛酸铜钙,化学式CaCu3Ti4O12(以下简称CCTO)是一种新型陶瓷材料,由于在2000年被发现有极大的介电常数而受到了广泛的关注。由于其巨介电特性和压敏特性,CCTO可以应用在压敏保护器件,高介电电容器,薄膜器件,高密度能量存储等一系列高科技领域。

但是,CCTO具有的一些性质阻碍了其在工业生产中的应用。首先,CCTO的漏电流太大。CCTO的介电损耗太大,以已有工艺制备的样品的损耗在大部分频率范围内都在0.1以上(附图1)。漏电流和介电损耗过大的主要效应是会消耗电能而导致器件的大量发热。这对微型化和集成化的电子器件来说是不可接受的。其次,CCTO的压敏电压梯度只有约30V/mm,较小的压敏电压限制了其作为压敏保护器件在高压领域的应用。

发明内容

本发明的目的是提出一种高梯度高介电低损耗压敏材料的制备方法,配方采用PbO掺杂CCTO,使用固相反应烧结,使PbO分布在CCTO晶界上,增加晶界电阻,减小晶粒,从而达到增加压敏电压梯度,减小介电损耗和漏电流的目的使制备的压敏材料的压敏电压梯度从100V/mm至600V/mm连续可调,相对介电常数在104左右,在103Hz至105Hz范围内的介电损耗在0.1以下,从而使该材料体系更适于工业应用。

本发明提出的高梯度高介电低损耗压敏材料的制备方法,包括以下步骤:

(1)原料配制和混合:

以CaCO3或CaO、CuO、TiO2以及PbO为原料,各原料的质量比为:

CaCO3∶CuO∶TiO2∶PbO=1∶(2.27~2.50)∶(3.03~3.35)∶(0.1~0.85),或CaO∶CuO∶TiO2∶PbO=1∶(4.05~4.48)∶(5.42~5.99)∶(0.18~1.52);

将各原料按上述质量比称量后置于球磨罐中混磨10~24小时;

(2)预烧和研磨:

将混磨后的物料在800℃至900℃下预烧2~12小时,随炉冷却;

将预烧之后的物料敲碎,置于球磨罐中以酒精为研磨介质研磨12~24小时,将研磨后的浆料置于干燥箱中干燥,过100~200目筛;

(3)成型:

采用压片成型工艺,将预烧和研磨后的粉料制成具有所需形状和强度的坯体;

(4)烧结:

在空气气氛中烧结坯体,升温速度为:从室温至400℃,升温时间2小时;在400℃保温排胶2~4小时;从400℃升温到1000℃~1100℃,升温时间3~5小时;保温3~12小时,使陶瓷烧结致密。

本发明提出的高梯度高介电低损耗压敏材料的制备方法,通过掺杂PbO,控制烧结工艺,使PbO分布在CCTO的晶界上,并有效减小晶粒大小,增加晶界电阻,从而大大降低了介电损耗,增加电压梯度;通过控制掺杂PbO的量可以控制压敏电压梯度的大小。由此为这种新材料的工业化应用铺平了道路。用这种工艺生产的材料的相对介电常数在104左右,在103Hz至105Hz范围内的介电损耗在0.1以下(如图1所示),压敏电压梯度在100V/mm到600V/mm之间连续可调(如图2所示),从而使该材料体系更适于工业应用。

附图说明

图1是使用已有文献中工艺与本发明方法制备的CCTO陶瓷的介电损耗谱对比。

图2是使用原有工艺与本发明方法制备的材料的直流IV特性对比。

图3是本发明制备方法的实施例1中陶瓷的烧结温度曲线。

具体实施方式

本发明提出的高梯度高介电低损耗压敏材料的制备方法,包括以下步骤:

(1)原料配制和混合:

以CaCO3或CaO、CuO、TiO2以及PbO为原料,各原料的质量比为:

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