[发明专利]Turbo 分量译码方法、分量译码器、支路计算器及Turbo 译码器有效
申请号: | 200910251012.0 | 申请日: | 2009-12-28 |
公开(公告)号: | CN102111162A | 公开(公告)日: | 2011-06-29 |
发明(设计)人: | 朱志辉 | 申请(专利权)人: | 重庆重邮信科通信技术有限公司 |
主分类号: | H03M13/27 | 分类号: | H03M13/27;H03M13/29;H04L1/00 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 400065 *** | 国省代码: | 重庆;85 |
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摘要: | |||
搜索关键词: | turbo 分量 译码 方法 译码器 支路 计算器 | ||
1.一种Turbo译码分量译码方法,其特征在于,计算前向分支度量Alpha,并交织存储于Alpha缓存器中;计算后向分支度量Beta,同时解交织读取Alpha,计算对数似然比LLR,将计算出来的LLR原位存储于Alpha缓存器中,在输出时顺序输出;所述LLR原位储存为将LLR存储于读取Alpha的地址中。
2.如权利要求1所述分量译码方法,其特征在于,对计算的Alpha作归一化处理,只存储归一化后的值。
3.一种实现权利要求1或2所述方法的分量译码器,其特征在于,包括一个Alpha/Beta计算模块、一个Alpha缓存器、一个交织/解决交织处理模块和一个LLR计算模块;所述Alpha/Beta计算模块计算Alpha值和Beta值,Alpha值经过交织/解决交织处理模块交织处理后存储于Alpha缓存器中;Beta值与从Alpha缓存器读出并经交织/解决交织处理模块解交织处理的Alpha值一并发送给LLR计算模块计算对数似然比LLR,该LLR原位存储于Alpha缓存器中,在输出时顺序输出。
4.一种包括权利要求3所述分量译码器的支路计算器,其特征在于,包括二个分量译码器SISO1和SISO2、输入输出控制模块、交织/解交织模块,以及迭代终止判断模块;
所述输入输出控制模块,完成输入数据的分块存储以及分量译码器对数据的并行读取和译码结果数据的存储;
所述二个分量译码器SISO1和SISO2,完成对Turbo译码各条支路的前向分支度量、后向分支度量,状态转移分支度量、以及每一个译码比特的对数似然比的计算,同时完成其相关变量的存储;
所述交织/解交织模块,完成交织矩阵的生成和存储,以及对输入该模块的数据做交织或解交织处理的控制;
所述迭代终止判断模块,进一步包括硬判决单元、条件判断单元和中断信号产生单元;若条件判断单元判断达到迭代终止条件,则由硬判决单元进行硬判决,进而由中断信号产生单元产生迭代中断信号,译码完成,否则不产生此信号,继续迭代译码。
5.如权利要求4所述支路计算器,其特征在于,所述迭代终止判断模块,包括以下单元:硬判决、缓存模块、比特收集和CRC检验,根据l2k与l′1k之和计算出临时硬判决值,缓存后比特收集,然后判断CRC校验结果是否正确,正确则产生迭代中断信号,译码完成,否则不产生此信号,继续迭代译码。
6.一种包括权利要求4或5所述支路计算器的Turbo译码器,其特征在于,包括输入控制模块、输出控制模块、SISO并行模块;所述输入控制模块包括M路并行存储器;所述输出控制模块包括一路存储器,所述SISO并行模块包括M路支路计算器,各个支路计算器接收输入控制模块的一路并行存储器的数据,并将其计算数据发送给输出控制模块的存储器。
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