[发明专利]一种同步动态存储器的控制系统及控制方法有效
申请号: | 200910223846.0 | 申请日: | 2009-11-24 |
公开(公告)号: | CN101719104A | 公开(公告)日: | 2010-06-02 |
发明(设计)人: | 周炼;刘毅;杨振力 | 申请(专利权)人: | 中兴通讯股份有限公司 |
主分类号: | G06F12/08 | 分类号: | G06F12/08;G06F13/16 |
代理公司: | 信息产业部电子专利中心 11010 | 代理人: | 梁军 |
地址: | 518057 广东省深圳市南山*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 同步 动态 存储器 控制系统 控制 方法 | ||
1.一种同步动态存储器的控制系统,其特征在于,所述系统包括:
地址缓存控制器,用于调整起始读请求的读地址顺序,并将调整了读地址顺序的读请求发送给同步动态存储器控制器;
同步动态存储器控制器,与所述地址缓存控制器连接,根据调整了读地址顺序的读请求,从所述同步动态存储器中读出数据,并将读出的数据发送给数据缓存控制器;
数据缓存控制器,分别与所述同步动态存储器控制器和地址缓存控制器连接,用于对所述同步动态存储器控制器发送的数据进行排序,按照所述起始读请求的顺序输出数据;
所述地址缓存控制器调整起始读请求的读地址顺序,具体为:
首先,对所述起始读请求进行存储,写入缓存,存储时,根据读请求的读地址进行存储,并存入读取规则和读请求的起始顺序编号;
然后,根据所述读取规则,从缓存中读出起始读请求,得到调整了读地址顺序的读请求;所述读取规则是指提高访问同步动态存储器时出现页命中和页快速命中机率,减小页错失机率的规则。
2.如权利要求1所述的同步动态存储器的控制系统,其特征在于,所述地址缓存控制器包括:
一个或多个缓存单元;每个缓存单元包括与所述同步动态存储器的物理存储体BANK个数一致的先进先出存储FIFO,所述FIFO的编号分别与所述BANK地址对应;
连读标志设置单元,与所述缓存单元连接,用于对行地址相同、且相邻的所述起始读请求设置连读标志;
计数器,与所述缓存单元连接,用于记录所述起始读请求的起始顺序编号;
分配器,与所述缓存单元连接,用于根据所述起始读请求的读地址,将所述起始读请求的读地址、连读标志和起始顺序编号分别存入与所述同步动态存 储器的物理存储体BANK相对应的先进先出存储FIFO中;
选择器,与所述缓存单元连接,用于从所述FIFO中读取存储的起始读请求,如果该起始读请求设置有连读标志,则继续从该FIFO中读取存储的起始读请求;如果该起始读请求没有设置连读标志,则从下一个FIFO中读取存储的起始读请求;所得的读请求为调整了读地址顺序的读请求。
3.如权利要求2所述的同步动态存储器的控制系统,其特征在于,所述数据缓存控制器包括与所述缓存单元个数一致的编号存储单元和数据存储单元,
所述编号存储单元,与所述缓存单元对应连接,用于存储所述起始读请求的起始顺序编号;
所述数据存储单元,分别与所述编号存储单元、同步动态存储器控制器连接,用于存储所述同步动态存储器控制器发送的数据,根据所述起始顺序编号,对所述数据进行排序,并输出。
4.如权利要求3所述的同步动态存储器的控制系统,其特征在于,所述地址缓存控制器包括两个缓存单元,分别为第一缓存单元、第二缓存单元;所述数据缓存控制器包括第一编号存储单元、第二编号存储单元和第一数据存储单元、第二数据存储单元;其中,所述第一编号存储单元分别与所述第一缓存单元和第一数据存储单元连接,所述第二编号存储单元分别与所述第二缓存单元和第二数据存储单元连接。
5.如权利要求4所述的同步动态存储器的控制系统,其特征在于,所述分配器对所述第一缓存单元写满之后,再对所述第二缓存单元进行写入。
6.如权利要求5所述的同步动态存储器的控制系统,其特征在于,所述第一缓存单元或第二缓存单元的任意一个FIFO写满,则所述第一缓存单元或第二缓存单元写满。
7.如权利要求4所述的同步动态存储器的控制系统,其特征在于,所述选择器在从所述第一缓存单元或第二缓存单元中读取数据时,所述分配器不能 对所述第一缓存单元或第二缓存单元进行写入。
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