[发明专利]电子元件的排列方式及电压控制振荡器有效
申请号: | 200710086502.0 | 申请日: | 2007-03-09 |
公开(公告)号: | CN101262212A | 公开(公告)日: | 2008-09-10 |
发明(设计)人: | 纪丽红;陈信光 | 申请(专利权)人: | 普诚科技股份有限公司 |
主分类号: | H03K3/03 | 分类号: | H03K3/03;H03K3/354 |
代理公司: | 北京林达刘知识产权代理事务所 | 代理人: | 刘新宇 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 电子元件 排列 方式 电压 控制 振荡器 | ||
技术领域
本发明是相关于一种电子元件的排列方式,尤指一种电子元件的集成电路布局的排列方式。
背景技术
一般电压控制振荡器(Voltage Controlled Oscillator,VCO)主要以具有奇数个反相器的架构为其工作主轴,利用每一个反相器所须延迟时间而构成其振荡波形,若有N级反相器时,则周期为2N×tp(传递延迟,propagation-delay),振荡频率为1/(2N×tp),利用输入端所输入的电压控制其反相器进行内部频率振荡后,于其输出端产生一输出频率。
请参阅图1,图1为已知电压控制振荡器内多级反相器的集成电路布局(Layout)示意图。如图1所示,图1是举已知电压控制振荡器包含有七级反相器121~127为例,七级反相器121~127是依顺序排列,由第一个反相器121、第二个反相器122......排列至第七个反相器127。而七级反相器121~127中每一个反相器121~127皆包含一输入端(1211、1221......1271)及一输出端(1212、1222......1272),其线路的连接方式依序由第一个反相器121的输出端1212耦接至第二个反相器122的输入端1221、第二个反相器122的输出端1222耦接至第三个反相器123的输入端1231......第六个反相器126的输出端1262耦接至第七个反相器127的输入端1271,最后再将第七个反相器127的输出端1272耦接至第一个反相器121的输入端1211,以完成整个电压控制振荡器进行频率振荡的功能。
由于,在集成电路布局内部元件与元件之间的接线效应会产生寄生电容与电阻,进一步影响到电子装置的特性,例如电阻及电容特性,如图1所示,第七个反相器127的输出端1272耦接至第一个反相器121的输入端1211此段线路的长度,即明显大于其他线路的长度,此种情形会使得第七个反相器127的输出端1272耦接至第一个反相器121的输入端1211此段线路所产生的寄生电阻无法等同于其他任两个电子元件之间所产生的寄生电阻的电阻值,造成相位偏移而使每一级反相器的信号延迟(delay)不同的问题。因此当电压控制振荡器内含有多级反相器时,由于多级反相器的输出特性会因为其集成电路布局的排列方式不同而存在着差异,进而会影响到整个电压控制振荡器的特性而产生相位差不同以及频率偏移,因此如何改善电压控制振荡器因为使用多级反相器进行频率振荡而于集成电路布局上因为线路的配置所产生信号间的相位差不同的问题,即成为改善电压控制振荡器的输出频率稳定的重要课题。
发明内容
因此,本发明的目的之一在于提供一种电子元件的排列方式,可改善以往集成电路布局的接线不匹配而产生电子元件的特性偏移的问题。
本发明揭露一种电子元件,包含有N个电子元件,N为奇数,其中该N个电子元件是包含一第一组电子元件以及一第二组电子元件,该第一组电子元件是依据一第一预定方式进行排列,而其第二组电子元件是依据一第二预定方式进行排列,其中该第二组电子元件是相邻于该第一组电子元件。其中该第一预定方式是将该第一组电子元件自第1个电子元件依奇数顺序由小至大排列至第N个电子元件,而该第二预定方式是将该第二组元件自该第2个电子元件依偶数顺序由小至大排列至第N-1个电子元件。
本发明提供一种电子元件的排列方式,其是适用于N个电子元件的排列,N为奇数,其中该N个电子元件是包含一第一组电子元件以及一第二组电子元件,该第一组电子元件是依据一第一预定方式进行排列,而其第二组电子元件是依据一第二预定方式进行排列,其中该第二组电子元件是相邻于该第一组电子元件。
本发明所述的电子元件的排列方式,其中该第一组电子元件是包含该N个电子元件中的奇数电子元件,而该第二组电子元件是包含该N个电子元件中的偶数电子元件。
本发明所述的电子元件的排列方式,其中该第一预定方式是将该第一组电子元件自第1个电子元件依奇数顺序由小至大排列至第N个电子元件,而该第二预定方式是将该第二组元件自该第2个电子元件依偶数顺序由小至大排列至第N-1个电子元件。
本发明所述的电子元件的排列方式,其中该N个电子元件中每一个电子元件皆包含一输入端及一输出端,该N个电子元件中的一第n个电子元件的输入端是耦接于一第n-1个电子元件所产生的输出端,其中1≤n≤N,n为一正整数,而该第1个电子元件的输入端是耦接于第N个电子元件的输出端。
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