[发明专利]一种传输控制装置及其控制方法有效
申请号: | 200710040650.9 | 申请日: | 2007-05-15 |
公开(公告)号: | CN101056157A | 公开(公告)日: | 2007-10-17 |
发明(设计)人: | 李焕炀;陈勇辉;周畅;严天宏 | 申请(专利权)人: | 上海微电子装备有限公司 |
主分类号: | H04L1/00 | 分类号: | H04L1/00 |
代理公司: | 上海智信专利代理有限公司 | 代理人: | 王洁 |
地址: | 201203上海市*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 传输 控制 装置 及其 方法 | ||
1.一种传输控制装置(100),其特征在于,包括:双端口随机存储器(5)、发送控制器(6)、接收控制器(7)、发送控制寄存器(8)、接收控制寄存器(9)、发送状态寄存器(10)、接收状态寄存器(11)、校验计算/纠错编码器(12)、校验检验/纠错译码器(13)、发送接口(14)、接收接口(15)及内部收发总线(16);其中,双端口随机存储器(5)与内部收发总线(16)相连,发送控制器(6)分别连接至校验计算/纠错编码器(12)、发送接口(14)和内部收发总线(16),接收控制器(7)分别连接到校验检验/纠错译码器(13)、接收接口(15)和内部收发总线(16),发送控制寄存器(8)通过校验计算/纠错编码器(12)连接至发送接口(14),接收控制寄存器(9)通过校验检验/纠错译码器(13)连接至接收接口(15),发送状态寄存器(10)分别连接至校验计算/纠错编码器(12)和发送接口(14),接收状态寄存器(11)分别连接至校验检验/纠错译码器(13)和接收接口(15);
所述双端口随机存储器(5)用于缓存需要发送或需要接收的数据;发送控制器(6)用于控制数据的发送;接收控制器(7)用于控制数据的接收;发送控制寄存器(8)用于储存发送帧的起始地址、帧长度和纠错编码所需的参数;接收控制寄存器(9)用于储存接收帧的起始地址、帧长度和纠错译码所需的参数;发送状态寄存器(10)用于存储帧发送和校验计算的状态;接收状态寄存器(11)用于存储帧接收和校验的状态;校验计算/纠错编码器(12)用于计算校验值或进行纠错编码,所计算的校验值或进行纠错编码后的值传送至发送控制寄存器(8);校验检验/纠错译码器(13)用于计算所发送数据的校验值,并与发送过来的校验值进行校验,若出错,则将出错状态写入接收状态寄存器(11)中,或者对所发送过来的数据进行纠错译码;发送接口(14)用于发送需要传送的帧;接收接口(15)用于接收需要接收的帧;内部收发总线(16)用于实现双端口随机存储器(5)、发送控制器(6)、接收控制器(7)、校验计算/纠错编码器(12)、校验检验/纠错译码器(13)之间的实时数据交换。
2.如权利要求1所述的传输控制装置(100),其特征在于:发送控制器(6)对内部收发总线(16)进行读出访问控制,对校验计算/纠错编码器(12)进行读写访问控制,对发送接口(14)进行写入访问控制;接收控制器(7)对内部收发总线(16)进行写入访问控制,对校验检验/纠错译码器(13)进行读写访问控制,对接收接口(15)进行写入访问控制;内部收发总线(16)对双端口随机存储器(5)进行读写访问控制。
3.如权利要求2所述的传输控制装置(100),其特征在于:内部收发总线(16)还分别连接至校验计算/纠错编码器(12)和校验检验/纠错译码器(13),且内部收发总线(16)对校验计算/纠错编码器(12)进行写入访问控制,对校验检验/纠错译码器(13)进行读写访问控制。
4.一种包括如权利要求1或2或3所述的传输控制装置(100)的信息收发主控装置(200),其特征在于,还包括:微处理器(1)、只读随机存储器(2)、可读写随机存储器(3)和主控总线(17);主控总线(17)分别以读写访问控制方式连接至微处理器(1)、只读随机存储器(2)和可读写随机存储器(3);主控总线(17)还分别连接至传输控制装置(100)中的双端口随机存储器(5)、发送控制器(6)、接收控制器(7)、发送控制寄存器(8)、接收控制寄存器(9)、发送状态寄存器(10)和接收状态寄存器(11)。
5.如权利要求4所述的信息收发主控装置(200),其特征在于:可读写随机存储器(3)可选自静态随机存储器和动态随机存储器。
6.如权利要求4所述的信息收发主控装置(200),其特征在于:主控总线(17)对发送控制器(6)和接收控制器(7)进行写入访问,对发送状态寄存器(10)和接收状态寄存器(11)进行读出访问,对双端口随机存储器(5)、发送控制寄存器(8)和接收控制寄存器(9)进行读写访问。
7.如权利要求4所述的信息收发主控装置(200),其特征在于:该信息收发主控装置还包括一中断控制器(4),其一端与微处理器(1)相连接,另一端与传输控制装置中的双端口随机存储器(5)相连接,所述中断控制器(4)同时与主控总线(17)相连。
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