[发明专利]存储器控制电路与方法有效
申请号: | 200610154296.8 | 申请日: | 2006-09-20 |
公开(公告)号: | CN101149967A | 公开(公告)日: | 2008-03-26 |
发明(设计)人: | 郑文昌 | 申请(专利权)人: | 南亚科技股份有限公司 |
主分类号: | G11C11/4076 | 分类号: | G11C11/4076;G11C11/413 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 蒲迈文;黄小临 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 存储器 控制电路 方法 | ||
1.一种存储器控制电路,其包含有:
一相位检测模块,用来检测一数据频闪讯号与一时钟讯号之间的相位差;
一控制模块,耦接至该相位检测模块,用来依据该相位差来产生一组控制讯号,其中该组控制讯号对应于该相位差;
一锁存模块,用来依据该数据频闪讯号的上升缘/下降缘来锁存一数据讯号所载的写入数据;
一奇偶数据分离器,耦接至该锁存模块,用来对该写入数据进行奇偶数据分离处理,以产生一数据分离讯号,其中该数据分离讯号载有对应于该写入数据的奇/偶数据;以及
一可调延迟线模块,耦接至该奇偶数据分离器以及该控制模块,用来依据该组控制讯号来调整该数据分离讯号所载的奇/偶数据的延迟,其中该奇/偶数据的延迟量对应于该组控制讯号。
2.如权利要求1所述的存储器控制电路,其中该数据讯号为DQ讯号,而该数据频闪讯号为DQS讯号。
3.如权利要求1所述的存储器控制电路,其中该相位检测模块包含有:
两接收单元,分别用来接收该时钟讯号与该数据频闪讯号;以及
一相位检测器,耦接至该两接收单元,用来检测该相位差。
4.如权利要求3所述的存储器控制电路,其中该相位检测模块还包含有:
一延迟吻合控制器,耦接至该两接收单元当中的至少一接收单元,该延迟吻合控制器包含有至少一延迟线,用来延迟该时钟讯号及/或该数据频闪讯号;
其中该相位检测器依据该至少一延迟线所延迟的该时钟讯号及/或该数据频闪讯号来检测该相位差。
5.如权利要求1所述的存储器控制电路,其中该控制模块为一译码器,用来依据该相位差进行译码以产生该组控制讯号。
6.如权利要求1所述的存储器控制电路,其中该该锁存模块包含有多个锁存,分别对应该数据讯号的多个位。
7.如权利要求1所述的存储器控制电路,其中该可调延迟线模块包含有多个可调延迟线,分别对应于该数据分离讯号的多个位,以及每一可调延迟线施加对应该组控制讯号的延迟量于该数据分离讯号的一个位。
8.如权利要求7所述的存储器控制电路,其中该可调延迟线模块中的每一可调延迟线包含有多个延迟单元。
9.如权利要求1所述的存储器控制电路,其还包含有:
一缓冲模块,耦接至该可调延迟线模块,用来对延迟后的奇/偶数据进行缓冲控制。
10.如权利要求9所述的存储器控制电路,其还包含有:
一开关模块,耦接至该缓冲模块,用来依据至少一选择讯号来输出该延迟后的奇/偶数据。
11.一种存储器控制方法,其包含有:
检测一数据频闪讯号与一时钟讯号之间的相位差;
依据该相位差来产生一组控制讯号,其中该组控制讯号对应于该相位差;
依据该数据频闪讯号的上升缘/下降缘来锁存一数据讯号所载的写入数据;
对该写入数据进行奇偶数据分离处理,以产生一数据分离讯号,其中该数据分离讯号载有对应于该写入数据的奇/偶数据;以及
依据该组控制讯号来调整该数据分离讯号所载的奇/偶数据的延迟,其中该奇/偶数据的延迟量对应于该组控制讯号。
12.如权利要求11所述的存储器控制方法,其中该数据讯号为DQ讯号,而该数据频闪讯号为DQS讯号。
13.如权利要求11所述的存储器控制方法,其中检测该数据频闪讯号与该时钟讯号之间的相位差的步骤还包含有:
分别接收该时钟讯号与该数据频闪讯号;
利用至少一延迟线来延迟该时钟讯号及/或该数据频闪讯号;以及
依据该至少一延迟线所延迟的该时钟讯号及/或该数据频闪讯号来检测该相位差。
14.如权利要求11所述的存储器控制方法,其中依据该相位差来产生该组控制讯号的步骤还包含有:
依据该相位差进行译码以产生该组控制讯号。
15.如权利要求11所述的存储器控制方法,其中依据该数据频闪讯号的上升缘/下降缘来锁存该数据讯号所载的写入数据的步骤还包含有:
利用多个锁存来锁存该数据讯号所载的写入数据,其中该多个锁存分别对应该数据讯号的多个位。
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