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[实用新型]差压式电脑流量计-CN96233963.6无效
发明人：黄渝笙 -专利权人：黄渝笙
申请日： 1996-10-25 - 公布日： 1998-08-26 - 主分类号： G01F1/38 文献下载
摘要：主控芯片8098由地址锁存器分别连接两非易失RAM和－EPROM,由译码器分别连接8155和8279再分别经接口电路连接打印机和显示板,完成数据采集,提取计算和显示输出,是一种可靠性高、精度高、抗干扰性强的自动化仪器
差压式电脑流量计

[发明专利]非易失性半导体存储器及其操作方法-CN01823579.4无效
发明人：崔雄林 -专利权人：崔雄林
申请日： 2001-12-05 - 公布日： 2004-11-10 - 主分类号： G11C16/04 文献下载
摘要：本发明公开了一种非易失性半导体存储器及其操作方法，存储器包括：具有有源区和场区的半导体衬底；至少两个非易失性存储晶体管，每个非易失性存储晶体管有在有源区的存储器和在存储器的控制栅，每一个控制栅置于单个控制板中；和至少两个选择晶体管，每个选择晶体管对应每个非易失性存储晶体管，每个选择晶体管连接到对应的每个非易失性存储晶体管，用于选择对应的每个非易失性存储晶体管。
非易失性半导体存储器及其操作方法

[发明专利]基于非易失存储器件的存内计算电路和方法-CN202210185373.5在审
发明人：李威;阮爱武;尹自强;吴方明;杜涛 -专利权人：成都市硅海武林科技有限公司
申请日： 2022-02-28 - 公布日： 2022-06-14 - 主分类号： G11C16/08 文献下载
摘要：本发明涉及集成电路技术领域，涉及一种基于非易失存储器件的存内计算电路和方法，电路包括基于非易失存储器件的单元电路，利用一个以上的单元电路构成阵列电路，阵列电路用于存内计算；单元电路中，非易失存储器件一端与位线BL相连，非易失存储器件另一端与第一NMOS管M1漏极相连；第一NMOS管M1源极与第二NMOS管M2的漏极相连，第一NMOS管M1栅极与第二位线WLB相连；第二NMOS管M2源极与源线SL相连，第二NMOS本发明所实现的存内计算具有高集成度、低功耗、高性能的优点，可以用于神经网络运算的加速等多种应用。
基于非易失存储器件计算电路方法

[发明专利]以多个非易失性存储器为特征的高性能存储结构和系统-CN201180075716.2在审
发明人： S.N.特里卡;K.S.格林斯鲁德 -专利权人：英特尔公司
申请日： 2011-12-21 - 公布日： 2014-08-20 - 主分类号： G06F13/14 文献下载
摘要：一种存储器存储系统，其包括至少存储控制器、第一非易失性固态存储器和第二非易失性固态存储器。该存储控制器具有用于从主机系统接收命令的接口。第一非易失性固态存储器与存储控制器耦合以至少存储从主机系统接收的数据。第二非易失性固态存储器与存储控制器耦合以存储上下文信息，其对应于存储在第一非易失性固态存储器装置中的数据。
非易失性存储器特征性能存储结构系统

[发明专利]一种电荷泵系统及非易失存储器-CN201811110499.6有效
发明人：魏胜涛;梅健平;陈晓璐 -专利权人：北京兆易创新科技股份有限公司;合肥格易集成电路有限公司
申请日： 2018-09-21 - 公布日： 2022-05-03 - 主分类号： G11C5/14 文献下载
摘要：本发明实施例提供了一种电荷泵系统及非易失存储器，该系统包括：包括了振荡器单元、电荷泵单元；振荡器单元的输出端与电荷泵单元的输入端连接，用于通过振荡器单元的输出端的输出信号，控制电荷泵单元进行冲压；振荡器单元包括：延时反相电路、锁存器；锁存器包括：第一输入接口、第二输入接口和第一输出接口；延时反相电路的输出端与第一输入接口连接；第一输出接口与电荷泵单元的输入端连接；第二输入接口作为所述振荡器单元的输入端，用于接收使能信号本发明实施例在振荡器单元中设置了锁存器，当使能信号拉低时，锁存器可以将时钟信号锁存在使能信号下降沿出现前的状态，因此能有效避免电荷泵系统中的毛刺，避免电荷泵单元出现过冲。
一种电荷系统非易失存储器

[发明专利]非易失性存储介质的数据更新方法、装置及存储介质-CN201910127182.1有效
发明人：周芦明;庄永康;王伟峰 -专利权人：深圳市汇顶科技股份有限公司
申请日： 2019-02-20 - 公布日： 2021-05-11 - 主分类号： G06F11/14 文献下载
摘要：本发明提供一种非易失性存储介质的数据更新方法、装置及存储介质，该包括：获取非易失性存储介质上的第一管理块，第一管理块包括：多个数据块的最新特征信息，多个数据块包括第一数据块和第二数据块，第一数据块为待更新数据块；根据第一管理块确定第一数据块；根据第一管理块确定第二数据块；根据第一数据块，更新第二数据块；生成第二管理块信息，第二管理块信息包括多个数据块的更新信息；根据第二管理块信息，更新第二管理块，不仅实现了非易失性存储介质的数据更新，而且实现了非易失性存介质的掉电保护，且有效降低了成本。
非易失性存储介质数据更新方法装置

[发明专利]一种保护易失性记录装置数据的系统与方法-CN200510023065.9有效
发明人：廖哲贤;林家鸿;高定国 -专利权人：技嘉科技股份有限公司
申请日： 2005-12-28 - 公布日： 2007-07-04 - 主分类号： G06F11/14 文献下载
摘要：本发明提出一种保护易失性记录装置数据的系统与方法，用以提高易失性记录装置中数字数据的保存安全性及增加易失性记录装置的使用年限。该保护易失性记录装置数据的系统包括：一电子计算器、一易失性记录装置、一非易失性记录装置及一应用软件，其中所述电子计算器具有中央处理器；所述易失性记录装置，与电子计算器连接，用于储存数字数据；所述非易失性记录装置，与电子计算器连接，用于储存数字数据；及所述应用软件，用于将储存于易失性记录装置中的数字数据，转存至非易失性记录装置中储存。
一种保护易失性记录装置数据系统方法

[发明专利]一种多线程快速周期串行外设操作非易失存储器的方法-CN201711360569.9有效
发明人：董少阳;李泽林;苏二峰;谢卫;许斌斌 -专利权人：中国航空工业集团公司西安飞行自动控制研究所
申请日： 2017-12-15 - 公布日： 2021-04-20 - 主分类号： G06F3/06 文献下载
摘要：本发明属于软件操控非易失存储器技术，具体涉及一种多线程快速周期串行外设操作非易失存储器的方法。本发明中主要针对CPU软件快速周期读写耗时较长的非易失存储器问题，在软件的运行周期中，有多个任务可能同时需要对非易失存储器进行读写，本方法设置了队列的模式对同时需要非易失存储器的操作进行队列排序，并且通过信号量Mutex互斥对非易失存储器进行管理。当多个非易失存储器读写请求到来时，首先对所有的请求进行队列的排序，并一一处理，在处理过程中，再次发生了非易失存储器读写请求时，则使用互斥信号量Mutex对非易失存储器进行保护，确保非易失存储器读写数据的准确性，并进一步提高CPU工作效率和安全性。
一种多线程快速周期串行外设操作非易失存储器方法

[发明专利]具有非易失性逻辑阵列备份相关应用的处理装置-CN201811580481.2有效
发明人： S·C·巴特林;S·卡纳 -专利权人：德克萨斯仪器股份有限公司
申请日： 2013-09-10 - 公布日： 2023-08-15 - 主分类号： G11C16/06 文献下载
摘要：本发明提供具有非易失性逻辑阵列备份相关应用的处理装置。一种处理装置(100)，使用多个易失性存储元件(120)操作。多个易失性存储元件(120)的N组的每组的M个易失性存储元件通过使用多路复用器(212)被连接到多个非易失性逻辑元件阵列中的N乘M大小的非易失性逻辑元件阵列(110)。多路复用器(212)连接N组中的一组到N乘M大小的非易失性逻辑元件阵列(110)以一次将来自M个易失性存储元件(120)的数据存储到N乘M大小的非易失性逻辑元件阵列(110)的一行中，或者一次将来自N乘M大小的非易失性逻辑元件阵列(110)的一行的数据写入到M个易失性存储元件(120)。相应的非易失性逻辑控制器(106)控制多路复用器(212)关于易失性存储元件(120)和非易失性存储元件(110)之间的连接的操作。
具有非易失性逻辑阵列备份相关应用处理装置

[发明专利]基于跨多个装置的协调内部地址方案的冗余编码条带-CN201880063221.X有效
发明人： V.博尔希维廷;W.F.克鲁格;B.W.奥克拉夫卡;S.苏巴拉奥 -专利权人：西部数据技术公司
申请日： 2018-09-24 - 公布日： 2023-09-12 - 主分类号： G06F11/00 文献下载
摘要：一种系统和方法涉及操作非易失性存储器系统。本文中所公开的技术高效地使用在非易失性存储器系统中的非易失性存储装置中可用的存储器。在一些方面中，非易失性存储装置跨所述非易失性存储装置执行冗余编码条带，所述冗余编码条带由具有跨所述存储装置用协调方案指派的内部地址的数据分块形成。在一些方面中，非易失性存储装置跨所述非易失性存储装置在相应非易失性存储装置中的相同内部地址处执行冗余编码条带。
基于跨多个装置协调内部地址方案冗余编码条带

[发明专利]一种基于非易失存储器的遥感数据快存方法-CN201910402403.1有效
发明人：安庆;欧阳玉华;柳立生;崔海容 -专利权人：武昌理工学院
申请日： 2019-05-15 - 公布日： 2021-06-01 - 主分类号： G06F12/02 文献下载
摘要：本发明提供一种基于非易失存储器的遥感数据快存方法，涉及数据存储技术领域，该方法包括以下步骤：S1：获取非易失存储器的起始擦写地址；S2：输入遥感数据时，提取基准影像获取初步地理信息匹配值；S3：判断再一次输入的地理信息匹配值与初步地理信息匹配值相识度是否大于预定阈值本发明一种基于非易失存储器的遥感数据快存方法数据存储快速，准确性高，误差小，可以进行数据对比修正，存储数据方便查询。
一种基于非易失存储器遥感数据方法

[发明专利]能降低功耗的电子装置及降低电子装置功耗的方法-CN201510460607.2有效
发明人：杨任花;赵俊峰;杨伟;肖世海;林殷茵;韦祎 -专利权人：华为技术有限公司;复旦大学
申请日： 2015-07-30 - 公布日： 2020-04-28 - 主分类号： G06F1/3287 文献下载
摘要：一种能降低功耗的电子装置及降低电子装置功耗的方法，所述电子装置包括处理器、易失性内存、及非易失性内存，所述非易失性内存存储第一操作系统，所述电子装置在第一工作模式和第二工作模式下工作；当所述电子装置处于所述第一工作模式时，第二操作系统在所述易失性内存中运行，在所述处理器侦测到所述电子装置达到预设的进入所述第二工作模式的条件时，开启所述非易失性内存，移动所述易失性内存中的非系统数据至所述非易失性内存中，所述非系统数据不包括所述第二操作系统，在所述非系统数据移动完成后，关闭所述易失性内存，在所述非易失性内存中运行所述第一操作系统，使所述电子装置进入所述第二工作模式。
降低功耗电子装置方法

[发明专利]具有非易失性逻辑阵列备份相关应用的处理装置-CN201310532311.8有效
发明人： S·C·巴特林;S·卡纳 -专利权人：德克萨斯仪器股份有限公司
申请日： 2013-09-10 - 公布日： 2019-01-18 - 主分类号： G11C16/06 文献下载
摘要：一种处理装置(100)，使用多个易失性存储元件(120)操作。多个易失性存储元件(120)的N组的每组的M个易失性存储元件通过使用多路复用器(212)被连接到多个非易失性逻辑元件阵列中的N乘M大小的非易失性逻辑元件阵列(110)。多路复用器(212)连接N组中的一组到N乘M大小的非易失性逻辑元件阵列(110)以一次将来自M个易失性存储元件(120)的数据存储到N乘M大小的非易失性逻辑元件阵列(110)的一行中，或者一次将来自N乘M大小的非易失性逻辑元件阵列(110)的一行的数据写入到M个易失性存储元件(120)。相应的非易失性逻辑控制器(106)控制多路复用器(212)关于易失性存储元件(120)和非易失性存储元件(110)之间的连接的操作。
具有非易失性逻辑阵列备份相关应用处理装置

[发明专利]一种存储芯片-CN201510289518.6有效
发明人：景蔚亮 -专利权人：上海新储集成电路有限公司
申请日： 2015-05-29 - 公布日： 2020-01-07 - 主分类号： G06F15/78 文献下载
摘要：本发明充分利用了3D存储阵列下面的硅片未利用空间，同时也将南桥及其IO设备功能模块和/或可信平台模块/可信密码模块(TPM/TCM)芯片功能集成在内，同时也可将3D新型非易失性存储器芯片的一部分作为基本输入输出系统(BIOS)功能，而3D新型非易失性存储芯片还可作为混合内存或混合缓存器的非易失性部分。通过多芯片封装技术将本发明3D新型非易失性存储芯片与处理器、片外最后一级易失性高速缓芯片存封装在一个封装体内，从而大大减少了母板面积和走线，有益于节省功耗和成本，同时由于本发明3D新型非易失性存储器与处理器封装在同一个封装体内
一种存储芯片

[发明专利]带有动态数据锁存器要求的高速缓存操作中的适应性算法-CN200980117908.8无效
发明人：李艳;戈保凌 -专利权人：桑迪士克公司
申请日： 2009-02-19 - 公布日： 2011-04-27 - 主分类号： G11C16/10 文献下载
摘要：一种非易失存储器可以使用存储在相应组的数据锁存器中的第一数据集对指定组的一个或多个寻址的页进行第一操作(例如诸如写入)，并且还接收对于也使用带有第二数据集的这些相应的数据锁存器中的一些的第二操作(例如诸如读取在所述第一操作期间，当相应的每组的至少一个数据锁存器变得可用于所述第二操作时，所述存储器确定是否存在足够数量的相应组的数据锁存器来在所述第一操作期间进行所述第二操作；如果不存在，则延迟第二操作。当足够数量的锁存器变得可用时，所述存储器锁随后可以在所述第一操作期间进行所述第二操作；并且如果响应于确定是否存在足够数量的相应组的数据锁存器来进行所述第二操作，确定存在足够的数量，则在所述第一操作期间进行所述第二操作
带有动态数据锁存器要求高速缓存操作中的适应性算法

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