专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]处理系统及其访存方法-CN201710796762.0有效
  • 胡迪;齐宗普;赵薇;喻津;孟磊 - 上海兆芯集成电路有限公司
  • 2017-09-06 - 2020-04-07 - G06F13/16
  • 一种处理系统及其访存方法,处理系统包括:高速缓存器、主机存储器、中央处理器以及硬件加速器。中央处理器访问高速缓存器以及主机存储器,且发出至少一指令。硬件加速器根据指令的访存行为,操作于非时间局部性访存模式以及时间局部性访存模式之一。当操作于非时间局部性访存模式时,硬件加速器通过加速器接口访问主机存储器。当操作于时间局部性访存模式时,硬件加速器通过加速器接口访问高速缓存器。本发明不仅可避免污染高速缓存器,还可增进访存效率。
  • 处理系统及其方法
  • [发明专利]硬件加速器引擎-CN201710912345.8有效
  • T·勃伊施;G·德索利 - 意法半导体股份有限公司;意法半导体国际有限公司
  • 2017-09-29 - 2022-08-23 - G06N3/063
  • 本公开涉及硬件加速器引擎。实施例涉及支持深度神经网络算法卷积阶段的有效映射的硬件加速器引擎。硬件加速器引擎包括多个卷积加速器,并且多个卷积加速器中的每一个包括内核缓冲器、特征线缓冲器和多个乘法累加(MAC)单元。MAC单元被布置为对从内核缓冲器和特征线缓冲器两者接收的数据进行乘法和累加。硬件加速器引擎还包括耦合到串流开关的输出总线端口的至少一个输入总线、耦合到串流开关的输入总线端口的至少一个输出总线、或硬连线到串流开关的相应输出总线和输入总线端口的至少一个输入总线和至少一个输出总线。
  • 硬件加速器引擎
  • [发明专利]基于PLI-VPI和专用加速硬件的仿真硬件加速-CN201410849200.4在审
  • 杨利民 - 天津益华微电子有限公司
  • 2014-12-31 - 2016-07-27 - G06F11/26
  • 本发明创造设计一种利用高端多核中央处理器CPU以及基于PCIe快速互联总线的专用仿真加速处理器(VPU)上大量逻辑运算处理单元体系结构的并行性,通过业界PLI/VPI接口协议标准和行业内标准仿真工具软件无缝链接,结合并行处理软硬件技术来构建加速硬件的仿真硬件加速器,该加速器是由中央处理器CPU,主板芯片组,内存,硬盘,光驱,电源,扩展口,专用硬件加速卡PCIE卡组成。所述中央处理器CPU包括4wayCPU;所述专用硬件加速卡包括4way专用硬件加速卡,形成SOC计算阵列;本发明创造提高了仿真效率,减少了仿真复杂度,缩短了仿真时间,为集成电路系统设计中完成了关键的一环
  • 基于plivpi专用加速硬件仿真加速器
  • [发明专利]硬件加速系统、方法及相关装置-CN202310502779.6有效
  • 郑瀚寻;马学韬;杨龚轶凡;闯小明;陆涵枭 - 苏州仰思坪半导体有限公司
  • 2023-05-06 - 2023-08-18 - G06T1/20
  • 本申请实施例提供了一种硬件加速系统、方法及相关装置。该方法包括:处理器获取第一可执行程序;识别第一可执行程序中的待加速模块;待加速模块用于实现第一可执行程序中的特定计算功能,第一可执行程序中多个待加速模块按照顺序执行;将待加速模块重新构建为目标模块得到第二可执行程序;第二可执行程序中多个目标模块并发执行以实现对物体定位程序的硬件加速;将第二可执行程序发送给FPGA,以使FPGA执行第二可执行程序,实现对物体定位系统的硬件加速。通过将可执行程序中按照顺序执行的待加速模块更新为并发执行的目标模块,本申请能够实现对可执行程序中特定计算功能的硬件加速,在硬件电路结构层面上架构出流水线模式,提升数据处理效率。
  • 硬件加速系统方法相关装置
  • [发明专利]一种软硬件协同的报文加速方法和装置-CN202010717720.5有效
  • 王中辉;朱圣龙;谢绍新;张伟 - 烽火通信科技股份有限公司;武汉飞思灵微电子技术有限公司
  • 2020-07-23 - 2022-04-15 - H04L47/125
  • 本发明公开了一种软硬件协同的报文加速方法和装置,该报文加速方法包括:软件加速层判断报文中是否携带有标记信息;若报文中没有携带标记信息,则通过协议栈对报文进行转发,并根据协议栈的转发结果得到报文的硬件加速行为和软件加速行为;软件加速层根据报文的业务类型分配标记信息,依据标记信息建立业务处理模块,并将软件加速行为下发至业务处理模块;软件加速层根据报文的特征信息建立硬件查找规则,并建立硬件查找规则、硬件加速行为和标记信息的第一关联关系,将第一关联关系下发至硬件加速层;若报文中携带有标记信息,则根据报文的标记信息将报文分配至相应的业务处理模块,业务处理模块根据相应的软件加速行为对报文进行软件加速
  • 一种软硬件协同报文加速方法装置
  • [发明专利]用于多用户场景的上行信道估计方法及系统-CN201410445318.0在审
  • 俞林宏 - 武汉邮电科学研究院
  • 2014-09-03 - 2015-01-21 - H04L27/26
  • 一种用于多用户场景的上行信道估计方法及系统,包括进行前端处理,资源解映射,复相关;并行执行离散傅里叶逆变换和时域平滑,当硬件加速器DFTPE对第i-1个用户的离散傅里叶逆变换完成时,核做第i-1个用户的时域平滑处理,同时硬件加速器DFPTE继续第i个用户的离散傅里叶逆变换;并行执行离散傅里叶变换和均衡以及后继处理,硬件加速器DFTPE对第i-1个用户的离散傅里叶变换完成时,核做第i-1个用户的均衡以及后继处理,同时硬件加速器本发明根据多用户场景的特点,用硬件加速器DFPTE和DSP核并行计算,完成信道估计,降低数据处理时间,提高接收机运算效率。
  • 用于多用户场景上行信道估计方法系统
  • [发明专利]可编程逻辑电路中硬件加速器镜像的测试与修复-CN201380073319.0在审
  • E·克鲁格里克 - 英派尔科技开发有限公司
  • 2013-02-19 - 2015-10-28 - G05B19/05
  • 本文中描述的技术一般包括用于可编程逻辑电路中的硬件加速器镜像的测试和修复的方法。在包括多个可编程逻辑电路的处理器芯片中,通过用复制的硬件加速器镜像对测试电路编程以及使测试电路处于与第一可编程逻辑电路相同的逻辑状态,来测试被编程到第一可编程逻辑电路中的硬件加速器镜像。将来自第一可编程逻辑电路的输出和来自测试电路的输出进行比较表明被编程到第一可编程逻辑电路中的硬件加速器镜像的精度。测试电路可以取代第一可编程逻辑电路,或者测试电路可被重新编程,用来测试被编程到处理器芯片的其他可编程逻辑电路中的其他硬件加速器镜像。
  • 可编程逻辑电路硬件加速器测试修复
  • [发明专利]数据处理方法、装置、电子设备以及可读存储介质-CN202211729714.7在审
  • 王涛;张衡;李锋;王献东;袁致远;张俊平 - 天翼云科技有限公司
  • 2022-12-30 - 2023-06-23 - G06F9/455
  • 在本发明实施中提供了一种数据处理方法、装置、电子设备以及可读存储介质,该方法通过在接收到对虚拟机的启动指令的情况下,获取虚拟机的配置文件;在配置文件中包含硬件加速参数项的情况下,在虚拟机的存储处理器的命令参数中增加硬件加速参数项的参数值;响应于对目标数据的存取指令,通过存储处理器调用命令参数中的参数值所指示的硬件加速单元对目标数据进行加解密处理;通过存储处理器对经过加解密处理后的目标数据执行存取操作。这样,可以在对目标数据进行存取时,使存储处理器在运行过程中可以调用硬件加速参数项所指示的硬件加速单元进行加解密处理,无需通过CPU进行加解密操作,释放CPU的算力,优化宿主机整体性能。
  • 数据处理方法装置电子设备以及可读存储介质

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