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[实用新型]一种时钟同步电路和海底地震仪-CN201920324180.7有效
发明人：王宜志;杨挺;刘丹;黄信峰;黄志鹏;潘谟晗;杜浩然;杨港 -专利权人：南方科技大学
申请日： 2019-03-14 - 公布日： 2019-09-24 - 主分类号： G01V1/38 文献下载
摘要：本实用新型公开了一种时钟同步电路和海底地震仪，其中，时钟同步电路包括：主时钟电路、至少一个地震数据采集电路、微处理器控制电路和至少两个分频电路；至少两个分频电路包括第一分频电路和第二分频电路；主时钟电路用于产生主时钟信号；第一分频电路与主时钟电路连接，用于对主时钟信号进行分频处理得到地震数据采集时钟信号；地震数据采集电路与第一分频电路连接，用于获取地震数据采集时钟信号；第二分频电路与主时钟电路连接，用于对主时钟信号进行分频处理得到实时时钟信号；微处理器控制电路与第二分频电路连接，用于获取所述实时时钟信号，本实用新型实施例提供的时钟同步电路时间精度高且功耗低。
分频电路地震数据采集时钟同步电路主时钟电路主时钟信号微处理器控制电路实时时钟信号本实用新型海底地震仪分频处理时钟信号电路功耗

[实用新型]多时钟频率切换电路-CN200320122574.3无效
发明人：王彬 -专利权人：上海华虹集成电路有限责任公司
申请日： 2003-12-18 - 公布日： 2005-01-05 - 主分类号： H03L7/00 文献下载
摘要：本实用新型公开了一种多时钟频率切换电路，旨在提供一种能实现不同时钟频率下无缝过渡的切换电路。其技术方案是：包括时钟同步器和时钟门控电路；所述时钟同步器由D触发器构成，对初始时钟和目标时钟分别进行同步；所述门控电路包括2个或门和一个与门，使同一时钟只能输出一路时钟信号，将原来的始终进行隔离，最终生成所需的时钟
多时频率切换电路

[发明专利]半导体集成电路-CN200410042944.1无效
发明人：柄谷康治;深津元;岛村秋光 -专利权人：松下电器产业株式会社
申请日： 2004-06-04 - 公布日： 2005-02-02 - 主分类号： G06F1/10 文献下载
摘要：例如触发器等同步电路单元，一些组成模块，其它保持不组成模块。在根据本发明的半导体集成电路中，向多个不组成模块的同步电路单元的每一个同步电路单元独立提供时钟产生电路，用于时钟输入，以控制时钟时滞，并且实现更低的功耗。时钟产生电路独立地连接到多个功能模块的每一个功能模块，以用于时钟输入，并且这些多个功能模块每一个都包括多个组成模块的同步电路单元。
半导体集成电路

[发明专利]一种具有抗扰特性的仿生时钟电路及其实现方法-CN201510048774.6有效
发明人：常小龙;张娅;满梦华;马贵蕾 -专利权人：中国人民解放军军械工程学院
申请日： 2015-01-30 - 公布日： 2017-09-29 - 主分类号： H03K3/02 文献下载
摘要：本发明提供了一种具有抗扰特性的仿生时钟电路及其实现方法。该仿生时钟电路包括若干用于产生同步时钟信号的神经元电路单元，神经元电路单元可以设置在芯片或PCB等的需要时钟信号的物理位置上，神经元电路单元之间通过突触电路相互连接形成耦合网络，突触电路能够对神经元电路单元进行调节，在干扰信号输入时，通过突触电路的调节，神经元电路单元依然可以产生与无干扰信号输入时相同的同步时钟信号，从而可减少因干扰造成的时钟抖动。神经元电路单元中的输出端用于输出同步时钟信号，使各部分终端单元电路接收到同步抗扰的时钟信号。本发明可提高同步数字电路系统对复杂电磁干扰环境的适应能力，有效抵御外界干扰，维护电路系统的稳定运行。
一种具有特性仿生时钟电路及其实现方法

[发明专利]控制电路、控制电路的控制方法和成像装置-CN201310230756.0无效
发明人：桑添泰嘉 -专利权人：索尼公司
申请日： 2013-06-09 - 公布日： 2014-01-15 - 主分类号： H04N5/235 文献下载
摘要：提供了一种控制电路、控制电路的控制方法和成像装置。控制电路包括：水平同步时钟计数单元，对用于指示沿以二维栅格形状排列的像素组的水平方向开始扫描像素的定时的水平同步时钟信号的时钟周期的数量进行计数，以用作水平同步时钟计数值；高频时钟计数单元，对具有比水平同步时钟信号高的频率的高频时钟信号的时钟周期的数量进行计数，以用作高频时钟计数值；和定时确定单元，在水平同步时钟计数值和高频时钟计数值的基础上确定开始和结束像素的曝光的定时。
控制电路控制方法成像装置

[发明专利]基于过采样的无需时钟恢复的数据恢复电路-CN201310453283.0有效
发明人：戴颉;职春星 -专利权人：灿芯半导体（上海）有限公司
申请日： 2013-09-29 - 公布日： 2013-12-25 - 主分类号： H03L7/08 文献下载
摘要：本发明公开一种基于过采样的无需时钟恢复的数据恢复电路，该电路包含：锁相环电路；输入端电路连接锁相环电路的过采样电路；输入端电路连接锁相环电路的时钟信号ck0和过采样电路的同步电路；输入端电路连接锁相环电路的时钟信号ck0和同步电路的边沿检测电路；输入端电路连接锁相环电路的时钟信号ck0、同步电路和边沿检测电路的判决电路；输入端电路连接锁相环电路的时钟信号ck0和判决电路的弹性缓冲器。本发明使用过采样在无需时钟恢复的情况下进行数据恢复以节省时钟恢复电路并便于进行同步电路设计以节省电路面积和功耗，高了电路的可靠性，降低了接收电路的误码率。
基于采样无需时钟恢复数据电路

[发明专利]时钟合成系统、电路和方法-CN201180008809.3有效
发明人：肯德尔·卡斯特-佩里 -专利权人：赛普拉斯半导体公司
申请日： 2011-02-22 - 公布日： 2012-10-24 - 主分类号： H03L7/183 文献下载
摘要：一种时钟合成系统可以包括前馈分频器电路、调制器、倍频器电路及定时电路，所述前馈分频器电路被配置成响应于选择信号将源时钟信号按多个整数中的一个分频以生成与同步脉冲同步的基准时钟；调制器响应于至少一个差值来调制选择信号；倍频器电路倍频基准时钟以生成输出时钟；定时电路响应于源时钟和同步脉冲来生成差值。
时钟合成系统电路方法

[发明专利]时钟恢复电路-CN98120012.5无效
发明人：佐伯贵範 -专利权人：日本电气株式会社
申请日： 1998-09-18 - 公布日： 2002-08-21 - 主分类号： H03B5/06 文献下载
摘要：这里公开了一种能够缩短获得同步状态所需时间的时钟恢复电路，该电路包括一个第一同步延迟电路，参考时钟和数据输入到其上，用于输出第一时钟；以及一个第二同步延迟电路，参考时钟和由反相器对数据反相获得的信号输入到其上，用于输出第二时钟。第一和第二时钟由一个脉冲合并电路进行合并，以产生一个提取时钟。提取出的时钟用作一个锁定电路的锁定计时。
时钟恢复电路

[发明专利]时钟同步方法及其所用的装置-CN99122001.3无效
发明人：河内义和 -专利权人：恩益禧电子股份有限公司
申请日： 1999-10-22 - 公布日： 2004-07-07 - 主分类号： H04L12/28 文献下载
摘要：一种通过减少同步所需的存储容量而被简化的时钟同步电路。该时钟同步电路包括存储器、写指针产生电路、数据保持检测电路和读指针产生电路。数据保持检测电路检测到存储器中不存在数据时，读指针产生电路将输入或输出时钟中的任一个或全部重新初始化。在完成数据写入存储器的操作后，由写指针产生电路和读指针产生电路更新各指针、并通过往存储器中写入数据或从存储器中读出数据把与输入时钟同步输入的数据和输出时钟同步输出。
时钟同步方法及其所用装置

[发明专利]分组交换网络传递时钟同步信息的方法及电路仿真通信设备-CN200710000777.8有效
发明人：魏初舜;于洋 -专利权人：杭州华三通信技术有限公司
申请日： 2007-01-19 - 公布日： 2008-07-23 - 主分类号： H04L12/56 文献下载
摘要：本发明公开了一种分组交换网络传递时钟同步信息的方法，所述分组交换网络包括至少2个网段，由通信节点连接相邻的第一PSN网段和第二PSN网段：在通信节点上按照第一同步时钟方式从第一PSN网段获得时钟同步信息；将获得的时钟同步信息按照第二同步时钟方式向第二PSN网段传递。本发明在一分组交换网中分段进行电路仿真，充分利用分组交换网的同步时钟源实施相对可靠的共同时钟方式电路仿真或差分恢复时钟方式电路仿真，可以减小自适应恢复时钟方式电路仿真跨越的网段；能够大大提高恢复时钟的精度和稳定性本发明还公开了一种分组交换网电路仿真设备，其有利于在一分组交换网中分段进行电路仿真的具体实施。
分组交换网络传递时钟同步信息方法电路仿真通信设备

[发明专利]检测电路、方法、芯片及设备-CN201880001249.0在审
发明人：申艾麟;韦健 -专利权人：深圳市汇顶科技股份有限公司
申请日： 2018-08-21 - 公布日： 2020-04-28 - 主分类号： H03K21/40 文献下载
摘要：本申请提供一种检测电路、方法、芯片及设备，该电路包括同步模块和与该同步电路连接的检测模块；该同步模块将使能信号的时钟域同步，将每路时钟信号的时钟域对应的使能信号传输至检测模块；检测模块在使能信号的作用下对每路时钟信号进行检测，得到每路时钟信号的频率。本申请可准确检测时钟信号的频率，保证信息安全。
检测电路方法芯片设备

[发明专利]无参考时钟的时钟数据恢复装置及其方法-CN202110776755.0在审
发明人：庄修铭;唐伟诚;高立龙 -专利权人：瑞昱半导体股份有限公司
申请日： 2021-07-09 - 公布日： 2022-07-29 - 主分类号： H04L7/00 文献下载
摘要：一种无参考时钟的时钟数据恢复装置及其方法，该无参考时钟的时钟数据恢复装置包含一时钟数据恢复电路、一振荡电路以及一处理器。时钟数据恢复电路用以根据在第一时段为第一频率的数据信号同步出第一时钟信号。振荡电路用以根据第一时钟信号输出振荡时钟信号。振荡时钟信号的频率与第一时钟信号的频率实质相同。处理器对在第二时段的数据信号进行过取样，以产生模拟预备信号。模拟预备信号符合数据信号在第二时段的第二频率。时钟数据恢复电路根据模拟预备信号同步出第二时钟信号。在同步出第二时钟信号之前，时钟数据恢复电路同步于振荡时钟信号而维持输出第一时钟信号。
参考时钟数据恢复装置及其方法

[发明专利]同步分离电路及监控器-CN96102720.7无效
发明人：三浦良明 -专利权人：三洋电机株式会社
申请日： 1996-03-01 - 公布日： 2001-05-23 - 主分类号： H04N5/08 文献下载
摘要：一种同步分离电路，具有时钟生成电路，用以生成其频率为包含于复合同步信号中的第一水平同步信号的频率的Ｍ（Ｍ为自然数）倍的时钟信号；水平同步信号生成电路，将根据在一预定期间输入的所述第一水平同步信号在所述时钟生成电路所生成的时钟信号的频率进行１／Ｍ分频，以生成第二水平同步信号；垂直信号生成电路，用以将所述水平同步信号生成电路生成的第二水平同步信号与所述复合同步信号的相位进行比较，将所得的相位差作为垂直同步信号而生成。
同步分离电路监控器

[发明专利]可选择时钟体系结构-CN03812817.9无效
发明人： T·法格尔赫 -专利权人：英特尔公司
申请日： 2003-03-27 - 公布日： 2005-08-24 - 主分类号： H03M9/00 文献下载
摘要：一种方法包括提供第一时钟信号给并行至串行转换电路(54)以及提供第二时钟信号给用于存储由转换电路进行转换的数据的存储器(52)。使第一和第二时钟信号之一有选择地与参考时钟信号同步。使另一个时钟与所述第一或第二时钟同步。可以有选择地将所述同步电路置于第一工作方式以便使第一时钟与参考时钟同步或置于第二工作方式以便使第二时钟与参考时钟同步。
可选择时钟体系结构

[发明专利]时钟生成电路、记录装置和时钟生成方法-CN200810127630.X无效
发明人：佐野达史 -专利权人：索尼株式会社
申请日： 2008-07-02 - 公布日： 2009-01-07 - 主分类号： G11B27/24 文献下载
摘要：本发明提供了一种时钟生成电路、记录装置和时钟生成方法，其中，该时钟生成电路使特定频率的输入信号乘以特定倍频因子并生成输出时钟信号。该时钟生成电路包括：PLL电路，对输入信号进行倍频并生成输出时钟信号；以及校正电路，改变PLL电路的倍频因子。校正电路通过增大或减小特定倍频因子来改变PLL电路的倍频因子，该改变仅在每个校正周期的校正间隔期间执行，校正周期大于输入信号的一个周期，以及改变被执行以使在与输入信号同步的输入同步信号和与输出时钟信号同步的输出同步信号之间的时间差减小PLL电路在校正间隔期间使输入信号乘以改变后的倍频因子。
时钟生成电路记录装置方法