专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种针对深度学习加速的集成电路仿真框架-CN202310346764.5在审
  • 林广栋;陆俊峰;黄光红;刘小明 - 安徽芯纪元科技有限公司
  • 2023-04-03 - 2023-06-30 - G06F30/367
  • 本发明公开了一种针对深度学习加速的集成电路仿真框架,通过与硬件仿真平台运行于同一主机的仿真控制软件执行模型解析、深度学习加速命令生成、数据准备、整体流程控制等过程,对这些过程不再进行硬件仿真仿真控制软件与硬件仿真平台之间通过一组文件进行交互,测试平台读取文件内容,将数据写入仿真环境中的存储器和寄存器,深度学习加速仿真环境中的工作方式与真实芯片一致,从而避免在深度学习加速硬件仿真时引入CPU、加载软件、操作系统、驱动软件等复杂因素,简化仿真过程,同时也省去了仿真CPU上的操作系统、驱动软件运行的过程,仅仅对深度学习加速的计算过程进行仿真,提高了仿真速度。
  • 一种针对深度学习加速集成电路仿真框架
  • [发明专利]一种实现处理器仿真仿真方法及装置-CN201710243286.X有效
  • 吴翔虎 - 直觉系统科技(昆山)有限公司
  • 2017-04-14 - 2020-08-14 - G06F9/455
  • 本发明实施例公开了一种实现处理器仿真仿真方法及装置。该方法包括:S1.根据目标仿真程序获取程序计数器值;S2.根据所述程序计数器值从存储器中获取仿真指令;S3.如果所述仿真指令为断点指令,则根据断点执行类型和所述仿真仿真状态进行断点处理;S4.所述仿真将运行状态切换到预设运行状态;S5.如果所述仿真指令为非断点指令,则执行所述仿真指令,返回执行步骤S1,直至获得仿真结果。本申请提供的实现处理器仿真仿真方法,在仿真程序中加入断点指令,程序的调试可以分段处理,从而提高仿真过程的灵活性。
  • 一种实现处理器仿真方法装置
  • [发明专利]一种多核并行仿真方法及实现多核并行仿真的平台架构-CN202210941533.4有效
  • 易敏;张挺 - 济南新语软件科技有限公司
  • 2022-08-08 - 2022-11-01 - G06F11/26
  • 本发明公开了一种多核并行仿真方法及实现多核并行仿真的平台架构,涉及芯片仿真技术领域。该仿真方法包括:根据设计代码和验证代码,将芯片仿真任务一分为二,得到设计代码仿真任务和验证代码仿真任务;将设计代码仿真任务和验证代码仿真任务分别在不同的CPU上执行;同时,将验证代码仿真任务进一步分配到多个CPU上执行;各个CPU间采用多线程并行方式执行仿真任务。该仿真方法还包括:将设计代码仿真任务中设计代码转换成验证代码,得到转换后的验证代码;将转换后的验证代码分配到新的CPU上执行。该平台架构包括设计仿真模块和验证仿真模块。本发明实现多核并行验证,进行软件仿真加速,提升芯片仿真验证速度和效率。
  • 一种多核并行仿真方法实现平台架构
  • [发明专利]一种在系统IP验证方法-CN200810045078.X无效
  • 廖永波;李平 - 电子科技大学
  • 2008-03-28 - 2008-09-10 - G06F17/50
  • 一种在系统IP验证方法,本发明涉及集成电路技术,以硬件仿真IP部分,系统的其他部分采用软件仿真,并在硬件仿真部分和软件仿真部分之间建立通信。本发明的有益效果是,能够为IP提供一个理想的仿真环境,排除对外围电路的硬件仿真所产生的干扰,同时兼顾了对IP的高速验证;并且由于仅对IP部分进行硬件仿真,验证成本较低。
  • 一种系统ip验证方法
  • [发明专利]IPoutstanding能力检查方法及装置-CN202211311535.1在审
  • 袁力;胡扬央;张丰 - 眸芯科技(上海)有限公司
  • 2022-10-25 - 2023-01-13 - G06F30/3308
  • 本发明公开了IPoutstanding能力检查方法及装置,涉及芯片系统仿真测试技术领域。该方法包括步骤:获取各IPoutstanding能力设计值,基于预设数据格式生成包含有所有IP的outstanding能力设计值的数据文件;在仿真过程中通过各IP核配置的栈存储IPoutstanding计数的最大值;仿真结束时对每个IP栈的栈顶进行peek操作以返回栈顶数值,得到outstanding能力仿真值;将各IPoutstanding能力仿真值和设计值进行比对以检查是否达到预设要求。本发明实现了IPoutstanding能力的自动检查,检查效率高,可靠性好,且易于实现,适用性广。
  • ipoutstanding能力检查方法装置
  • [发明专利]处理器芯片仿真-CN201210009703.1有效
  • 许国泰 - 上海华虹集成电路有限责任公司
  • 2012-01-13 - 2017-03-15 - G06F11/36
  • 本发明公开了一种处理器芯片仿真器,包括仿真芯片,时钟源,同步模块和仿真模块;仿真芯片内包括时钟处理模块和处理器;时钟处理模块接收时钟源产生的外部时钟信号,对该外部时钟信号进行分频或倍频,向处理器和同步模块输出相同的经分频或倍频处理后的工作时钟信号;处理器基于工作时钟信号产生各种内部信号,并通过交互信号线组向仿真模块输出供仿真模块跟踪以及与仿真模块交互的信号;同步模块对工作时钟信号进行同步后产生仿真时钟信号;仿真模块基于该仿真时钟信号对交互信号线组上的仿真芯片内部信号进行跟踪,向处理器输出交互和替换信号。本发明能有助于提高仿真器系统的工作稳定性。
  • 处理器芯片仿真器
  • [发明专利]带非易失性存储器的处理器芯片仿真-CN201310330041.2在审
  • 许国泰 - 上海华虹集成电路有限责任公司
  • 2013-07-31 - 2015-02-11 - G06F17/50
  • 本发明公开了一种带非易失性存储器的处理器芯片仿真器,包括:仿真芯片,其包括仿真逻辑模块和处理器;一SRAM存储器,其包括程序存储器区域和数据存储器区域;时钟源;处理器从程序存储器区域读取用户程序语句并执行;处理器执行数据存储器页擦或片擦用户程序语句后告知仿真逻辑模块;仿真逻辑模块对数据存储器区域中的目标地址范围执行页擦或片擦,同时停止向处理器输出时钟信号;仿真逻辑模块完成页擦或片擦后,恢复向处理器输出时钟信号,处理器继续读取和执行用户程序。本发明能较为真实地模拟非易失性存储器特性的数据存储器片擦或页擦功能,方便用户程序的开发、调试和功能仿真,有助于提高代码开发效率。
  • 非易失性存储器处理器芯片仿真器

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