[发明专利]用于集成电路时钟分配的系统和方法有效
申请号: | 201610400188.8 | 申请日: | 2016-06-08 |
公开(公告)号: | CN106249807B | 公开(公告)日: | 2019-07-09 |
发明(设计)人: | D.赫西登斯;R.霍;A.维斯格伯 | 申请(专利权)人: | 英飞凌科技股份有限公司 |
主分类号: | G06F1/10 | 分类号: | G06F1/10 |
代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 申屠伟进;杜荔南 |
地址: | 德国瑙伊比*** | 国省代码: | 德国;DE |
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摘要: | 本发明涉及用于集成电路时钟分配的系统和方法。实施例集成电路(IC)时钟分配器系统包括第一IC。第一IC包括时钟同步器电路和时钟发生器电路。时钟同步器电路包括耦合到第一时钟传递路径的第一输入,第一时钟传递路径包括外部IC中所包含的第一信号路径的部分的复制延迟。时钟同步器电路还包括耦合到第二时钟传递路径的第二输入。时钟发生器电路还包括耦合到参照振荡器和时钟同步器电路中的至少一个的输出的输入。第二时钟传递路径的延迟包括第一信号路径的延迟。 | ||
搜索关键词: | 用于 集成电路 时钟 分配 系统 方法 | ||
【主权项】:
1.一种用于集成电路(IC)时钟分配的方法,所述方法包括:通过第一时钟传递路径从第一IC接收时钟信号,第一时钟传递路径包括第二时钟传递路径的部分的复制延迟;通过第二IC生成第二IC的时钟信号;通过第二时钟传递路径传送第二IC时钟信号;从第二时钟传递路径接收第二IC时钟信号;以及通过第二IC依照所接收的第一IC时钟信号和所接收的第二IC时钟信号来确定时钟根信号。
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- 本发明提供一种半导体架构和相应半导体装置。半导体装置包含第一、第二、第三、第四NMOS晶体管和第一、第二、第三、第四PMOS晶体;其中当第一、第二、第三以及第四NMOS晶体管并行连接,且第一、第二、第三以及第四PMOS并行连接时,输出信号依据输入信号以及第一逻辑功能被提供,其中当第一及第二NMOS晶体管串行连接,且第一及第二PMOS晶体管串行连接时,输出信号依据输入信号和第二逻辑功能被提供。本发明的半导体架构和相应半导体装置可以降低时序偏差。
- 时钟分配装置和时钟分配方法-201510899941.8
- 廖兰馨;陈凯信;陈稼婴 - 联发科技(新加坡)私人有限公司
- 2015-12-08 - 2016-06-22 - G06F1/10
- 本发明实施例公开了时钟分配装置和时钟分配方法,其中,输入端,用于接收时钟信号;时钟网格,用于将所述输入端接收的时钟信号分为多个时钟信号,并将所述分为的多个时钟信号均匀地分配给多个时钟门;以及多个时钟门,耦接至所述时钟网格,用于将从所述时钟网格接收的时钟信号传输给多个寄存器。本发明实施例可减少所述多个时钟信号到达所述多个寄存器的时钟偏移。
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