[发明专利]用于存储器接口中的延迟控制的方法和设备有效
| 申请号： | 201580029466.7 | 申请日： | 2015-05-11 |
| 公开（公告）号： | CN106663462B | 公开（公告）日： | 2019-05-03 |
| 发明（设计）人： | J·C·迪范德佛;Y·C·程 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G11C7/10 | 分类号： | G11C7/10;G11C11/4076;H03L7/08;H03L7/081 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 唐杰敏 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本文描述了用于延迟控制的系统和方法。在一个实施例中，延迟系统包括第一延迟电路，该第一延迟电路被配置成向第二延迟电路提供电压偏置并且以一更新速率来更新电压偏置，其中该电压偏置控制第二延迟电路的延迟。该延迟系统还包括被配置成调整第一延迟电路的更新速率的更新控制器。例如，更新控制器可以基于纳入该延迟系统的存储器接口的定时要求来调整更新速率。在定时要求较放松时可以减小更新速率以降低功率，而在定时要求较严格时可以增大更新速率。 | ||
| 搜索关键词： | 用于 存储器 接口 可编程 功率 | ||
【主权项】：
1.一种存储器接口中的延迟系统，包括：第一延迟电路，所述第一延迟电路被配置成向第二延迟电路提供电压偏置并且以一更新速率来更新所述电压偏置，其中所述电压偏置控制所述第二延迟电路的延迟；以及更新控制器，所述更新控制器被配置成基于被所述第二延迟电路延迟的信号的数据率来调整所述第一延迟电路的所述更新速率，其中所述数据率指示所述存储器接口的数据率操作。
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