[发明专利]自对准多重图形化方法及硅基硬掩模组合物的应用有效
申请号: | 201210553343.1 | 申请日: | 2012-12-18 |
公开(公告)号: | CN103871846B | 公开(公告)日: | 2017-06-13 |
发明(设计)人: | 郝静安;胡华勇 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/027 | 分类号: | H01L21/027;G03F7/00 |
代理公司: | 北京集佳知识产权代理有限公司11227 | 代理人: | 骆苏华 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种自对准多重图形化方法及硅基硬掩模组合物的应用,该方法采用了该硅基硬掩模组合物来作为RELACS材料,在半导体衬底上形成光刻胶图形之后,将这种含硅的RELACS材料覆盖在光刻胶图形上,然后进行混合烘焙,从而在光刻胶图形的表面形成交联层,接着利用该交联层形成侧墙,在后续工艺步骤中可以侧墙为掩模以将图形转印到半导体衬底上,形成希望得到的图形。与利用现有RELACS材料实现的自对准双重图形化方法相比,本发明可以解决现有自对准双重图形化方法所获得图形的侧壁垂直度不高,以及现有自对准双重图形化方法中底部抗反射涂层会被过多的刻蚀,以致底部抗反射涂层下方的半导体衬底可能会受到损伤的问题。 | ||
搜索关键词: | 对准 多重 图形 方法 硅基硬掩 模组 应用 | ||
【主权项】:
一种自对准多重图形化方法,其特征在于,包括:提供半导体衬底,在所述半导体衬底上形成底部抗反射涂层;在所述半导体衬底上至少形成一个光刻胶图形;在所述半导体衬底及光刻胶图形上形成含硅的RELACS材料层,所述含硅的RELACS材料层为硅基硬掩模组合物,所述硅基硬掩模组合物包含有机硅烷聚合物及溶剂,所述有机硅烷聚合物表示为{(SiO1.5‑Y‑SiO1.5)x(R3SiO1.5)y(XSiO1.5)z}(OH)e(OR6)f;进行混合烘焙,与所述光刻胶图形接触的含硅的RELACS材料层发生交联反应,并在所述光刻胶图形表面形成交联层,所述混合烘焙的温度为60℃‑300℃,时间为30s‑300s;去除所述光刻胶图形顶部上的交联层、未发生交联反应的含硅的RELACS材料层及光刻胶图形,剩余的交联层形成侧墙;以所述侧墙为掩模对所述底部抗反射涂层进行刻蚀,形成底部抗反射涂层图形。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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