[发明专利]使源/漏区更接近沟道区的MOS器件及其制作方法有效

专利信息
申请号: 201210089963.4 申请日: 2012-03-30
公开(公告)号: CN103367151A 公开(公告)日: 2013-10-23
发明(设计)人: 秦长亮;殷华湘 申请(专利权)人: 中国科学院微电子研究所
主分类号: H01L21/336 分类号: H01L21/336;H01L21/8238;H01L29/78;H01L29/10;H01L27/092
代理公司: 中国专利代理(香港)有限公司 72001 代理人: 刘春元;卢江
地址: 100029 *** 国省代码: 北京;11
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摘要: 发明涉及使源/漏区更接近沟道区的MOS器件及其制作方法,包括提供初始结构,包括衬底,有源区,及栅极叠层;在栅极叠层两侧的有源区中进行离子注入,使得部分衬底材料预非晶化以形成非晶态材料层;形成第一侧墙;以第一侧墙为掩蔽,进行各向异性刻蚀,形成凹槽,在第一侧墙下方的非晶态材料层得以保留;利用表现出对非晶态材料层各向同性并且对其刻蚀速率大于或基本等于对衬底材料{100}、{110}面的刻蚀速率但远大于对衬底材料{111}面的刻蚀速率的腐蚀溶液进行湿法刻蚀,从而将第一侧墙下方的非晶态材料层去除,导致在非晶态材料层下方的衬底材料暴露在所述溶液中并被刻蚀,最终形成延伸到栅极叠层下方附近区域的Sigma形凹槽;在Sigma形凹槽内外延形成硅锗。
搜索关键词: 使源 漏区更 接近 沟道 mos 器件 及其 制作方法
【主权项】:
一种PMOS器件的制作方法,包括以下步骤:提供初始结构,其包括衬底(10),在衬底中形成的包括沟道区的有源区,以及在沟道区上方形成的栅极叠层;在栅极叠层两侧的有源区中进行离子注入,从而使得部分衬底材料预非晶化以形成非晶态材料层(150);在栅极叠层两侧形成第一侧墙(155);以第一侧墙为掩蔽,进行自对准各向异性刻蚀,从而形成凹槽(160),在第一侧墙下方的非晶态材料层得以保留;利用表现出对非晶态材料层各向同性并且对其刻蚀速率大于或基本等于对衬底材料{100}、{110}面的刻蚀速率但远大于对衬底材料{111}面的刻蚀速率的腐蚀溶液进行湿法刻蚀,从而将第一侧墙(155)下方的非晶态材料层迅速去除,导致在非晶态材料层下方的衬底材料暴露在所述溶液中并被刻蚀,最终形成延伸到栅极叠层下方附近区域的Sigma形凹槽(170);以及在Sigma形凹槽(170)内外延形成硅锗。
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