专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体器件-CN202211247893.0在审
  • 崔惠彬;尹灿植;吉奎炫;白头山;赵炯纪;韩正勋 - 三星电子株式会社
  • 2022-10-12 - 2023-04-14 - H10B12/00
  • 可以提供一种半导体器件,该半导体器件包括在衬底上的栅极结构、第一栅极间隔物和第二栅极间隔物。栅极结构的侧壁包括凹入的下侧壁部分和相对于衬底的上表面垂直的上侧壁部分。第一栅极间隔物形成在栅极结构的侧壁的上侧壁部分上。第二栅极间隔物形成在栅极结构的侧壁的凹入的下侧壁部分和第一栅极间隔物的外侧壁上。第二栅极间隔物接触第一栅极间隔物的下表面,并包括氮化物。
  • 半导体器件
  • [发明专利]半导体器件及其制造方法-CN202211174269.2在审
  • 朱贞慜;尹灿植;吉奎炫;白头山;韩正勋 - 三星电子株式会社
  • 2022-09-26 - 2023-03-31 - H01L25/18
  • 公开了一种半导体器件,包括:设置在基板上的外围字线;下电介质图案,覆盖外围字线并且包括覆盖外围字线的侧表面的第一部分和覆盖外围字线的顶表面的第二部分;接触插塞,在外围字线的一侧并穿透第一部分和第二部分;以及填充图案,与下电介质图案的第二部分接触并穿透第二部分的至少一部分。接触插塞包括设置在下电介质图案的顶表面上的接触焊盘以及穿透第一部分和第二部分的贯穿插塞。填充图案围绕接触焊盘的侧表面。第一部分和第二部分包括相同的材料。
  • 半导体器件及其制造方法
  • [发明专利]半导体存储器装置-CN202210920453.0在审
  • 崔雅朗;尹灿植;韩正勳;吉奎炫;金元洪;白头山 - 三星电子株式会社
  • 2022-08-02 - 2023-03-14 - H01L27/092
  • 发明构思涉及一种半导体存储器装置。所述半导体存储器装置包括:基底,包括NMOS区域和PMOS区域;第一栅极图案,设置在基底的NMOS区域上;以及第二栅极图案,设置在基底的PMOS区域上。第一栅极图案包括顺序地堆叠在基底上的第一高k层、扩散减轻图案、N型逸出功图案和第一栅电极,第二栅极图案包括顺序地堆叠在基底上的第二高k层和第二栅电极,扩散减轻图案与第一高k层接触,第一栅电极的堆叠结构与第二栅电极的堆叠结构相同,并且第二栅极图案不包括N型逸出功图案。
  • 半导体存储器装置
  • [发明专利]半导体装置-CN202111304820.6在审
  • 金桐䎸;吉奎炫;韩正勋;白头山 - 三星电子株式会社
  • 2021-11-05 - 2022-06-17 - H01L27/092
  • 提供了一种半导体装置。所述半导体装置包括:第一沟槽和第二沟槽,在基底中的相应的第一区域和第二区域中;第一隔离结构,具有顺序地堆叠在第一沟槽中的第一内壁氧化物图案、第一衬里和第一填充绝缘图案;第二隔离结构,具有顺序地堆叠在第二沟槽中的第二内壁氧化物图案、第二衬里和第二填充绝缘图案;第一栅极结构,具有顺序地堆叠在第一区域上的第一高k介电图案、第一P型金属图案和第一N型金属图案;以及第二栅极结构,具有顺序地堆叠在第二区域上的第二高k介电图案和第二N型金属图案;其中,第一衬里和第二衬里分别突出到第一内壁氧化物图案和第二内壁氧化物图案以及第一填充绝缘图案和第二填充绝缘图案的上表面上方。
  • 半导体装置
  • [发明专利]半导体存储器装置-CN202111186310.3在审
  • 金桐䎸;吉奎炫;韩正勳;白头山 - 三星电子株式会社
  • 2021-10-12 - 2022-06-14 - H01L27/108
  • 提供了一种半导体存储器装置。所述半导体存储器装置可以具有:基底,包括存储器单元区域中的有源区和外围区域中的逻辑有源区;元件隔离结构,位于有源区与逻辑有源区之间;绝缘层图案,覆盖有源区;以及支撑绝缘层。绝缘层图案可以包括沿着元件隔离结构延伸的延伸部分,可以与元件隔离结构间隔开,并且可以悬于元件隔离结构之上。支撑绝缘层可以填充限定在延伸部分与元件隔离结构之间的凹陷空间。
  • 半导体存储器装置
  • [发明专利]半导体装置-CN202111466399.9在审
  • 白头山;金桐䎸;吉奎炫;韩正勋 - 三星电子株式会社
  • 2021-12-03 - 2022-06-14 - H01L21/8234
  • 一种半导体装置包括栅极堆叠体,该栅极堆叠体包括栅极绝缘层和在栅极绝缘层上的栅电极。栅极绝缘层包括第一介电层和在第一介电层上的第二介电层,第二介电层的介电常数大于第一介电层的介电常数。该半导体装置还包括在栅极堆叠体的侧表面上的第一间隔件,以及在第一间隔件上的第二间隔件,其中第二间隔件包括从低于第一间隔件的下表面的水平朝向第一介电层延伸的突出部分,并且第二间隔件的介电常数大于第一介电层的介电常数并且小于第一间隔件的介电常数。
  • 半导体装置
  • [发明专利]半导体存储器件-CN202111374021.6在审
  • 金桐晤;吉奎炫;韩正勋;白头山 - 三星电子株式会社
  • 2021-11-19 - 2022-06-03 - H01L27/108
  • 一种半导体存储器件包括:衬底,包括单元区、核心区和在单元区与核心区之间的边界区;在边界区中的边界元件隔离层,边界元件隔离层在边界元件隔离凹陷中并包括沿着边界元件隔离凹陷的轮廓延伸的第一和第二边界衬层;以及第一栅极结构,在边界元件隔离层的至少一部分和核心区上,其中第一栅极结构包括第一高介电层和第一栅极绝缘图案,以衬底的顶表面为基准参考水平面,第一栅极绝缘图案在第一高介电层之下,第一栅极绝缘图案不与第一边界衬层的顶表面重叠,以及其中第一栅极绝缘图案包括在第二边界衬层的顶表面与第一高介电层的底表面之间的第一_1栅极绝缘图案和在核心区的衬底的顶表面与第一高介电层的底表面之间的第一_2栅极绝缘图案。
  • 半导体存储器件
  • [发明专利]电机损耗诊断方法及利用该方法的电机损耗诊断系统-CN202180003087.6在审
  • 安浩振;金斗植;金敬植;白头山 - 宜瑞产业
  • 2021-05-24 - 2022-02-01 - G01R31/34
  • 本发明涉及电机损耗诊断方法及损耗诊断系统,更详细地,目的是提供一种能够诊断电机的个别损耗而以便能够改善电机效率的电机损耗诊断方法及损耗诊断系统。本发明一个方面的电机损耗诊断方法包括数据输入步骤、个别损耗分析步骤、效率计算步骤、损耗率评估步骤、输出步骤。所述数据输入步骤为了测量电机的效率而接受所述电机的运转数据的输入。所述个别损耗分析步骤使用所述运转数据来计算所述电机铁损率、机械损耗率、附加负载损耗率、定子损耗率及转子损耗率的个别损耗率。所述效率计算步骤使用在所述个别损耗分析步骤中计算的所述个别损耗率来计算所述电机的效率。所述损耗率评估步骤从存储了满足基准效率的电机的个别损耗率数据的数据库,计算在所述个别损耗分析步骤中计算的个别损耗率超出所述数据的平均值的程度。所述输出步骤输出在所述效率计算步骤中计算的效率和在所述损耗率评估步骤中计算的超出程度。根据本发明,显示出电机的铁损率、机械损耗率、附加负载损耗率、定子损耗率及转子损耗率的个别损耗率。因而不仅可以知道电机的效率因为哪个个别损耗率而低下,而且可以知道改善电机哪个部分来提高电机的效率。
  • 电机损耗诊断方法利用系统

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