专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]具有部分嵌埋型解耦合电容的半导体芯片-CN02156801.4无效
  • 施庆章;涂俊安;许宗旗;林蔚峰;吕明圜 - 矽统科技股份有限公司
  • 2002-12-13 - 2004-06-30 - H01L27/00
  • 一种部分嵌埋型解耦合电容,设置成半导体芯片的集成部分,以降低delta-I噪声。半导体芯片包括多个嵌埋的金属层、一个钝化层,形成于多个嵌埋的金属层上方作为半导体芯片的最顶层以及多个焊垫,放置于钝化层上。一个表面平面型金属图案形成于钝化层上且经由多个焊垫中的一个或打开于钝化层上的一个通孔而电连接至多个嵌埋的金属层中的一层。表面平面型金属图案可连接至半导体芯片之电源层或接地层。因而,表面平面型金属图案作为一个电极、以其它层作为相反电极,且以夹在其间的钝化层作为介电层所组成。表面平面型金属图案还作为散热器,直接从半导体芯片内部散热。
  • 具有部分嵌埋型解耦合电容半导体芯片
  • [发明专利]电源杂讯的分析方法及降低方法-CN02130472.6无效
  • 田浩伦;陈尚义;吕明园;涂俊安 - 矽统科技股份有限公司
  • 2002-08-21 - 2004-02-25 - H01L21/82
  • 一种电源杂讯的分析方法及降低方法,应用在集成电路的设计过程中。首先利用电脑辅助设计软件,对集成电路设计的相关资料进行分析,以获得集成电路设计的电源网络模型,然后将电源网络模型定义为由多单元方块互相连结构成,另一方面,分析集成电路设计的相关资料后,可得知电性连接至各个单元方块的元件数量和类型参数,作为电源网络模型单元方块的元件参考资料,再利用电性连接至单元方块的元件所构成的等效电路来估算各单元方块在操作时所引起的电压降,便可知电源网络模型中各个区域所消耗的电压分布情况及电压消耗量,据此在电源网络模型的适当位置配置去耦合电容,以适当补偿集成电路中元件操作时所引起的压降,从而降低集成电路内电源杂讯。
  • 电源杂讯分析方法降低
  • [发明专利]资料传输电路与方法-CN02129746.0无效
  • 涂俊安;张志宇;郑建洲 - 矽统科技股份有限公司
  • 2002-08-14 - 2004-02-18 - G06F13/00
  • 一传输电路包括分派电路与计算电路。传输电路介于处理电路与存储器控制器间。处理电路经第一信号线与分派电路连接,分派电路经第二信号线与计算电路连接,且计算电路经第三信号线与存储器控制器连接。此外,在分派电路与存储器控制器间具有快速信号线提供连接。在运作过程中,处理电路将资料流经第一信号线传给分派电路。分派电路检查是否符合加速模式。如不符合加速模式的条件,分派电路将资料流经第二信号线传给计算电路进行处理。如果符合加速模式的条件,分派电路经快速信号线将资料流直接传给存储器控制器,以增加传输电路的效能。
  • 资料传输电路方法
  • [发明专利]自动设定集成电路晶片操作频率的装置及方法-CN01124280.9无效
  • 黄鸿儒;涂俊安;白宏达 - 矽统科技股份有限公司
  • 2001-08-23 - 2003-03-12 - H01L21/70
  • 本发明公开了一种自动设定集成电路晶片操作频率的装置及方法,该集成电路晶片具有一内建自我测试(built-inself-test,BIST)单元使IC晶片能做自我测试;该装置包括一时脉产生器以及一频率决定单元;时脉产生器提供一测试时脉给IC晶片,频率决定单元则用以设定时脉产生器产生测试时脉,并且依据BIST单元所产生的测试结果来设定操作频率;频率决定单元亦能控制BIST单元以测试IC晶片,并根据上述测试结果调整一测试频率值,同时设定时脉产生器产生对应于该调整过的测试频率值的测试时脉;因此,本发明装置可决定一通过内建自我测试的最高频率并且设定此频率为IC晶片的操作频率。
  • 自动设定集成电路晶片操作频率装置方法
  • [发明专利]图形加速接口的自动选择方法及其装置-CN01109748.5无效
  • 涂俊安;黄鸿儒;吕忠晏 - 矽统科技股份有限公司
  • 2001-04-02 - 2002-11-13 - G06F11/22
  • 一种图形加速接口的自动选择方法及其装置;本方法包括下列步骤1.在一附加卡上设有一自动检测单元及一决定单元;2.将附加卡插入一主机板的连接插座上,自动检测单元产生一自动检测信号;3.附加卡接收来自主机板的硬件确认比特;4.决定单元根据硬件确认比特及自动检测信号,以决定图形加速接口的执行模式及信号电位。包括一自动检测单元及一决定单元;自动检测单元的输入及输出端分别连接主机板及决定单元;决定单元的两个输入端分别连接主机板及决定单元。本发明可弹性配合各型主机板的工作模式。
  • 图形加速接口自动选择方法及其装置
  • [发明专利]三维绘图装置-CN01109189.4无效
  • 涂俊安;萧见忠;白宏达 - 矽统科技股份有限公司
  • 2001-03-21 - 2002-02-27 - G06T17/00
  • 在三维绘图系统中,几何引擎与彩现引擎的工作量不均衡会导致其中一引擎闲置;本发明提供了一种将此闲置时间减至最少的三维绘图装置;本发明采用一部份的绘图内存作为几何引擎的外部资料缓冲器,此资料缓冲器不仅储存由几何引擎传来的顶点资料,亦可储存二维绘图指令以确保二维及三维绘图指令按照正确的顺序执行;由于绘图内存的价格不高,因此可以使用较大的资料缓冲器,如此便能显著减少引擎闲置的时间。
  • 三维绘图装置

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