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[发明专利]数据并行计算设备的排序-CN201780070349.4有效
发明人： A.S.麦金农 -专利权人：谷歌有限责任公司
申请日： 2017-11-14 - 公布日： 2023-10-24 - 主分类号： G06F7/24 文献下载
摘要：本公开的各方面涉及响应于对信息的请求来确定相关内容。一个或多个计算设备(170)可以将数据元素加载到寄存器(385A‑385B)中，其中每个寄存器与一组并行处理器(380A‑380B)中的至少一个并行处理器相关联。对于并行处理器中的每一个，加载到其相关联的寄存器中的数据元素可以以降序并行排序。对于并行处理器中的每一个，排序的数据元素可以与该组中其它并行处理器的排序的数据元素合并。合并和排序的数据元素可以被转置和存储。
数据并行计算设备排序

[发明专利]处理器、排序方法及电子设备-CN202180088003.3在审
发明人：杨升;刘虎;林强;杜幸芝 -专利权人：华为技术有限公司
申请日： 2021-03-18 - 公布日： 2023-08-29 - 主分类号： G06F7/24 文献下载
摘要：本申请提供一种处理器、排序方法及电子设备，能够减少排序过程中使用的指令数量，以提高排序效率。该处理器包括：指令存储电路、控制电路和排序电路。控制电路，用于从指令存储电路读取第一指令，并向排序电路发送经解码的第一指令。排序电路，用于响应经解码的第一指令，根据存储地址读取M个第一序列，以及若M个第一序列均为有序序列，则输出一个长度为M*N的有序序列，或者，若M个第一序列中存在无序序列，则输出M个长度为N的有序序列。这样，处理器中的排序电路可以响应经解码的第一指令，对多个序列排序。换句话说，处理器执行1条第一指令即可对多个序列排序，可以避免执行大量重复指令，减少排序指令的数量和执行时间，提高排序效率。
处理器排序方法电子设备

[发明专利]数据排序方法、设备及存储介质-CN202310393996.6在审
发明人：卢宇彤;王莹;陈志广 -专利权人：中山大学
申请日： 2023-04-12 - 公布日： 2023-08-11 - 主分类号： G06F7/24 文献下载
摘要：本发明公开了一种数据排序方法、设备及存储介质，涉及数据处理技术领域，获取各数据排序进程对应的主元的有序候选序列，其中，有序候选序列由数据排序进程基于数据样本序列进行数据样本交换和排序得到，在基于有序候选序列判定对应的主元满足预设负载均衡条件时，检测主元的相邻主元是否满足预设负载均衡条件，并在检测到相邻主元不满足预设负载均衡条件时，协助相邻主元进行计算，在判定各主元均满足预设负载均衡条件时，将主元和/或相邻主元进行广播得到第一主元序列，根据第一主元序列对数据序列进行划分得到第一位移数组，基于第一位移数组进行数据序列间的数据交换和本地排序得到有序结果序列，为大规模的数据排序提供了高效率的计算能力。
数据排序方法设备存储介质

[发明专利]用于实现数据奇偶重排的方法、设备和介质-CN202210195213.9有效
发明人：请求不公布姓名 -专利权人：上海壁仞智能科技有限公司
申请日： 2022-03-01 - 公布日： 2023-07-18 - 主分类号： G06F7/24 文献下载
摘要：本公开的实施例涉及一种用于实现数据奇偶重排的方法、设备和介质，方法包括：基于线程组的线程数，确定第一映射参数；基于所述第一映射参数，将所述第一寄存器的数据映射到所述第三寄存器并且将所述第二寄存器的数据映射到第四寄存器；将所述第一寄存器、第二寄存器、第三寄存器和第四寄存器的数据移位到中转寄存器；基于中转寄存器的地址，对所述中转寄存器中的数据执行抽取，以便获得第一数据、第二数据、第三数据以及第四数据；以及将第一数据和第二数据分别写入到所述第一寄存器和所述第二寄存器，从而实现寄存器数据奇偶重排。由此，能够在不计算共享存储器地址的情况下更为快速地在两个寄存器间实现数据的奇偶重排。
用于实现数据奇偶重排方法设备介质

[发明专利]一种基于机器学习模型的排序方法-CN201811096121.5有效
发明人：施荣华;毛雷;赵颖;钟增胜;胡超 -专利权人：中南大学
申请日： 2018-09-19 - 公布日： 2023-07-18 - 主分类号： G06F7/24 文献下载
摘要：本发明公开了一种基于机器学习模型的排序方法，包括以下步骤：第一步，对于给定的待排元素集生成模型训练数据；第二步，根据第一步生成的训练数据利用机器学习的方法构建待排元素集的分布模型；第三步，利用分布模型预测待排元素集中每一个元素在有序数组中的位置；第四步，根据元素的预测位置将元素放入有序数组中，得到一个有序的数组完成排序操作。本发明由于采用将元素直接放入有序数组中的方式，相比于快速排序、归并排序、堆排序等排序算法，运行时间更短。
一种基于机器学习模型排序方法

[发明专利]一种基于FPGA的序列多峰值搜索排序装置-CN201910861551.X有效
发明人：赵晓明;刘彬;张小玢;高嵩;邓涛;李长存 -专利权人：北京华航无线电测量研究所
申请日： 2019-09-12 - 公布日： 2023-07-11 - 主分类号： G06F7/24 文献下载
摘要：本发明提出一种基于FPGA的序列多峰值搜索排序装置，包括峰值寄存器、标识常量寄存器、比较寄存器和处理单元。所述处理单元使用峰值寄存器、标识常量寄存器、比较寄存器对输入序列进行多峰值搜索排序。本发明有效提升了序列排序的速度，降低了排序时需要占用的存储资源，具有较强的实用性和通用性。
一种基于 fpga 序列峰值搜索排序装置

[发明专利]一种数据排序方法及其数据排序电路-CN202211697576.9在审
发明人：郭超;伦建坤;黄运新 -专利权人：深圳大普微电子科技有限公司
申请日： 2022-12-28 - 公布日： 2023-06-09 - 主分类号： G06F7/24 文献下载
摘要：本发明提供一种数据排序方法，包括并行接收多个输入数据中的至少一组输入数据；将待排序的多个输入数据两两进行比较后，获取对应的比较值；根据每个输入数据对应的比较值获取对应的得分值；将每个输入数据对应的得分值进行累加，以得到每个输入数据的得分累计值；根据每个输入数据的得分累计值，对所述多个输入数据进行重新排序。本发明还提供一种可以采用上述数据排序方法的数据排序电路，因此，本发明提供的数据排序方法及其数据排序电路所需时钟少，排序速度快，能满足数据排序的实时性要求。
一种数据排序方法及其电路

[发明专利]一种基于FPGA实现的多级归并排序方法-CN202010391104.5有效
发明人：张俊杰;田森;曹炳尧;庄耀宇;杨丹;张倩武;陈健;宋英雄;李迎春 -专利权人：上海大学
申请日： 2020-05-11 - 公布日： 2023-06-09 - 主分类号： G06F7/24 文献下载
摘要：本发明公开了一种基于FPGA实现的多级归并排序方法，包括以下步骤：步骤1，分别检测多个2归并排序模块，每个2归并排序模块包括待排序队列A和待排序队列B；步骤2，分别对多个2归并排序模块进行归并排序，并分别输出排列结果；步骤3，排列结果作为下一级的待排序队列，进入下一级的2归并排序模块，重复步骤1和步骤2，直到输出最终排列结果。本发明的一种基于FPGA实现的多级归并排序方法，使归并排序数增加时，门级数恒定，并且可以实现任意长度排序队列进行归并。
一种基于 fpga 实现多级归并排序方法

[发明专利]一种矢量排序装置、方法及存储介质-CN202211738848.5在审
发明人：王和国;韩景通;肖海勇;汪永威 -专利权人：深圳云天励飞技术股份有限公司
申请日： 2022-12-30 - 公布日： 2023-06-06 - 主分类号： G06F7/24 文献下载
摘要：本发明涉及排序算法领域，具体为一种矢量排序装置包括：选择单元，比较及交换单元，合并单元；所述选择单元包括矢量片段选择单元及元素选择单元；所述比较及交换单元包括比较单元及交换单元；所述合并单元包括元素合并单元及矢量片段合并单元；所述选择单元根据矢量片段的排序状态选择所述矢量片段，使得元素已排序的所述矢量片段中的元素较元素未排序的矢量片段中的元素进行更少的比较。本发明解决了现有技术矢量排序过程中效率低的技术问题，快速、高效地实现任意长度、不同内部随机性及规律性特点的矢量的快速排序。
一种矢量排序装置方法存储介质

[发明专利]一种数据排序方法、装置、设备及可读存储介质-CN202211735449.3在审
发明人：潘无穷;韦韬;李婷婷;冯皓楠;李天一;钱中天 -专利权人：支付宝（杭州）信息技术有限公司
申请日： 2022-12-31 - 公布日： 2023-05-26 - 主分类号： G06F7/24 文献下载
摘要：本说明书公开了一种数据排序方法、装置、设备及可读存储介质，本说明书提供的数据排序方法中，根据非基准密文对应的第一噪音值和第一指定参数更新非基准密文，并将各非基准密文分别与更新后的基准密文进行比较。进而根据第一比较结果将待处理数组划分为多个子数组，将各子数组分别重新作为待处理数组，重复上述比较过程直至各数组只包含单一密文为止，以各数组之间的大小关系，确定各密文的排序结果。可见，在对密文排序的过程中，以噪音值和第一指定参数更新各非基准密文的方式，即使比较结果为非基准密文与基准密文相等，也不会泄露原始的非基准密文与基准密文之间的关系，提高了密文排序过程中数据的安全性和隐私保护性。
一种数据排序方法装置设备可读存储介质

[发明专利]一种数据排序方法、装置及电子设备-CN202211697871.4在审
发明人：余何庆 -专利权人：北京奕斯伟计算技术股份有限公司;广州全盛威信息技术有限公司
申请日： 2022-12-28 - 公布日： 2023-04-11 - 主分类号： G06F7/24 文献下载
摘要：本申请实施例提供了一种数据排序方法、装置及电子设备，涉及通信技术领域。该方法中将多个待排序数据依次输入排序模块进行排序操作，获得排序结果；根据排序结果，确定多个待排序数据的前L个数据；其中，针对多个待排序数据中的任一数据执行的排序操作包括：将任一数据输入N级子模块中的第i级子模块进行比较操作；若任一数据大于第i级子模块中的最小数据，则基于二分法确定任一数据在第i级子模块中的存储位置，存储任一数据，将第i级子模块中的最小数据输入第(i+1)级子模块中进行比较操作；若任一数据不大于第i级子模块中的最小数据，则将任一数据输入第(i+1)级子模块中进行比较操作；i从1开始取值，最大取值为(N‑1)。
一种数据排序方法装置电子设备

[发明专利]一种排序方法、处理器及电子设备-CN202211623886.6在审
发明人：肖海勇 -专利权人：深圳云天励飞技术股份有限公司
申请日： 2022-12-16 - 公布日： 2023-04-07 - 主分类号： G06F7/24 文献下载
摘要：本申请适用于矢量排序技术领域，提供了一种排序方法、处理器及电子设备，方法包括：控制单元根据存储单元中的M个第一序列，得到N个第二序列和N个第三序列；将N个第二序列分别存储到N个第一矢量寄存器单元中，将N个第三序列分别存储到N个第二矢量寄存器单元中；对N个第一矢量寄存器单元中的的两个第二序列进行排序，并根据每次排序后的两个第二序列，对N个第二矢量寄存器单元中对应的两个第三序列进行调整；根据第一矢量寄存器单元中的排序后的N个第二序列和第二矢量寄存器单元中的调整后的N个第三序列，确定M个第一序列中的每个第一序列中的每个元素的排列顺序。从而，可实现对多个序列的并行排序，提高排序效率。
一种排序方法处理器电子设备

[发明专利]航天器变轨段姿态转换时间序列生成方法及系统-CN202211062700.4在审
发明人：陈占胜;宋君强;任三孩;赵庆广;郑艺裕;杨燕;李文龙;潘瑞雪;朱晨聪;卢昕 -专利权人：上海卫星工程研究所
申请日： 2022-08-31 - 公布日： 2022-12-20 - 主分类号： G06F7/24 文献下载
摘要：本发明提供的一种航天器变轨段姿态转换时间序列生成方法及系统，包括如下步骤：步骤S1：获取卫星多次变轨的时间序列；步骤S2：根据卫星多次变轨的时间序列确定卫星在变轨段期间的姿态转换时刻；步骤S3：根据姿态转换时刻编写姿态转换语义矩阵；步骤S4：将姿态转换语义矩阵转换为真实姿态时序矩阵；步骤S5：对真实姿态时序矩阵进行检查。本发明利用简单的矩阵表示姿态时段，并进一步通过逻辑判断转换为真实的姿态时段，可利用计算机编程快捷地实现姿态时序的生成，在发射窗口计算等方面具有较强的实用性。
航天器变轨段姿态转换时间序列生成方法系统

[发明专利]电子设备及其数据的处理方法和介质-CN202211065827.1在审
发明人：杨宇;黄磊;黄墩博 -专利权人：安谋科技（中国）有限公司
申请日： 2022-09-01 - 公布日： 2022-11-25 - 主分类号： G06F7/24 文献下载
摘要：本申请涉及人工智能领域，涉及一种数据的处理方法、介质和电子设备。方法包括：根据待处理数据对应的二进制数据，确定参考数值范围；根据对待处理数据对应的二进制数据的排序方式，依次从参考数值范围内选取参考数值，并将选取的参考数值与待处理数据对应的二进制数据中的每一个数据进行数值比较；对应于待处理数据对应的二进制数据中存在与选取的参考数值相同的第一数据，根据选取的参考数值在参考数值范围内的排列顺序，确定第一数据在排序结果中的顺序，基于排序方式完成对待处理数据对应的二进制数据的排序。对于取值范围较小且数据量较大的待处理数据进行排序，可以大幅度降低排序算法的时间复杂度，提高对数据进行排序的效率。
电子设备及其数据处理方法介质

[发明专利]一种用于长序列数据排序的电路及方法-CN202210721233.5在审
发明人：王宇宣;周自衡;潘红兵 -专利权人：南京大学
申请日： 2022-06-24 - 公布日： 2022-11-01 - 主分类号： G06F7/24 文献下载
摘要：本发明公开了一种用于长序列数据排序的电路及方法。该电路用于对N个数据在K进制下进行排序，且数据中的最大元素在K进制下包含m位；电路包括基数计数单元、首地址生成单元、数据分配单元和两个排序缓冲区，两个排序缓冲区分别作为源缓冲区与目标缓冲区，均可以读出给定地址中的数据，或将一个数据写入指定地址；基数计数单元、首地址生成单元和数据分配单元依次相连；两个排序缓冲区均分别与数据分配单元和基数计数单元相连。本发明的数据排序电路结构简单，可根据具体需求进行灵活调整，且本发明的数据排序方法具有线性阶时间复杂度，排序时间较短。
一种用于序列数据排序电路方法

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