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- [发明专利]芯片故障处理方法及设备-CN202211632591.5在审
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何路;郭小平;聂英豪;宋易
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湖南胜云光电科技有限公司
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2022-12-19
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2023-05-30
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G06F30/327
- 本申请提供一种芯片故障处理方法及设备，该方法包括：对RTL代码进行综合，生成门级网表，RTL代码对应部署于目标芯片上的多个逻辑电路单元，门级网表包括多个逻辑电路单元分别对应的逻辑电路网表；在门级网表中添加逻辑电路网表关联的多路选择器组；在第一逻辑电路单元发生故障的情况下，获取第一逻辑电路单元对应的修改后RTL代码，并对修改后RTL代码进行综合，获取新逻辑电路网表；取消第一逻辑电路单元对应的逻辑电路网表与对应的第一多路选择器组的关联，建立第一逻辑电路单元对应的新逻辑电路网表与第一多路选择器组的关联。本申请可以实现快速定位问题，对错误进行快速修正，提高处理效率、加快开发进度。
- 芯片故障处理方法设备
- [发明专利]一种单输出组合逻辑电路的近似简化方法-CN202010612406.0有效
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邹九发;王伦耀;夏银水;储著飞
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宁波大学
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2020-06-30
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2023-05-12
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G06F30/327
- 本发明公开了一种单输出组合逻辑电路的近似简化方法，其在错误率约束下，通过将多个乘积项近似表示成一个乘积项，以及删除特定的乘积项从而实现逻辑函数简化；考虑到简单的逻辑函数的逻辑表达式往往对应简单的电路结构，因此使得一些逻辑电路有了更大的优化空间；在不影响逻辑电路正常应用的前提下，可实现逻辑电路功耗、速度和面积等性能的进一步优化；其虽然是单输出的组合逻辑电路简化方法，但考虑到多输出组合逻辑电路可转化为多个单输出电路的组合，因此其可以推广到多输出组合逻辑电路的简化，适用于逻辑功能可以用“与/或”形式逻辑函数描述的逻辑电路的优化，且容易编程实现，可以融入到计算机辅助设计中，用于逻辑电路的综合与优化。
- 一种输出组合逻辑电路近似简化方法
- [发明专利]一种集成电路设计中插入时钟门控的方法-CN202211613425.0在审
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董森华;雍晓;刘毅
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上海华大九天信息科技有限公司
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2022-12-15
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2023-05-09
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G06F30/327
- 本发明提供了一种集成电路设计中插入时钟门控的方法，包括以下步骤：1）将目标设计被抽象历程处理转换成以操作为基底的通用网表，所述目标设计，包括，寄存器传输级；2）设定部分时钟门控约束；3）识别所有时序器件并将其转换成相对更通用的时序器件；4）选取时序器件，寻找选定时序器件的反馈回路，制作反馈回路签名，所述反馈回路签名，包括，反馈回路中的所有的实例类型、每个实例的控制信号与每个实例的反馈位置；5）检查当前的时序器件是否存在可能与其他的时序器件共享激源逻辑电路并产生时钟门控群组；6）对时序器件进行分组；7）生成时序器件的激源逻辑和载入逻辑；8）基于激源逻辑生成时钟门控逻辑。本发明可以自动推导出集成电路设计中的时钟门控（Clock Gating）的电路。
- 一种集成电路设计插入时钟门控方法
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