[发明专利]一种去毛刺频率锁定电路在审
申请号: | 201611142338.6 | 申请日: | 2016-12-12 |
公开(公告)号: | CN106712768A | 公开(公告)日: | 2017-05-24 |
发明(设计)人: | 何文明;廖英豪 | 申请(专利权)人: | 深圳市紫光同创电子有限公司 |
主分类号: | H03L7/087 | 分类号: | H03L7/087 |
代理公司: | 深圳鼎合诚知识产权代理有限公司44281 | 代理人: | 江婷 |
地址: | 518057 广东省深圳市南山区*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 毛刺 频率 锁定 电路 | ||
1.一种去毛刺频率锁定电路,包括:频率锁定检测电路、相位锁定检测电路、锁定去毛刺电路,所述频率锁定检测电路和所述相位锁定检测电路分别与所述锁定去毛刺电路连接;所述频率锁定检测电路对输入时钟和反馈时钟的频率进行比较得到频率锁定信号输出到所述锁定去毛刺电路,所述相位锁定检测电路对输入时钟和反馈时钟的相位进行比较得到相位锁定信号输出到所述锁定去毛刺电路;所述锁定去毛刺电路在所述相位锁定信号和所述频率锁定信号均为高电平时,对所述输入时钟进行计数,当计数值达到预设计数值后,锁定所述输入时钟的频率和相位。
2.如权利要求1所述的去毛刺频率锁定电路,其特征在于,所述频率锁定检测电路包括检测电路包括分别用于检测反馈时钟和输入时钟的频率的第一可编程计数器和第二可编程计数器,以及与所述第一可编程计数器和第二可编程计数器连接的控制状态逻辑电路;所述控制状态逻辑电路对第一可编程计数器和第二可编程计数器的检测结果进行比较,相同时,所述控制状态逻辑电路输出高电平的频率锁定信号,否则输出低电平的频率锁定信号。
3.如权利要求1所述的去毛刺频率锁定电路,其特征在于,所述相位锁定检测电路包括相位检测电路和连接所述相位检测电路的锁定信号输出电路,所述相位检测电路检测所述输入时钟和反馈时钟的相位,当两者的相位相同时,所述锁定信号输出电路输出的相位锁定信号为高电平,否则为低电平。
4.如权利要求3所述的去毛刺频率锁定电路,其特征在于,所述锁定信号输出电路包括充放电电路,所述充放电电路包括电容,当所述相位检测电路检测到所述输入时钟和反馈时钟的相位相同时,所述充放电电路对所述电容进行充电,充电时间达到预设时间,相位锁定信号输出为高电平,当所述相位检测电路检测到所述输入时钟和反馈时钟的相位不同时,所述充放电电路对所述电容进行放电,相位锁定信号输出为低电平。
5.如权利要求1-4任一项所述的去毛刺频率锁定电路,其特征在于,所述锁定去毛刺电路包括计数电路和与所述计数电路连接的锁定电路;所述计数电路接收所述频率锁定信号、所述相位锁定信号、所述输入时钟以及所述锁定电路反馈的锁定标志位;当所述频率锁定信号、所述相位锁定信号和所述锁定标志位为高电平时,所述计数电路对所述输入时钟进行计数,所述锁定电路对计数值与所述预设计数值进行比较,当计数值达到所述预设计数值,所述锁定电路输出高电平的锁定输出信号。
6.如权利要求5所述的去毛刺频率锁定电路,其特征在于,所述计数电路包括依次连接的第一与门、第二与门、第三计数器,所述第三计数器上还连接有第三与门,所述第三与门控制所述第三计数器的时钟输入端,所述第二与门控制所述第三计数器的复位端;所述第一与门的输入包括所述频率锁定检测电路和所述相位锁定检测电路分别输出的所述频率锁定信号与所述相位锁定信号,所述第三与门的输入包括所述第一与门的逻辑计算结果、所述输入时钟以及所述锁定电路反馈的锁定标志位。
7.如权利要求6所述的去毛刺频率锁定电路,其特征在于,所述第三计数器是十二位计数器。
8.如权利要求5所述的去毛刺频率锁定电路,其特征在于,所述锁定电路包括与所述第三计数器连接的状态控制器以及与所述状态控制器连接的触发器;所述状态控制器接收所述计数器的对所述输入时钟的计数值,当所述计数值达到所述预设计数值,所述状态控制器输出高电平的锁定控制信号到所述触发器以及输出低电平的锁定标志位,所述触发器对所述锁定控制信号进行采样,输出高电平的锁定输出信号,所述第三与门关闭,所述第三计数器停止计数。
9.如权利要求8所述的去毛刺频率锁定电路,其特征在于,所述状态控制器为可编程状态控制器。
10.如权利要求8所述的去毛刺频率锁定电路,其特征在于,当所述频率锁定信号和所述相位锁定信号出现低电平,所述第三计数器与所述触发器复位,所述触发器输出低电平解除锁定。
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