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[发明专利]一种系统时钟的动态调整方法和电路-CN201210226789.3有效
发明人：孙晓宁;陆崇心;张洪柳;刘大铕 -专利权人：山东华芯半导体有限公司
申请日： 2012-07-03 - 公布日： 2013-01-02 - 主分类号： H03L7/099 文献下载
摘要：本发明公开了一种系统时钟的动态调整方法和电路，依据本发明，通过对锁相环配置寄存器配置操作的读取来关断锁相环时钟输出的方式，动态设置锁相环的配置值，由硬件自动完成锁相环的关断，相应地，通过计时控制，匹配锁相环模式变换的时间，开启锁相环时钟输出，从而，保证了锁相环时钟的完整性。这种时钟切换，由片上的硬件替换CPU来实现，既减轻了软件的负担和时序控制，提高了系统时钟的可靠性，也减轻了CPU的负担。
一种系统时钟动态调整方法电路

[发明专利]基于FPGA片内锁相环的窗口时钟生成和动态配置方法-CN201110050328.0有效
发明人：殷晔;王石记;付旺超;徐鹏程;安佰岳;杜影 -专利权人：北京航天测控技术有限公司
申请日： 2011-03-02 - 公布日： 2011-10-05 - 主分类号： H03L7/08 文献下载
摘要：本发明提供一种基于FPGA片内锁相环的窗口时钟生成和动态配置方法，根据所需窗口时钟以及输入时钟频率，计算FPGA片内锁相环的配置参数；向FPGA发送锁相环配置参数，FPGA接收配置参数，在收到启动命令后开始片内锁相环动态重配置过程；FPGA片内锁相环输出多个时钟，每两个时钟通过FPGA内部处理合成所需窗口时钟并输出。本发明根据所需窗口时钟以及输入时钟的频率设置FPGA片内锁相环的配置参数，在FPGA内部合成窗口时钟，对外部配置的硬件要求少，提供的窗口时钟可控性高、电磁兼容性好。
基于 fpga 片内锁相环窗口时钟生成动态配置方法

[发明专利]一种使用无锁定指示锁相环的SoC片内时钟生成电路-CN201410231058.7有效
发明人：赵翠华;张洵颖;张丽娜;裴茹霞;杨博;李红桥;肖建青;娄冕 -专利权人：中国航天科技集团公司第九研究院第七七一研究所
申请日： 2014-05-28 - 公布日： 2017-04-26 - 主分类号： H03L7/08 文献下载
摘要：本发明一种使用无锁定指示锁相环的SoC片内时钟生成电路，通过计数锁定电路来实现在SoC片内自产生的锁定信号。计数锁定电路对片外输入的时钟进行计数，通过无锁定锁相环锁定时间与输入时钟频率相乘的结果获得锁相环锁定时计数器的计数值。如果计数值达到锁相环的锁定时间选择的计数值，计数锁定电路输出稳定指示的锁定信号，锁定信号为低表示锁相环未锁定，为高表示已锁定；通过时钟输出电路解决无锁定锁相环在未锁定前已输出时钟信号的问题，利用与逻辑电路使得无锁定指示锁相环锁定之前SoC无时钟，锁定之后有稳定的时钟，确保SoC设计功能的正确性和可靠性；并且利用同步电路实现了锁定信号与锁相环输出时钟信号的同步。
一种使用锁定指示锁相环 soc 时钟生成电路

[发明专利]片外可配置的调频连续波锁相环系统及控制方法-CN202310162226.0在审
发明人：万祝娟;吴博文;段宗明;金微微;汪功兵 -专利权人：中国电子科技集团公司第三十八研究所
申请日： 2023-02-21 - 公布日： 2023-05-12 - 主分类号： H03L7/08 文献下载
摘要：本发明公开一种片外可配置的调频连续波锁相环系统及控制方法，所述系统包括锁相环电路、片内数字电路、片外数字电路和三态接口电路，所述片内数字电路的输出端连接所述锁相环电路，所述片内数字电路和所述片外数字电路的输出端分别连接所述三态接口电路的第一输入端和第二输入端以分别输出片内分频比控制信号和片外分频比控制信号至所述三态接口电路，所述三态接口电路的第一输出端连接所述锁相环电路，以分别在所述三态接口电路为片内模式时通过所述第一输出端将所述片内分频比控制信号发送至所述锁相环电路，在片外模式时通过第一输出端将所述片外分频比控制信号发送至所述锁相环电路并设置所述第二输出端为高阻态
片外可配置调频连续波锁相环系统控制方法

[发明专利]一种锁相环及其时钟产生方法和电路-CN201310169140.7有效
发明人：王军宁;潘锐 -专利权人：英特格灵芯片（天津）有限公司
申请日： 2013-05-09 - 公布日： 2018-04-13 - 主分类号： H03L7/18 文献下载
摘要：本发明提出一种产生时钟信号的锁相环。所述的锁相环包括数字控制单元，所述数字控制单元产生分频比调整信号；和模拟锁相环单元，所述模拟锁相环单元基于分频比调整信号对产生的时钟信号进行调整，其特征在于所述模拟锁相环单元通过对分频比调整信号进行响应来微调产生的时钟信号的频率这种锁相环避免了全模拟锁相环实现时的低带宽的限制，环路滤波器的电容和电阻可以集成到片内以节约成本，也避免了全数字锁相环抖动性能差失真率高的弊端。
一种锁相环及其时钟产生方法电路

[实用新型]一种锁相环及其时钟产生电路-CN201320248589.8有效
发明人：王军宁;潘锐 -专利权人：英特格灵芯片（天津）有限公司
申请日： 2013-05-09 - 公布日： 2013-11-27 - 主分类号： H03L7/08 文献下载
摘要：本实用新型提出一种锁相环及其时钟产生电路。所述的锁相环包括数字控制单元，所述数字控制单元产生分频比调整信号；和模拟锁相环单元，所述模拟锁相环单元基于分频比调整信号对产生的时钟信号进行调整，其特征在于所述模拟锁相环单元通过对分频比调整信号进行响应来微调产生的时钟信号的频率这种锁相环避免了全模拟锁相环实现时的低带宽的限制，环路滤波器的电容和电阻可以集成到片内以节约成本，也避免了全数字锁相环抖动性能差失真率高的弊端。
一种锁相环及其时钟产生电路

[发明专利]一种优化风电机组锁相环参数的方法及系统-CN201810292899.7在审
发明人：刘超;迟永宁;田新首;李琰;汤海雁 -专利权人：中国电力科学研究院有限公司
申请日： 2018-03-30 - 公布日： 2018-09-07 - 主分类号： G06Q10/04 文献下载
摘要：一种优化风电机组锁相环参数的方法及系统，包括：求解锁相环传递函数的特征方程，获取影响锁相环响应特征的参数；仿真风电机组锁相环运行环境调节所述影响锁相环响应特征的参数；根据仿真得到相位跟踪结果确定最优锁相环参数本发明既可以优选出最佳的锁相环参数，又避免了盲目的放大锁相环参数；提高了电网电压相位跳变情况下锁相环相位跟踪性能，改善了风电机组的暂态特性，在满足锁相环相位跟踪精度的基础上，又兼顾了参数选取的便利性。
锁相环风电机组相位跟踪响应特征电网电压相位参数选取传递函数结果确定特征方程运行环境暂态特性便利性求解跳变优化放大

[发明专利]双锁相环电路及其控制方法-CN200910157826.8有效
发明人：刘永旺;卢文才;史德立 -专利权人：晨星软件研发(深圳)有限公司;晨星半导体股份有限公司
申请日： 2009-07-07 - 公布日： 2011-01-12 - 主分类号： H03L7/08 文献下载
摘要：本发明公开了一种双锁相环电路及其控制方法。所述双锁相环电路包括一相位/频率检测器，一电荷泵，一频率调节电路和一N分频器。所述频率调节电路包括一粗调节电路，用于粗调节锁相环输出信号频率接近于一目标频率；一细调节电路，用于细调节锁相环输出信号频率至此目标频率；及一电流控制振荡器，耦接于此粗调节电路和此细调节电路，用于产生频率为所述目标频率的锁相环输出信号所述双锁相环电路可有效达到在保持锁相环环路带宽较小的情况下扩大频率调节范围的目的，并且可实现片内集成，从而降低了成本和电路设计复杂度。
双锁相环电路及其控制方法

[实用新型]一种锁相环-CN201820590260.2有效
发明人：孙海涛 -专利权人：上海玮舟微电子科技有限公司
申请日： 2018-04-24 - 公布日： 2018-08-28 - 主分类号： H03L7/18 文献下载
摘要：本实用新型公开了一种锁相环。锁相环包括锁相环主体和与锁相环主体相连的频率范围自动控制器，锁相环主体至少包括压控振荡器；频率范围自动控制器包括比较单元、分频单元、第一控制单元、第二控制单元和逻辑控制单元。该锁相环能够在减小锁相环的面积的基础上，降低锁相环中的压控振荡器连续切换频段的时间，提升电路系统的稳定性。
锁相环压控振荡器自动控制器第二控制单元逻辑控制单元本实用新型比较单元分频单元连续切换提升电路减小频段

[发明专利]一种基于锁相环和矩阵开关的S波段快跳频率源-CN201711138434.8在审
发明人：吴昱程;陈林辉;刘志哲;刘晓东;聂利鹏;曹玉雄 -专利权人：北京遥感设备研究所
申请日： 2017-11-16 - 公布日： 2018-04-13 - 主分类号： H03L7/07 文献下载
摘要：本发明公开了一种基于锁相环和矩阵开关的S波段快跳频率源，包括变频电路、五功分器、分频器、倍频器、滤波器A、滤波器B、混频器和放大器，还包括锁相环A、锁相环B、锁相环C、锁相环D、锁相环E和5X2矩阵开关本发明采用锁相环A、锁相环B、锁相环C、锁相环D、锁相环E、5X2矩阵开关搭建快速跳频源，采用变频电路产生基准频率，大大降低了成本；锁相环A、锁相环B、锁相环C、锁相环D、锁相环E保证了高带外抑制度且为跳频间隔提供了自由度
一种基于锁相环矩阵开关波段频率

[发明专利]一种高可靠性的锁相环模块及其输出时钟的切换方法-CN202010940406.3在审
发明人：耿晓祥;周建;林明杰;马肖祥;王建中 -专利权人：苏州云途半导体有限公司
申请日： 2020-09-09 - 公布日： 2020-12-18 - 主分类号： H03L7/085 文献下载
摘要：一种高可靠性锁相环模块，所述锁相环模块包括锁相环单元、锁相环监测单元、时钟切换单元，所述锁相环单元连接至所述锁相环监测单元，所述锁相环监测单元的输出和所述锁相环单元的输出分别连接至所述时钟切换单元，所述锁相环监测单元用于对所述锁相环单元的工作状态或参数进行监测，所述时钟切换单元根据所述锁相环监测单元的监测结果对所述锁相环模块的输出时钟进行切换。上述技术方案中能够实现锁相环输出时钟的自动切换，降低了功耗，节约了成本，且能够避免因锁相环失锁以及锁相环输入参考时钟发生抖动所导致的系统故障、崩溃等问题，极大地提高了系统的稳定性和可靠性。
一种可靠性锁相环模块及其输出时钟切换方法

[发明专利]锁相环的锁定检测方法、锁相环及其频率锁定检测控制器-CN202010194504.7有效
发明人：廖英豪;张卫波 -专利权人：深圳市紫光同创电子有限公司
申请日： 2020-03-18 - 公布日： 2023-02-28 - 主分类号： H03L7/081 文献下载
摘要：本发明提供一种锁相环的锁定检测方法、锁相环及其频率锁定检测控制器，能够解决锁相环上电不稳定过程中内部逻辑异常的问题，并且结构简单、设计版图面积小。所述锁定检测方法包括：对锁相环的频率进行第一次锁定，直至锁相环的内置稳压器稳定，第一次锁定过程中对数字逻辑的复位时序以及电源是否稳定不做要求；当锁相环的内置稳压器稳定之后，锁相环的各输出分频器开始工作，锁相环进行第二次锁定过程，此时所述锁相环的压控振荡器输出时钟没有毛刺、电源电压稳定，实现包括相位对齐调整以及占空比合成的复杂功能；最后将锁相环的锁定检测电路的输出信号作为锁相环的锁定指示信号输出。
锁相环锁定检测方法及其频率控制器

[发明专利]一种锁相环及频率控制方法-CN201810372541.5在审
发明人：孙海涛 -专利权人：上海玮舟微电子科技有限公司
申请日： 2018-04-24 - 公布日： 2018-09-21 - 主分类号： H03L7/18 文献下载
摘要：本发明公开了一种锁相环及频率控制方法。锁相环包括锁相环主体和与锁相环主体相连的频率范围自动控制器，锁相环主体至少包括压控振荡器；频率范围自动控制器包括比较单元、分频单元、第一控制单元、第二控制单元和逻辑控制单元。该锁相环能够在减小锁相环的面积的基础上，降低锁相环中的压控振荡器连续切换频段的时间，提升电路系统的稳定性。
锁相环压控振荡器自动控制器频率控制第二控制单元逻辑控制单元比较单元分频单元连续切换提升电路减小频段

[发明专利]一种宽带全集成锁相环频率综合器-CN201410428339.1有效
发明人：张吉利;黄森;王子谦;王陈銮;朱光;刁盛锡;林福江 -专利权人：中国科学技术大学
申请日： 2014-08-27 - 公布日： 2017-05-17 - 主分类号： H03L7/18 文献下载
摘要：本发明提供一种宽带全集成锁相环频率综合器，所述的宽带全集成锁相环频率综合器包括鉴频鉴相器、数控电荷泵、环路滤波器、宽带频率压控振荡器、多模分频器、波形整形电路、可编程分频器以及外部接口SPI模块。本发明的宽带全集成锁相环频率综合器中的宽带频率压控振荡器使用数控电流饥饿型环形振荡器实现，既能实现宽带的频率输出，也能减小锁相环输出信号受电源抖动的影响；宽带全集成锁相环频率综合器中采用双电荷泵结构，减小环路滤波器积分电容所占用的芯片面积，使环路滤波器容易片上集成，数控电荷泵结构保证在不同输出频率下锁相环的环路参数基本不变，维持锁相环性能基本不变。
一种宽带集成锁相环频率综合

[发明专利]时钟系统、电子装置、处理方法-CN201780091708.4在审
发明人：刘敬波;刘俊秀;王雅君;石岭 -专利权人：深圳开阳电子股份有限公司
申请日： 2017-12-08 - 公布日： 2020-07-14 - 主分类号： H03L7/08 文献下载
摘要：本发明公开了一种时钟系统(100)，时钟系统(100)包括参考时钟模块(110)、锁相环模块(120)、锁相环电源模块(130)、锁相环故障监测模块(140)和锁相环故障处理模块(150)。锁相环模块(120)用于根据参考时钟信号输出处理时钟信号。锁相环电源模块(130)用于为锁相环模块(120)供电。锁相环故障监测模块(140)用于根据锁相环电源模块(130)的供电电压和处理时钟信号确定锁相环模块(120)的工作状态。锁相环故障处理模块(150)用于根据锁相环模块(120)的工作状态控制锁相环模块(120)和/或锁相环电源模块(130)及确定输出时钟信号。本发明还公开了一种处理方法和一种电子装置。
时钟系统电子装置处理方法

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