专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种旋转变压器系统及其控制方法-CN201310001029.7无效
  • 黄雷;苟毅彤 - 天津清源电动车辆有限责任公司
  • 2013-01-04 - 2013-05-01 - H02P6/16
  • 数字信号控制芯片调制输出预设频率的正弦激励信号,调理后作为旋转变压器的额定电压;正弦激励信号的过零时刻作为数字信号控制芯片的中断信号;数字信号控制芯片的定时器以过零时刻作为时间基准开始计数,延时1/4周期后数字信号控制芯片采集所述旋转变压器余弦信号的AD采样;旋转变压器输出两路余弦调制模拟信号,信号调理电路对两路余弦调制模拟信号进行调理,获取调理后模拟信号并传输至数字信号控制芯片;数字信号控制芯片对调理后模拟信号进行同步采样,获取AD转换结果并输出转子位置角度值
  • 一种旋转变压器系统及其控制方法
  • [实用新型]一种工业以太网接口的编码器转换装置-CN201721148112.7有效
  • 陈虎;刘俊武;李俊;李文庆;隋继平;郝天阳 - 科德数控股份有限公司
  • 2017-09-08 - 2018-04-06 - H04L29/06
  • 本实用新型公开了一种工业以太网接口的编码器转换装置,至少包括FPGA模块、ARM模块、工业以太网物理层模块以及编码器接口模块;所述编码器接口模块至少包括TTL增量式编码器接口、余弦增量式编码器接口、绝对式编码器接口,所述FPGA模块至少包括增量式TTL接口控制器、增量式余弦接口控制器、绝对式编码器接口控制器;所述FPGA模块经所述编码器接口模块与编码器进行通讯,对编码器发出的串行数据进行解码,同时将编码器位置信息转换为工业以太网报文本实用新型统一多种编码器的输出接口,将串行数据输出、TTL输出、余弦输出统一转换为工业以太网报文,支持多种工业以太网协议,能够满足不同运动控制场合下的使用需求。
  • 一种工业以太网接口编码器转换装置
  • [实用新型]一种旋转变压器系统-CN201320001654.7有效
  • 黄雷;苟毅彤 - 天津清源电动车辆有限责任公司
  • 2013-01-04 - 2013-08-21 - H02P6/16
  • 数字信号控制芯片调制输出预设频率的正弦激励信号,调理后作为旋转变压器的额定电压;正弦激励信号的过零时刻作为数字信号控制芯片的中断信号;数字信号控制芯片的定时器以过零时刻作为时间基准开始计数,延时1/4周期后数字信号控制芯片采集所述旋转变压器余弦信号的AD采样;旋转变压器输出两路余弦调制模拟信号,信号调理电路对两路余弦调制模拟信号进行调理,获取调理后模拟信号并传输至数字信号控制芯片;数字信号控制芯片对调理后模拟信号进行同步采样,获取AD转换结果并输出转子位置角度值
  • 一种旋转变压器系统
  • [发明专利]基于跨级不完全连接机制的息肉检测假阳性辨识方法-CN202211359799.4在审
  • 徐勇军 - 中科(厦门)数据智能研究院
  • 2022-11-02 - 2023-01-13 - G06T7/00
  • 本发明公开了一种基于跨级不完全连接机制的息肉检测假阳性辨识方法,属于结肠镜息肉检测技术领域,包括构建空间多路径机制,定位特征图上显示息肉的特征区域,特征融合主体利用三种尺度的特征映射融合不同大小的病变特征,形成样本数据和负样本数据集合;同批次同样尺度的样本训练后计算余弦相似损失。本发明通过空间多路径机制对特征图上息肉的特征区域进行定位,形成样本数据集合和负样本数据集合,对同批次的样本训练后计算余弦相似损失,同时结合单阶段模型对负样本数据进行多尺度采样,结合极大似然估计选择置信度分数最高的负样本
  • 基于不完全连接机制息肉检测阳性辨识方法
  • [实用新型]余弦编码器采集卡-CN201120067955.0有效
  • 张美成;朱钧 - 无锡市展鹏科技有限公司
  • 2011-03-15 - 2011-10-12 - H03M1/12
  • 本实用新型公开了一种余弦编码器采集卡,包括运算放大电路、第一级触发器、第二级触发器、异或门和另一触发器,其特征在于:所述运算放大电路与第一级触发器相连接,第一级触发器与第二级触发器相连接,所述第一级触发器输出的信号和第二级触发器输出的信号通过异或门输入到另一触发器内内处理本实用新型解决了现有技术中编码器采集卡时钟信号受到电机运行速度的高低变化和相关电容、电阻参数离散性的影响,导致编码器采集卡的抗干扰能力较差与采集精度较低的问题,提供了一种抗干扰能力强、对电机不同运行状态影响小、成本低同时安装调试方便的余弦编码器采集卡
  • 余弦编码器采集

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