专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种RS码编码器及编码方法-CN201410549916.2有效
  • 谭卓越;单琦;孟祥国;靳云;李璇 - 航天恒星科技有限公司
  • 2014-10-16 - 2019-04-05 - H03M13/15
  • 本发明公开了一种RS码编码器及编码方法,包括RS码并行生成多项式系数计算模块、RS码符号串并转换模块、RS码并行计算使能产生模块和RS码符号并行计算模块;RS码并行生成多项式系数计算模块接受任意RS码生成多项式系数,完成并行生成多项式系数计算,将并行生成多项式系数传递给RS码符号并行计算模块;RS码符号串并转换模块对输入待编码信息完成串并转换,输出并行RS码信息符号;计算使能产生模块根据输入配置参数及数据时钟产生RS码并行计算模块使能信号;RS码符号并行计算模块根据RS码并行生成多项式系数及计算使能完成并行RS码校验符号计算;本发明适用于基于FPGA的高速调制器的高速RS编码,并且支持定义在不同有限域上的RS码码率自适应编码
  • 一种rs编码器编码方法
  • [发明专利]串扰检验方法-CN200310119595.4无效
  • 岩西信房 - 松下电器产业株式会社
  • 2003-12-04 - 2004-06-23 - G06F17/50
  • 并行线路长度提取过程中,输入布线和依据间距的基准值,该依据间距的基准值描述随线路间距而不同的并行线路长度的限定值,从而提取相邻线路之间的并行线路长度。在依据间距的并行线路长度检验过程中,针对并行线路长度提取过程中提取的相邻线路计算线路间距,将相邻线路之间的并行线路长度与依据间距的基准值比较,在并行线路长度较大的情况下确定发生串扰的部分。
  • 检验方法
  • [发明专利]一种基于固态硬盘的数据库并行排序连接系统-CN202110778813.3在审
  • 范玉雷;周郑杰;王俊凯;赵懂佳;许铃冰;周科宇 - 浙江工业大学
  • 2021-07-09 - 2021-10-29 - G06F3/06
  • 一种基于固态硬盘的数据库并行排序连接系统,内存作为并行读固态硬盘管理模块的数据页缓冲区、并行排序模块排序缓冲区、并行写固态硬盘管理模块的归并缓冲区和并行连接模块的连接缓冲区;固态硬盘中存储有待排序数据和数据字典;系统判别模块根据数据字典中对待排序数据的统计信息判断内存数据页缓冲区大小与待排序数据量之间的关系,决定系统采用哪种排序方法;并行读固态硬盘管理模块并行读取固态硬盘并把数据存入内存数据页缓冲区;并行排序模块对内存排序缓冲区中的数据进行排序;并行写固态硬盘管理模块把排好序的数据从归并缓冲区写入固态硬盘;并行连接模块对内存连接缓冲区中的数据进行连接。本发明能够充分发挥固态硬盘内部并行特性。
  • 一种基于固态硬盘数据库并行排序连接系统
  • [发明专利]一种并行文件存储系统及方法-CN202210513731.0在审
  • 冯康;张天松;肖连菊;易夕冬;陈劭旻 - 广东奥飞数据科技股份有限公司
  • 2022-05-11 - 2022-07-29 - G06F3/06
  • 本发明涉及文件储存技术领域,具体为一种并行文件存储系统及方法,包括并行文件存储系统,所述并行文件存储系统的输出端电性连接有并行文件存储优化模组,所述并行文件存储优化模组的输出一端电性连接有并行存储器模块,且并行文件存储优化模组的输出另一端电性连接有采用分层存储模块,并且并行文件存储优化模组的输出另一端电性连接有增添缓冲器模块,交叉访问存储器则包括有低位交叉模块和高位交叉模块,通过低位交叉模块中的交叉访问并行存储器连续地址分布在相邻的不同模块中,可以实现多模块并行存取,提高存储器带宽,以及高位交叉程序内的访问地址按顺序分配给各个模块,某个模块工作的时候其他模块不工作,进行并行文件储存的调控。
  • 一种并行文件存储系统方法
  • [发明专利]一种RNN并行模型及其在多核CPU上的实现方法及系统-CN202111204314.X有效
  • 董小社;余星达;陈维多;何欣瑞;王强;陈衡;王龙翔 - 西安交通大学
  • 2021-10-15 - 2023-08-18 - G06N3/044
  • 本发明公开了一种RNN并行模型及其在多核CPU上的实现方法及系统,针对多层RNN结构进行层内和层间并行优化,将原输入序列分成许多最小子序列,并将切分后的多层子RNN作用于每个最小子序列;采用层间并行方法分析作用于每个最小子序列的多层子RNN中数据的依赖关系,将不同层及不同时间步的循环单元并行化;采用核组内的模型并行将多层次的RNN并行模型映射在多核CPU的第一层次;采用核组间的数据并行将多层次的RNN并行模型映射在多核CPU的第二层次,充分利用了多核CPU架构特点,实现多层次的RNN并行模型在多核CPU上的并行训练。本发明充分利用多核处理器架构的特点,实现循环神经网络更细粒度的并行方式,加快网络的训练。
  • 一种rnn并行模型及其多核cpu实现方法系统

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