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[发明专利]BHT在具有可变长度指令集执行模式的处理器中的有效使用-CN200780034094.2有效
发明人：罗德尼·韦恩·史密斯;布莱恩·迈克尔·斯坦普尔 -专利权人：高通股份有限公司
申请日： 2007-09-28 - 公布日： 2009-08-26 - 主分类号： G06F9/38 文献下载
摘要：在至少在具有第一最小指令长度的第一指令集执行模式及具有较小的第二最小指令长度的第二指令集执行模式中执行指令的处理器中形成行及计数器索引地址，所述行及计数器索引地址存取分支历史表(BHT)中的每一计数器且减少基于当前指令集执行模式而多路复用的索引地址位的数目在一个实施例中，以使得在一个指令集执行模式中可针对每一存取给所述BHT的一半断电的方式布置BHT行内的计数器并给其加索引。
bht 具有可变长度指令执行模式处理器中的有效使用

[发明专利]基站、用户设备、通讯系统及其远程控制方法-CN201811493213.7在审
发明人：林享桦;廖光耀;李秉懋;许宗棋 -专利权人：光宝电子(广州)有限公司;光宝科技股份有限公司
申请日： 2018-12-07 - 公布日： 2020-06-16 - 主分类号： H04W4/06 文献下载
摘要：远程主机传送组态指令，组态指令相关于省电组态。基站经由回程线路接收组态指令，并依据组态指令而经由蜂巢式物联网网络传送广播消息，广播消息包括组态指令所要求对象的识别信息。通过通讯收发器依据广播消息执行资源存取作业，并反应于资源存取作业完成，通过通讯收发器接收来自基站的组态指令。藉此，可达到省电效果并能符合实际需求。
基站用户设备通讯系统及其远程控制方法

[发明专利]指令存取及排程的方法及其装置-CN200610138686.6有效
发明人：洪伟翔;苏耀群;贾维中;高智国 -专利权人：威盛电子股份有限公司
申请日： 2006-11-10 - 公布日： 2007-03-28 - 主分类号： G06F9/38 文献下载
摘要：本发明提供一种指令存取及排程的方法及其装置，特别涉及一种指令存取的方法，包括下列步骤：接收至少一指令；判断该指令为一写入指令或一非写入指令，其中若该指令为该写入指令则将该指令存储于一元件写入暂存器中，若该指令为该非写入指令，则将该指令存储于一元件非写入暂存器中；判断该指令是否为一对等运算指令，其中若该指令为一对等运算指令则将该指令经由一对等运算指令路径传送至一指令下行单元，若该指令为非对等运算指令则将该指令传送至一处理单元；及接收该对等运算指令路径及该处理单元传送过来的指令并分别下行该写入指令及该非写入指令。
指令存取方法及其装置

[发明专利]预先读取脱序执行指令的方法及处理器-CN200410033576.4有效
发明人：威廉·V·米勒 -专利权人：威盛电子股份有限公司
申请日： 2004-04-07 - 公布日： 2005-02-16 - 主分类号： G06F9/38 文献下载
摘要：一种处理脱序执行指令的方法及处理器，在一实施例中，其处理器包含指令预先读取逻辑，用以从存储器中预先读取指令。此处理器更包含指令信息逻辑，用以从存储器中储存与所读取的指令有关的信息。此处理器更包含控制逻辑，如果当时有一激态存储器存取，而且上述的预先读取指令为一脱序执行指令，则上述的控制逻辑是用以控制与一预先读取的指令有关的信息的暂时储存。此一方法预先读取指令中的脱序执行，暂时将和脱序执行指令有关的信息储存在一储存位置，而且如果完成了存储器存取，未发生数据错误，就将暂时储存的信息储存起来，并处理上述的预先读取的指令。
预先读取执行指令方法处理器

[发明专利]用于消除具有多个存储器存取的DSP/处理器中的存储缓冲器的架构和方法-CN201180052455.2有效
发明人：詹特星·肯·林;阿贾伊·阿南特·英格尔;伊新·A·郭;保罗·道格拉斯·巴塞特 -专利权人：高通股份有限公司
申请日： 2011-11-01 - 公布日： 2016-11-09 - 主分类号： G06F9/38 文献下载
摘要：一种用于控制对存储器的系统存取的方法和设备，其包含接收第一和第二指令，以及评估两个指令是否可在架构上完成。当至少一个指令不能在架构上完成时，延迟两个指令。当两个指令可在架构上完成且至少一者为写入指令时，调整所述存储器的写入控制以考虑评估延迟。所述评估延迟可足以评估两个指令是否可在架构上完成。可将所述评估延迟输入到所述存储器的所述写入控制而不是读取控制。评估两个指令是否可在架构上完成可包含确定用于每一指令的数据是否位于高速缓冲存储器中，以及所述指令是否为存储器存取指令。
用于消除具有存储器存取 dsp 处理器中的存储缓冲器架构方法

[发明专利]一种利用智能存取柜的实现物品转交的方法、物品转交处理装置和存取柜系统-CN201911024361.9在审
发明人：石广宁;张伟光;朱国华 -专利权人：广州甩手技术有限公司
申请日： 2019-10-25 - 公布日： 2020-02-14 - 主分类号： G07F17/12 文献下载
摘要：本发明公开一种利用智能存取柜的实现物品转交的方法，包括第一取件流程，第一取件流程实现为：接收第二用户端发送的登录指令；响应于第二用户端发出的登录指令，获取授权信息，根据授权信息获取匹配的取件订单，并将取件订单以能够接收开锁指令的形式呈现在第二用户端，其中，授权信息包括有第二用户端标识信息；接收第二用户端的开锁指令响应于第二用户端发出的开锁指令，控制存取柜匹配的空间格打开柜门。根据本发明的另一个方面，提供了一种物品转交处理装置和存取柜系统，根据本发明公开的方法、装置及系统可以实现用户间的转存操作，并且对取件用户进行登记和监视，还可以多人同时操作同一柜子。
取件用户端开锁指令授权信息存取柜登录匹配转交用户端标识信息指令装置及系统处理装置智能存取空间格响应柜门转存柜子发送监视

[发明专利]执行存储器引用过滤的装置、系统和方法-CN201110170566.5有效
发明人： C·J·纽博恩;K·希夫 -专利权人：英特尔公司
申请日： 2007-08-21 - 公布日： 2018-05-22 - 主分类号： G06F9/48 文献下载
摘要：本申请提供执行存储器引用过滤的装置、系统和方法，其中执行存储器引用过滤的装置，包括第一硬件逻辑以及标志存储区，其中第一硬件逻辑被配置为：响应于在执行软件程序期间检测到预定指令而监控在程序命令中预定指令之后的指令；确定对应于在预定指令之后的指令的存储器存取操作是否要存取未被分配给对应于软件程序的线程的一个或多个存储器区域；如果是，则引起事件以调用中断处理程序来阻止对应于软件程序的线程存取一个或多个预定存储器区域
执行存储器引用过滤装置系统方法

[发明专利]微处理机与随机存取快取记忆体的快速弹出装置及其方法-CN200510000489.3有效
发明人：霍克尔伊·罗德尼 -专利权人：智权第一公司
申请日： 2005-01-11 - 公布日： 2005-06-15 - 主分类号： G06F9/30 文献下载
摘要：本发明是关于一种微处理机与随机存取快取记忆体的快速弹出装置及其方法，该随机存取快取记忆体的快速弹出装置包括一堆栈以接收存放于快取记忆体的推入(push)指令数据的列与栏。在执行弹出(pop)指令时，此装置使用堆栈最顶端的列与栏数值存取快取记忆体。在一实施例中，会记录顶端的列与栏数值所指定的目前快取线的最近推入数据的位移值(offset)。此位移值在每次执行推入或弹出指令时都会更新。如果弹出指令造成此位移值溢位(overflow)，堆栈最顶端的记录单位就会弹出。如果推入指令造成此位移值欠位(underflow)，列数值与栏数值会被推入堆栈。上述的列数值、栏数值、与位移值稍后会与真实的弹出位址作比较，以决定猜测提供的数据正确与否。
微处理机随机存取记忆体快速弹出装置及其方法

[发明专利]存储器子系统的多字元储存/读取方法以及其电路-CN200810003158.9有效
发明人：苏泓萌;张传华;曾仁志 -专利权人：晶心科技股份有限公司
申请日： 2008-01-11 - 公布日： 2008-08-06 - 主分类号： G06F9/34 文献下载
摘要：本发明提供一种多字元搬移指令，利用此多字元搬移指令的存储器搬移方法，以及在存储器子系统与处理器寄存器群组之间进行多字元搬移的一种电路。多字元搬移指令定义：存取类型(载入或储存)，连续寄存器组，选择遮罩，以及用于存储器位置起始地址的基底寄存器。因此，由此指令所存取的字元总数等于，由连续寄存器组所定义的寄存器数量连同由选择遮罩所规定的寄存器数量。除此之外，多字元搬移指令还定义：地址更新模式，顺序模式，以及修改模式。
存储器子系统多字储存读取方法及其电路

[发明专利]处理用于数据存取的存取属性-CN201480045561.1有效
发明人：西蒙·克拉斯克;安东尼·潘顿 -专利权人： ARM有限公司
申请日： 2014-07-15 - 公布日： 2018-11-09 - 主分类号： G06F9/30 文献下载
摘要：可由第一及第二软件(10、12)设置属性以指示数据存取指令的执行是否可中断。对于预定类型的数据存取指令(由第二软件(10)设置的第二属性规定该指令可中断)，该指令可被设置为可中断，即使由第一软件(12)设置的第一属性规定该指令的执行不能中断亦如此。
特权中断数据处理设备指令处理电路系统数据存取指令存取指令数据存取预定类型指示数据存取

[发明专利]用于高速缓冲存储器存取模式选择的方法和设备-CN201580026298.6有效
发明人： S·K·凡库玛汉堤;S·R·香农 -专利权人：高通股份有限公司
申请日： 2015-05-01 - 公布日： 2018-07-17 - 主分类号： G06F9/30 文献下载
摘要：本发明涉及一种特定方法，所述方法包含基于存储在发布队列处的数个指令、执行单元的数个活跃线程，或基于这两者，在第一高速缓冲存储器存取模式和第二高速缓冲存储器存取模式之间进行选择。所述方法进一步包含执行第一高速缓冲存储器存取。当选定所述第一高速缓冲存储器存取模式时，执行所述第一高速缓冲存储器存取包含执行标记存取，并在执行所述标记存取之后执行数据阵列存取。当选定所述第二高速缓冲存储器存取模式时，执行所述第一高速缓冲存储器存取包含与所述数据阵列存取并行地执行所述标记存取。
高速缓冲存储器存取存取模式数据阵列方法和设备队列线程并行存储指令发布

[发明专利]具备总线存取收回的数据处理系统-CN200580032682.3有效
发明人：威廉·C·莫耶;布雷特·W·默多克 -专利权人：飞思卡尔半导体公司
申请日： 2005-09-01 - 公布日： 2007-08-29 - 主分类号： G06F13/00 文献下载
摘要：总线主控(112)可基于当前待定存取的一个或多个特性来选择性地收回当前待定存取。这样，总线主控可以更好地控制其存取请求。一个或多个特性可包括，例如，存取类型(例如，读/写、指令/数据、突发/非突发等等)、存取的顺序或次序、正在被存取的地址(例如，正在被存取的地址范围或者正在被存取的设备)、请求收回的总线主控(例如，在多主控系统中总线仲裁(216)还可基于当前待定存取请求或后续存取请求的一个或多个特性来选择性收回当前待定存取请求以便后续存取请求。
具备总线存取收回数据处理系统

[发明专利]具备总线存取收回的数据处理系统-CN200580032673.4有效
发明人：威廉·C·莫耶;吉米·谷穆佳;布雷特·W·默多克 -专利权人：飞思卡尔半导体公司
申请日： 2005-09-01 - 公布日： 2007-08-29 - 主分类号： G06F13/00 文献下载
摘要：总线主控(112)可基于当前待定存取的一个或多个特性来选择性地收回当前待定存取。这样，总线主控可以更好地控制其存取请求。一个或多个特性可包括，例如，存取类型(例如，读/写、指令/数据、突发/非突发等等)、存取的顺序或次序、正在被存取的地址(例如，正在被存取的地址范围或者正在被存取的设备)、请求收回的总线主控(例如，在多主控系统中总线仲裁(216)还可基于当前待定存取请求或后续存取请求的一个或多个特性来选择性收回当前待定存取请求以便后续存取请求。
具备总线存取收回数据处理系统

[发明专利]具有低消耗电流的内存和降低内存消耗电流的方法-CN201410249607.3有效
发明人：夏浚 -专利权人：钰创科技股份有限公司
申请日： 2014-06-06 - 公布日： 2018-06-19 - 主分类号： G06F3/06 文献下载
摘要：所述方法包括所述控制器致能对应所述多个记忆区块中一第一记忆区块的地址和一第一列地址的激活指令；所述第一记忆区块的一记忆区段内对应所述第一列地址的一字符开关根据所述激活指令开启；所述控制器致能对应所述记忆区段的地址的一存取指令；对应所述记忆区段的多个位开关根据所述存取指令开启；在所述存取指令去能后，所述控制器致能对应随后记忆区段的地址和所述第一记忆区块的地址的一预充电指令。
记忆区块记忆区段控制器内存存取指令致能低消耗电流激活指令内存消耗列地址个位开关消耗电流预充电指令

[发明专利]硬件加速器与数据传输方法-CN200710181591.7有效
发明人：许钰鼎;涂长利 -专利权人：威盛电子股份有限公司
申请日： 2007-10-23 - 公布日： 2008-03-05 - 主分类号： G06F13/38 文献下载
摘要：数据传输系统包括总线控制器、指令暂存器、数据暂存器、储存装置控制器与硬件加速器。总线控制器用以经由总线连接至主机以接收指令包。指令与数据暂存器分别用以储存总线控制器接收的指令包与数据。储存装置控制器用以控制储存装置的存取操作。硬件加速器用以根据指令包产生并根据控制指令驱动储存装置控制器与总线控制器其中之一搬动数据暂存器中的数据至其中的另一。本发明具有数据存取速度较高、处理器的运算负载较低与数据存取速度不易受到处理器的运算负载影响的优点。
硬件加速器数据传输方法