[发明专利]嵌套的延时锁定环有效
| 申请号： | 202111487646.3 | 申请日： | 2021-12-06 |
| 公开（公告）号： | CN114142855B | 公开（公告）日： | 2022-12-20 |
| 发明（设计）人： | 万海军;李健平;张跃玲 | 申请（专利权）人： | 苏州聚元微电子股份有限公司 |
| 主分类号： | H03L7/23 | 分类号： | H03L7/23;G06F30/33 |
| 代理公司： | 江苏长德知识产权代理有限公司 32478 | 代理人： | 汤小权 |
| 地址： | 215000 江苏省苏州市苏州工业园*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了嵌套的延时锁定环，属于芯片设计技术领域，包括芯片电路环路中两个互相嵌套的延时锁定环(DLL)，第一个延时锁定环(DLL1)能够使数模转换器(DAC)的输出与输入差分时钟(CLKP和CLKN)同步，第二个延时锁定环(DLL2)能够产生与输入差分时钟(CLKN)同频的时钟，进而实现芯片电路环路系统时钟或信号通路总延时的最小化；本发明，通过将芯片电路环路中的两个延时锁定环(DLL)进行互相嵌套，既满足了各自环路时钟和信号的同步要求，又达到芯片电路环路系统总延时最小化的设计目标。 | ||
| 搜索关键词： | 嵌套 延时 锁定 | ||
【主权项】：
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