[发明专利]基于yosys实现求和运算的FPGA逻辑综合方法及装置有效
| 申请号： | 202111130658.0 | 申请日： | 2021-09-26 |
| 公开（公告）号： | CN113568598B | 公开（公告）日： | 2021-12-14 |
| 发明（设计）人： | 王鑫楠;赵美飞;刘洋 | 申请（专利权）人： | 中科亿海微电子科技（苏州）有限公司 |
| 主分类号： | G06F7/575 | 分类号： | G06F7/575 |
| 代理公司： | 北京融智邦达知识产权代理事务所(普通合伙) 11885 | 代理人： | 董惠文 |
| 地址： | 215000 江苏省苏州市苏州工业园区金*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提供了一种基于yosys实现求和运算的FPGA逻辑综合方法及装置，使用yosys将求和运算的用户电路描述文件解析生成语法树；根据语法树中的节点类型提取出描述求和模块的RTL级数据对象，形成RTL级数据对象集合；将RTL级数据对象集合转化为逻辑门级对象集合，建立逻辑门级对象之间的进位链信号连接；打印提取逻辑网表文件。通过将RTL级Cell对象的多位宽操作数进行拆分，建立多个单位宽的逻辑门级Cell对象集合，在新建逻辑门级Cell对象的同时新建表示求和运算产生的Wire类型的进位信号，由于逻辑门级对象中增加了进位信号，并且将进位信号作为操作数，减少了求和运算中的逻辑单元块的使用数量。 | ||
| 搜索关键词： | 基于 yosys 实现 求和 运算 fpga 逻辑 综合 方法 装置 | ||
【主权项】：
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