[发明专利]用于在串行器/解串器(SERDES)宏中同时传播多个时钟频率的方法和装置在审

专利信息
申请号: 202080061548.0 申请日: 2020-08-20
公开(公告)号: CN114342312A 公开(公告)日: 2022-04-12
发明(设计)人: 马克-安德烈·拉克鲁瓦;穆罕默德·马赫迪·穆赫森普尔 申请(专利权)人: 华为技术有限公司
主分类号: H04L7/033 分类号: H04L7/033
代理公司: 广州三环专利商标代理有限公司 44202 代理人: 石朝清
地址: 518129 广东*** 国省代码: 广东;44
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摘要: 所公开的系统、结构和方法涉及一种双线制时钟乘法单元(CMU),CMU采用第一锁相环(PLL)、第二PLL、以及加法器,第一PLL用于生成差模编码的第一高速时钟频率f1,第二PLL用于生成共模编码的第二高速时钟频率f2,加法器用于组合差模编码的第一高速时钟频率f1和共模编码的第二高速时钟频率f2,并在双线制导体总线上发送组合的差模和共模高速时钟频率。此外,系统、结构和方法涉及一种双线制时钟恢复模块,还公开了双线制时钟恢复模块。
搜索关键词: 用于 串行 解串器 serdes 同时 传播 时钟 频率 方法 装置
【主权项】:
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