[发明专利]有/无符号乘累加装置及方法有效
| 申请号： | 202011521792.9 | 申请日： | 2020-12-21 |
| 公开（公告）号： | CN112558920B | 公开（公告）日： | 2022-09-09 |
| 发明（设计）人： | 尹首一;谷江源;孙庆斌;张淞;刘雷波;魏少军 | 申请（专利权）人： | 清华大学 |
| 主分类号： | G06F7/544 | 分类号： | G06F7/544;G06F7/48;G06F7/53;G06F7/533 |
| 代理公司： | 北京三友知识产权代理有限公司 11127 | 代理人： | 单晓双;叶明川 |
| 地址： | 10008*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供了一种有/无符号乘累加装置及方法，适用于粗粒度可重构处理器架构，所述装置包含拆分模块、运算模块、处理模块和输出模块；拆分模块用于获取配置控制信号，根据配置控制信号将输入的大于预设位宽的二进制被乘数、乘数和加数，按预设拆分规则拆分生成多组小于预设位宽的二进制数；运算模块用于根据配置控制信号中的动态配置文件，通过多个MAC运算单元对多组小于预设位宽的二进制数进行对应的分组后，分别进行乘累加计算和/或并行乘累加计算获得多个计算结果；处理模块用于将多个计算结果按预设调整规则分别进行移位和有效位扩展处理获得多个大于预设位宽的处理结果；输出模块用于将多个处理结果进行累加获得运算结果。 | ||
| 搜索关键词： | 符号 累加 装置 方法 | ||
【主权项】：
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