[发明专利]锁相环电路和包括锁相环电路的时钟发生器在审
| 申请号： | 202011054351.2 | 申请日： | 2020-09-29 |
| 公开（公告）号： | CN112653454A | 公开（公告）日： | 2021-04-13 |
| 发明（设计）人： | 郑在洪;郑相敦;李京珉;韩秉基 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | H03L7/081 | 分类号： | H03L7/081 |
| 代理公司： | 中科专利商标代理有限责任公司 11021 | 代理人： | 杨姗 |
| 地址： | 韩国*** | 国省代码： | 暂无信息 |
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| 摘要： | 锁相环(PLL)电路可以包括压控振荡器、亚采样PLL电路和分数分频控制电路。分数分频控制电路可以包括：压控延迟线，路由反馈信号以生成延迟信息；复制压控延迟线，其上施加有延迟信息并且被配置为路由参考时钟信号以生成多个延迟参考时钟信号，每个延迟参考时钟信号被延迟多达不同的相应延迟时间；以及数字时间转换器DTC，被配置为根据多个延迟参考时钟信号生成选择参考时钟信号，并将选择参考时钟信号输出到亚采样PLL电路。 | ||
| 搜索关键词： | 锁相环 电路 包括 时钟发生器 | ||
【主权项】：
暂无信息
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