[发明专利]内嵌处理器进行快速数据通信的方法、装置及存储介质有效
| 申请号： | 201911009338.2 | 申请日： | 2019-10-23 |
| 公开（公告）号： | CN110737618B | 公开（公告）日： | 2021-03-16 |
| 发明（设计）人： | 贾复山;张继存 | 申请（专利权）人： | 盛科网络(苏州)有限公司 |
| 主分类号： | G06F13/34 | 分类号： | G06F13/34 |
| 代理公司： | 苏州威世朋知识产权代理事务所(普通合伙) 32235 | 代理人： | 苏婷婷 |
| 地址： | 215021 江苏省苏州市*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提供一种内嵌处理器进行快速数据通信的方法、装置及存储介质，所述方法包括：将内存储器分割为地址连续，且顺序编址的多个片上存储单元；配置连接于内存储器的内存接口控制器，内存接口控制器包括多个内存接口控制单元；配置分别连接于内存接口控制器的片上处理器和DMA控制器，DMA控制器包括与内存接口控制单元一一对应设置的多个请求分配单元；配置连接于DMA控制器的专用功能模块，专用功能模块包括多个数据采集单元和多个数据接收单元；当片上处理器以及DMA控制器发生读写请求时，通过内存接口控制单元匹配对应的片上存储单元以读写内存储器中数据，并将读出的数据返回给原请求模块。本发明可以提供并发的数据处理能力，提高了数据处理带宽。 | ||
| 搜索关键词： | 处理器 进行 快速 数据通信 方法 装置 存储 介质 | ||
【主权项】：
1.一种内嵌处理器进行快速数据通信的方法，其特征在于，所述方法包括：/n将内存储器分割为地址连续，且顺序编址的多个片上存储单元，不同片上存储单元之间的读写操作相互独立且可以同时进行；/n配置连接于内存储器的内存接口控制器，所述内存接口控制器包括多个内存接口控制单元，每一内存接口控制单元对应至少一个片上存储单元，每一片上存储单元唯一对应一个内存接口控制单元；/n配置分别连接于内存接口控制器的片上处理器和DMA控制器，所述DMA控制器包括与内存接口控制单元一一对应设置的多个请求分配单元，每一请求分配单元处理的请求信息所对应的地址与片上处理器的地址段匹配，且每一请求分配单元处理的请求信息所对应的地址与通过内存接口控制单元对应的片上存储单元的地址匹配；/n配置连接于DMA控制器的专用功能模块，所述专用功能模块包括多个数据采集单元和多个数据接收单元，所述片上处理器用于配置专用功能单元所对应的内存的地址范围，每一专用功能模块均分别连接于每一请求分配单元；/n当片上处理器对内存储器发生读写请求时，通过内存接口控制单元匹配对应的片上存储单元以读写内存储器中数据，并将读出的数据返回给原请求模块，和/或当专用功能模块通过DMA控制器对内存储器发生读写请求时，通过所述DMA控制器按请求的地址对接内存接口控制器，并通过内存接口控制单元匹配对应的片上存储单元以读写内存储器中数据，并将读出的数据返回给原请求模块。/n
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