[发明专利]可编程平台上的加速器架构在审
| 申请号： | 201910218813.0 | 申请日： | 2015-05-29 |
| 公开（公告）号： | CN110109859A | 公开（公告）日： | 2019-08-09 |
| 发明（设计）人： | D·希派;M·朗哈默;J·伊斯特莱克 | 申请（专利权）人： | 阿尔特拉公司 |
| 主分类号： | G06F13/42 | 分类号： | G06F13/42 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 酆迅;张昊 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 可编程集成电路设备上的加速处理器结构包括处理器以及多个可配置数字信号处理器(DSP)。每个可配置DSP都包括电路块，电路块又包括多个乘法器。加速处理器结构还包括：第一总线，以将数据从处理器传输至可配置DSP；以及第二总线，以将数据从可配置DSP传输至处理器。 | ||
| 搜索关键词： | 可配置 处理器 处理器结构 总线 电路块 可编程集成电路 数字信号处理器 可编程平台 传输 乘法器 加速器 架构 | ||
【主权项】：
1.一种集成电路系统，包括：软件可编程矢量处理电路装置，包括：软件可编程矢量处理器的阵列，其中所述软件可编程矢量处理器包括根据软件指令操作的硬化电路装置；和第一互连；现场可编程门阵列(FPGA)可编程逻辑电路装置，包括第二互连；硬件处理器系统；以及片上网络(NOC)，所述片上网络经由所述第一互连与所述可编程逻辑通信地耦合，经由所述第二互连与所述软件可编程矢量处理电路装置通信地耦合，并且与所述硬件处理器系统通信地耦合。
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