[发明专利]用来防止软件侧通道的机制在审
| 申请号： | 201910117040.7 | 申请日： | 2019-02-15 |
| 公开（公告）号： | CN110162380A | 公开（公告）日： | 2019-08-23 |
| 发明（设计）人： | F.马基恩;幸滨;K.兹穆德青斯基;C.罗扎斯;M.维吉 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F9/455 | 分类号： | G06F9/455;G06F21/53 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 高苇娟;申屠伟进 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 提供了用来防止软件侧通道的机制。一种处理器包括处理核心，用来标识包括要在架构上受保护的环境中执行的多个指令的代码，确定被存储在架构上受保护的存储器中的第一物理存储器页面与由所述多个指令中的第一指令引用的第一虚拟存储器页面匹配，生成第一虚拟存储器页面的第一地址和第一物理存储器页面的第二地址之间的第一地址映射，在高速缓冲存储器中存储包括第一地址映射的地址翻译数据结构，并且通过取回被存储在地址翻译数据结构中的第一地址映射来执行代码。 | ||
| 搜索关键词： | 地址映射 虚拟存储器 存储 地址翻译 数据结构 侧通道 受保护 架构 高速缓冲存储器 物理存储器页面 指令 物理存储器 存储器 处理核心 指令引用 处理器 取回 匹配 页面 | ||
【主权项】：
1.一种处理器，包括：高速缓冲存储器；以及处理核心，其被通信地耦合到包括架构上受保护的存储器的架构上受保护的环境，所述处理核心要：标识包括要在所述架构上受保护的环境中执行的多个指令的代码；确定被存储在所述架构上受保护的存储器中的第一物理存储器页面与由所述多个指令中的第一指令引用的第一虚拟存储器页面匹配；生成第一虚拟存储器页面的第一地址和第一物理存储器页面的第二地址之间的第一地址映射；在所述高速缓冲存储器中存储包括第一地址映射的地址翻译数据结构；以及通过取回被存储在所述地址翻译数据结构中的第一地址映射来执行所述代码。
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