[发明专利]半导体装置及半导体装置的制造方法在审
申请号: | 201880026747.0 | 申请日: | 2018-09-28 |
公开(公告)号: | CN110574153A | 公开(公告)日: | 2019-12-13 |
发明(设计)人: | 须泽孝昭 | 申请(专利权)人: | 富士电机株式会社 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L21/28;H01L23/522 |
代理公司: | 11286 北京铭硕知识产权代理有限公司 | 代理人: | 张欣;金玉兰 |
地址: | 日本神奈*** | 国省代码: | 日本;JP |
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摘要: | 在层间绝缘膜(13)的接触孔(14),介由势垒金属(15)埋入成为接触插塞的钨膜(16)。层间绝缘膜(13)是依次层叠HTO膜(11)和BPSG膜(12)而成的。BPSG膜(12)与HTO膜(11)相比,由势垒金属(15)形成前的前处理的湿式蚀刻中使用的氢氟酸水溶液进行的蚀刻的速度更快。在制造这种结构的半导体装置时,在层间绝缘膜(13)形成接触孔(14)后,通过势垒金属(15)形成前的前处理的湿式蚀刻,使接触孔(14)的在BPSG膜(12)的部分(14a)的宽度(w1)阶梯状地大于在HTO膜(11)的部分(14b)的宽度(w2),从而减小接触孔(14)的深宽比。由此,能够实现微小化和可靠性提高。 | ||
搜索关键词: | 接触孔 层间绝缘膜 势垒金属 湿式蚀刻 前处理 蚀刻 氢氟酸水溶液 半导体装置 接触插塞 阶梯状地 依次层叠 深宽比 减小 埋入 钨膜 制造 | ||
【主权项】:
1.一种半导体装置,其特征在于,具备:/n第2导电型的第1半导体区,其设置于第1导电型的半导体基板的第1主面的表面层;/n第1导电型的第2半导体区,其是所述半导体基板的除所述第1半导体区以外的部分;/n元件结构,其设置于所述半导体基板的第1主面侧,且具有所述第1半导体区与所述第2半导体区的pn结;/n层间绝缘膜,其设置于所述半导体基板的第1主面上,且覆盖所述元件结构;/n接触孔,其是将所述层间绝缘膜选择性地开口而成,并且选择性地露出所述半导体基板的第1主面;/n第1金属膜,其沿着所述接触孔的内壁而设置,与所述半导体基板的紧贴性高,且与所述半导体基板进行欧姆接触;/n第2金属膜,其在所述接触孔的内部埋入到所述第1金属膜上;以及/n第1电极,其设置在所述层间绝缘膜和所述第2金属膜上,且介由所述第2金属膜和所述第1金属膜而与所述第1半导体区电连接,/n所述层间绝缘膜具有:/n第1绝缘膜,其设置于所述半导体基板的第1主面上,以及/n第2绝缘膜,其设置于所述第1绝缘膜上,且由对氢氟酸或稀氢氟酸的蚀刻速度比所述第1绝缘膜快的绝缘材料构成,/n所述接触孔在侧壁具有台阶,所述台阶的在所述第2绝缘膜的部分的宽度阶梯状地大于在所述第1绝缘膜的部分的宽度,/n所述接触孔的在所述第1绝缘膜的部分的深宽比为0.5以上且1.5以下,/n所述接触孔的在所述第2绝缘膜的部分的深宽比为0.5以上且1.5以下。/n
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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