[发明专利]一种3Gsps信号处理平台的时钟系统在审
| 申请号： | 201811357612.0 | 申请日： | 2018-11-15 |
| 公开（公告）号： | CN109542162A | 公开（公告）日： | 2019-03-29 |
| 发明（设计）人： | 舒德军;胡红伟;吴智慧 | 申请（专利权）人： | 南京长峰航天电子科技有限公司 |
| 主分类号： | G06F1/12 | 分类号： | G06F1/12 |
| 代理公司： | 南京纵横知识产权代理有限公司 32224 | 代理人： | 董建林;张欢欢 |
| 地址： | 210061 江*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了一种3Gsps信号处理平台的时钟系统，包括依次相连的AD时钟缓冲器、AD转换单元和FPGA1处理单元，以及依次相连的DA时钟缓冲器、DA转换单元和FPGA2处理单元，外部时钟输入AD时钟缓冲器转换为差分信号，此差分信号输入AD转换单元作为其工作时钟，AD转换单元输出差分信号传给FPGA1处理单元作为其基准时钟；外部时钟输入DA时钟缓冲器转换为差分信号，此差分信号输入DA转换单元作为其工作时钟，DA转换单元输出差分信号传给FPGA2处理单元作为其基准时钟；FPGA1处理单元与FPGA2处理单元同步。本发明实现系统中两路FPGA分别处理ADC、DAC信号，并在参考时钟的基准下实现同步。 | ||
| 搜索关键词： | 处理单元 时钟缓冲器 差分信号 信号处理平台 工作时钟 基准时钟 时钟系统 外部时钟 依次相连 输出差 参考时钟 转换 两路 | ||
【主权项】：
1.一种3Gsps信号处理平台的时钟系统，其特征是，包括依次相连的AD时钟缓冲器、AD转换单元和FPGA1处理单元，以及依次相连的DA时钟缓冲器、DA转换单元和FPGA2处理单元，外部时钟输入AD时钟缓冲器之后转换为差分信号，此差分信号输入AD转换单元作为其工作时钟，AD转换单元输出差分信号传给FPGA1处理单元作为其基准时钟；外部时钟输入DA时钟缓冲器之后转换为差分信号，此差分信号输入DA转换单元作为其工作时钟，DA转换单元输出差分信号传给FPGA2处理单元作为其基准时钟；FPGA1处理单元用来处理ADC信号，FPGA2处理单元用来处理DAC信号，FPGA1处理单元与FPGA2处理单元以差分模式进行同步通信。
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