[发明专利]一种乘累加器及累加输出方法有效

专利信息
申请号: 201811314546.9 申请日: 2018-11-06
公开(公告)号: CN109634556B 公开(公告)日: 2021-04-23
发明(设计)人: 刘大可;苗志东;杨兵强 申请(专利权)人: 极芯通讯技术(南京)有限公司
主分类号: G06F7/52 分类号: G06F7/52
代理公司: 北京路浩知识产权代理有限公司 11002 代理人: 王莹;吴欢燕
地址: 211800 江苏省南京市江苏自贸区南*** 国省代码: 江苏;32
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摘要: 发明实施例提供了一种乘累加器,包括:M级运算列,每一级运算列中包括若干个寄存器;其中,第一级运算列包括N个乘法运算单元,每个乘法运算单元连接一个寄存器;第二级至第M‑1级运算列包括加法运算单元,每个加法运算单元连接一个寄存器,第i级的加法运算单元数量为第M级运算列由个多路选择器以及N个寄存器组成,第j个多路选择器包括k+1‑b个输入端口,输入端口分别连接第二级到第k+2‑b级中第j个加法运算单元所连接的寄存器。本发明实施例提供的一种乘累加器及累加输出方法,既可以实现时间维度对乘法运算单元输出的累加,又可以对多路乘法运算单元输出进行分组累加,提高了乘累加器的灵活度,满足多种运算形式对乘累加器的需求。
搜索关键词: 一种 累加器 累加 输出 方法
【主权项】:
1.一种乘累加器,其特征在于,包括:M级运算列,每一级运算列中包括若干个寄存器,所述寄存器用于在每个时刻存储运算结果并输出;其中,第一级运算列由N个乘法运算单元组成,每个乘法运算单元连接一个寄存器;第二级至第M‑1级运算列由加法运算单元组成,每个加法运算单元连接一个寄存器,第i级的所述加法运算单元数量为且2M‑3=N,N=2k,2≤i≤(M‑1),i、k、N、M均为自然数;第M级运算列由个多路选择器以及N个寄存器组成,第j个多路选择器包括k+1‑b个输入端口,所述输入端口分别连接第二级到第k+2‑b级中第j个加法运算单元所连接的寄存器,2b‑1<j≤2b,b为自然数;其中,第二级运算列还包括N个二选一多路器,所述二选一多路器包括两个输入端口,其中一个输入端口的输入为0,另一个输入端口连接所述第二级运算列加法运算单元所连接的寄存器。
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