[发明专利]用于时钟同步的方法、设备和系统有效
| 申请号： | 201810763733.9 | 申请日： | 2018-07-12 |
| 公开（公告）号： | CN109257072B | 公开（公告）日： | 2022-07-26 |
| 发明（设计）人： | M·什蒂格利奇;N·苏哈多尔尼克;M·乌德比纳 | 申请（专利权）人： | 意法半导体有限公司;意法半导体发展有限责任公司 |
| 主分类号： | H04B5/00 | 分类号： | H04B5/00;H04L7/033;H04L27/00;H04J3/06;H03L7/099;H03L7/18 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华;张昊 |
| 地址： | 法国*** | 国省代码： | 暂无信息 |
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| 摘要： | 本公开涉及用于同步应答器内有源负载调制时钟的方法和对应应答器。应答器使用有源负载调制与读取器通信。应答器包括数字锁相环(DPLL)，其在操作中生成与读取器的载波时钟同步的有源负载调制(ALM)载波时钟。在数据帧的传输之间，DPLL被置于闭合DPLL的反馈环路的操作的锁定模式。在具有持续时间的传输数据帧内，在传输数据帧的持续时间中，DPLL被置于打开反馈环路的操作的保持模式。在传输数据帧的持续时间期间，至少一次地调整ALM载波时钟的相位。 | ||
| 搜索关键词： | 用于 时钟 同步 方法 设备 系统 | ||
【主权项】：
1.一种方法，包括：使用数字锁相环(DPLL)生成与读取器的载波时钟同步的应答器的有源负载调制(ALM)载波时钟；以及使用所述ALM载波时钟将数据帧从所述应答器传输至所述读取器，生成所述ALM载波时钟包括：在数据帧的传输之间，将所述DPLL置于操作的锁定模式，反馈环路在所述锁定模式下被闭合；并且在具有持续时间的传输数据帧内，在所述传输数据帧的持续时间内，将所述DPLL置于操作的保持模式，所述反馈环路在所述保持模式下被打开；并且在所述传输数据帧的持续时间期间，至少一次地调整所述ALM载波时钟的相位。
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