[发明专利]在基于处理器的系统中提供经扩展动态随机存取存储器突发长度有效
| 申请号： | 201780069229.2 | 申请日： | 2017-11-30 |
| 公开（公告）号： | CN109964213B | 公开（公告）日： | 2023-04-28 |
| 发明（设计）人： | K·S·贝恩斯;W·奎因;王力永 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16;G06F13/28 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 公开在基于处理器的系统中提供经扩展动态随机存取存储器DRAM突发长度。一方面，一种基于处理器的系统包含提供4位宽数据存取(“x4”)和128位内部数据预取的DRAM电路(例如，安置在公共x4/x8裸片上)。当在x4模式中操作时，所述DRAM电路经配置以提供32位的经扩展DRAM突发长度(“BL32”)。所述DRAM电路从以通信方式耦合到所述DRAM电路的存储器控制器接收存储器读取请求，预取128位数据，并响应于所述存储器读取请求将所有所述128位所获取数据返回到所述存储器控制器。在一些方面，所述DRAM电路还可从所述存储器控制器接收包含128位写入数据的存储器写入命令，并将所述128位写入数据写入到存储器，而无需执行读取/修改/写入RMW操作。 | ||
| 搜索关键词： | 基于 处理器 系统 提供 扩展 动态 随机存取存储器 突发 长度 | ||
【主权项】：
1.一种用于提供经扩展动态随机存取存储器DRAM突发长度的基于处理器的系统，包括：DRAM电路，其经配置以提供4位宽数据存取和128位内部数据预取；以及存储器控制器，其以通信方式耦合到所述DRAM电路；所述DRAM电路经配置以通过配置成进行以下操作来提供32位的经扩展DRAM突发长度：从所述存储器控制器接收存储器读取请求；执行128位数据的内部预取；生成所有所述128位数据的错误校正码ECC；以及响应于所述存储器读取请求，将所有所述128位数据返回到所述存储器控制器。
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