[实用新型]一种锁相环电路有效
| 申请号: | 201721195288.8 | 申请日: | 2017-09-18 |
| 公开(公告)号: | CN207382288U | 公开(公告)日: | 2018-05-18 |
| 发明(设计)人: | 周俊 | 申请(专利权)人: | 江汉大学 |
| 主分类号: | H03L7/099 | 分类号: | H03L7/099 |
| 代理公司: | 深圳市合道英联专利事务所(普通合伙) 44309 | 代理人: | 廉红果;谭雪婷 |
| 地址: | 430056 湖北省武*** | 国省代码: | 湖北;42 |
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| 摘要: | 本实用新型涉及一种锁相环电路,包括PLL环路模块、前级放大模块、信号反馈模块、中央处理器、末级放大模块、校准模块和压控本振模块;本实用新型通过利用信号反馈环路来减小PLL频移的方法,以及给出改进的终极压控本振输出频率信号装置,将以更稳定、更精确的输出信号至用户端。 | ||
| 搜索关键词: | 一种 锁相环 电路 | ||
【主权项】:
1.一种锁相环电路,其特征在于:包括PLL环路模块、前级放大模块、信号反馈模块、中央处理器、末级放大模块、校准模块和压控本振模块;所述PLL环路模块的得到的频率信号送至所述前级放大模块,所述前级放大模块的信号输出端分别连接到所述信号反馈模块的信号输入端和末级放大模块的信号输入端,所述信号反馈模块的参数输出端连接到所述中央处理器的参数输入端,所述中央处理器的控制端连接到所述末级放大模块的受控端;所述末级放大模块的压控电压信号输出至所述压控本振模块,所述压控本振的信号输出端分别连接到所述PLL环路模块的信号输入端和校准模块的信号输入端,所述中央处理器的控制端也连接到所述校准模块的受控端。
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