[发明专利]由p+ 有效
申请号: | 201711365600.8 | 申请日: | 2017-12-18 |
公开(公告)号: | CN108346576B | 公开(公告)日: | 2021-03-16 |
发明(设计)人: | V·杜德克 | 申请(专利权)人: | 3-5电力电子有限责任公司 |
主分类号: | H01L21/329 | 分类号: | H01L21/329;H01L29/06;H01L29/207;H01L31/18 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 郭毅 |
地址: | 德国德*** | 国省代码: | 暂无信息 |
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摘要: |
层堆叠的制造方法,层堆叠由p |
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搜索关键词: | base sup | ||
【主权项】:
1.一种层堆叠的制造方法,所述层堆叠由p+衬底、p‑层、n‑层和第三层构成,其中,‑所述p+衬底具有5*1018‑5*1020N/cm3的掺杂剂浓度和50‑900微米的层厚度并且包括GaAs化合物或者由GaAs化合物构成,‑所述p‑层具有1014‑1016N/cm3的掺杂剂浓度和0.01‑1微米的层厚度并且包括GaAs化合物或者由GaAs化合物构成,‑所述n‑层具有1014‑1016N/cm3的掺杂剂浓度和10‑200微米的层厚度并且包括GaAs化合物或者由GaAs化合物构成,‑制造第一部分堆叠和第二部分堆叠并且使所述第一部分堆叠的上侧与所述第二部分堆叠的上侧通过晶圆接合材料锁合地连接,以便制造所述层堆叠,‑所述第一部分堆叠至少包括所述p+衬底,‑所述第二部分堆叠至少包括所述n‑层,‑通过在所述p+衬底的上侧上的外延或注入或通过在所述n‑层上的外延制造所述p‑层,并且所述p‑层形成所述第一部分堆叠的或所述第二部分堆叠的上侧,‑所述第三层在所述晶圆接合之前或之后制造,‑在第一替代方案中,在所述晶圆接合之后通过磨削至少部分地形成所述第二部分堆叠的n‑衬底制造所述n‑层,或者,在第二替代方案中,在所述晶圆接合之前在n+衬底上制造所述n‑层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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