[发明专利]在高速串行总线上传达低速和高速并行比特流在审
| 申请号： | 201680065860.0 | 申请日： | 2016-10-13 |
| 公开（公告）号： | CN108292924A | 公开（公告）日： | 2018-07-17 |
| 发明（设计）人： | W·K·拉德;M·W·维拉斯;K·W·斯帕尔斯;Z·朱 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | H03M9/00 | 分类号： | H03M9/00;H03K7/08 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 陈炜;袁逸 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 详细描述中公开的方面包括在高速串行总线上传达低速和高速并行比特流。在一方面中，数据传送方电路将低速并行比特流转换成高速并行比特流，随后基于高速参考频率串行化所转换的高速并行比特流。在另一方面中，如果低速并行比特流被确定存在于高速并行比特流中，则数据接收方电路从高速并行比特流中恢复低速并行比特流。通过基于高速参考频率对低速并行比特流进行串行化和解串行化，可在高速串行总线上传达高速并行比特流和低速并行比特流而无需附加串化器和解串器，从而降低了传送方电路和接收方电路两者中的组件成本和实现复杂性。 | ||
| 搜索关键词： | 比特流 高速并行 并行 高速串行总线 电路 串行化 参考频率 数据传送方 数据接收方 组件成本 串化器 接收方 串器 流转 传送 转换 恢复 | ||
【主权项】：
1.一种数据传送方电路，包括：串化器电路，其被配置为基于高速参考频率串行化对应于高速比特率的高速并行比特流，以生成用于在高速串行总线上进行传输的高速串行比特流；以及数据处理电路，其被配置为：接收对应于比所述高速比特率更慢的低速比特率的低速并行比特流；将所述低速并行比特流转换成对应于所述高速比特率的所述高速并行比特流；以及将所转换的高速并行比特流提供给所述串化器电路。
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