[发明专利]用于存储器管理单元的多线程转换及事务重新排序在审
| 申请号： | 201680029881.7 | 申请日： | 2016-04-27 |
| 公开（公告）号： | CN107710173A | 公开（公告）日： | 2018-02-16 |
| 发明（设计）人： | J·E·波达艾玛;P·C·J·维尔齐恩斯基;C·J·摩瑞拉;A·米雷特斯凯;M·瓦里亚;K·J·厄恩魏因;M·索马孙达拉姆;M·U·乔德里;S·M·加代尔拉布 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G06F12/0844 | 分类号： | G06F12/0844;G06F12/1036 |
| 代理公司： | 北京律盟知识产权代理有限责任公司11287 | 代理人： | 杨林勳 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 系统及方法涉及在多线程存储器管理单元MMU中执行地址转换。两个或多于两个地址转换请求可由所述多线程MMU接收且被并行地处理以检索到系统存储器的地址的地址转换。如果所述地址转换存在于所述多线程MMU的转换高速缓冲存储器中，那么可从所述转换高速缓冲存储器接收所述地址转换且将其调度以用于使用所述经转换地址接入所述系统存储器。如果所述转换高速缓冲存储器中存在未命中，那么可在两个或多于两个转换表查核行程中并行地调度两个或多于两个地址转换请求。 | ||
| 搜索关键词： | 用于 存储器 管理 单元 多线程 转换 事务 重新 排序 | ||
【主权项】：
一种设备，其包括：多线程存储器管理单元MMU，其经配置以从一或多个上游装置接收两个或多于两个地址转换请求，其中所述多线程MMU经进一步配置以并行地处理所述两个或多于两个地址转换请求中的至少两者，以获得系统存储器的对应经转换地址。
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