[发明专利]用于存储器管理单元的多线程转换及事务重新排序在审
| 申请号: | 201680029881.7 | 申请日: | 2016-04-27 |
| 公开(公告)号: | CN107710173A | 公开(公告)日: | 2018-02-16 |
| 发明(设计)人: | J·E·波达艾玛;P·C·J·维尔齐恩斯基;C·J·摩瑞拉;A·米雷特斯凯;M·瓦里亚;K·J·厄恩魏因;M·索马孙达拉姆;M·U·乔德里;S·M·加代尔拉布 | 申请(专利权)人: | 高通股份有限公司 |
| 主分类号: | G06F12/0844 | 分类号: | G06F12/0844;G06F12/1036 |
| 代理公司: | 北京律盟知识产权代理有限责任公司11287 | 代理人: | 杨林勳 |
| 地址: | 美国加利*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 用于 存储器 管理 单元 多线程 转换 事务 重新 排序 | ||
1.一种设备,其包括:
多线程存储器管理单元MMU,其经配置以从一或多个上游装置接收两个或多于两个地址转换请求,
其中所述多线程MMU经进一步配置以并行地处理所述两个或多于两个地址转换请求中的至少两者,以获得系统存储器的对应经转换地址。
2.根据权利要求1所述的设备,其中所述一或多个上游装置包括经配置以产生两个或多于两个地址转换请求的通用处理器、专用处理器或多线程处理器中的一或多个。
3.根据权利要求1所述的设备,其中所述多线程MMU包括主级调度器,所述主级调度器经配置以接收所述两个或多于两个地址转换请求且发出所述两个或多于两个地址转换请求以用于在转换高速缓冲存储器中转换。
4.根据权利要求3所述的设备,其中所述主级调度器经配置以按次序将所述两个或多于两个地址转换请求发出到所述转换高速缓冲存储器,所述次序不同于由所述主级调度器接收所述两个或多于两个地址转换请求的次序。
5.根据权利要求3所述的设备,其中所述主级调度器包括两个或多于两个主级调度器槽,所述两个或多于两个主级调度器槽经配置以在所述两个或多于两个地址转换请求被处理时存储所述两个或多于两个地址转换请求。
6.根据权利要求5所述的设备,其中所述两个或多于两个主级调度器槽被分配到所述一或多个上游装置的两个或多于两个代理程序。
7.根据权利要求6所述的设备,其中所述分配基于所述两个或多于两个代理程序的分类而可编程。
8.根据权利要求6所述的设备,其中所述分配是基于仲裁原则,所述仲裁原则包括循环、固定优先级或与所述两个或多于两个代理程序相关联的可编程优先级。
9.根据权利要求5所述的设备,其中所述两个或多于两个主级调度器槽包括对应的两个或多于两个状态,其中每一状态包括存储于对应主级调度器槽中的地址转换请求的状态。
10.根据权利要求3所述的设备,其中如果在所述转换高速缓冲存储器中存在针对由所述主级调度器发出的所述两个或多于两个地址转换请求的一或多个命中地址转换请求的命中,那么所述转换高速缓冲存储器经配置以将对应一或多个转换结果提供到所述主级调度器,所述一或多个转换结果包括所述系统存储器的针对所述一或多个命中地址转换请求的一或多个经转换地址。
11.根据权利要求10所述的设备,其中所述主级调度器经配置以调度对所述系统存储器的针对一或多个命中地址转换请求的所述一或多个经转换地址的存取。
12.根据权利要求11所述的设备,其中所述主级调度器经配置以基于与对应一或多个命中地址转换请求相关联的优先级或与产生所述一或多个命中地址转换请求的所述一或多个上游装置相关联的服务质量QoS度量而调度对所述系统存储器的所述一或多个经转换地址的所述存取。
13.根据权利要求12所述的设备,其中所述主级调度器经配置以基于重新排序所述存取而调度对所述系统存储器的所述一或多个经转换地址的所述存取,以避免所述存取之间的危险。
14.根据权利要求3所述的设备,其中如果在所述转换高速缓冲存储器中存在针对由所述主级调度器发出的一或多个未命中地址转换请求的未命中,那么所述转换高速缓冲存储器经配置以将所述一或多个未命中地址转换请求转递到次级调度器。
15.根据权利要求14所述的设备,其中所述次级调度器经配置以接收所述一或多个未命中地址转换请求,且调度所述一或多个未命中地址转换请求以用于在一或多个转换表查核器TTW中转换成所述系统存储器的地址。
16.根据权利要求15所述的设备,其中所述次级调度器包括两个或多于两个次级调度器槽,所述两个或多于两个次级调度器槽经配置以存储所述一或多个未命中地址转换请求中的两个或多于两个,直到从所述一或多个TTW接收到包括所述系统存储器的对应于所述两个或多于两个未命中地址转换请求的经转换地址的转换结果且所述经转换地址传回到所述转换高速缓冲存储器为止。
17.根据权利要求16所述的设备,其中所述两个或多于两个次级调度器槽包括对应两个或多于两个状态,其中每一状态包括存储于对应次级调度器槽中的未命中地址转换请求的状态。
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