[发明专利]蚀刻方法有效
| 申请号: | 201610021315.3 | 申请日: | 2016-01-13 |
| 公开(公告)号: | CN105810581B | 公开(公告)日: | 2019-12-10 |
| 发明(设计)人: | 渡边光;辻晃弘 | 申请(专利权)人: | 东京毅力科创株式会社 |
| 主分类号: | H01L21/311 | 分类号: | H01L21/311 |
| 代理公司: | 11277 北京林达刘知识产权代理事务所(普通合伙) | 代理人: | 刘新宇;张会华 |
| 地址: | 日本*** | 国省代码: | 日本;JP |
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| 摘要: | 本发明提供一种在抑制由氮化硅构成的第2区域被削去的同时对由氧化硅构成的第1区域进行蚀刻的蚀刻方法。在本发明的蚀刻方法中,为了对第1区域进行蚀刻,执行一次以上的第1序列,然后,执行一次以上的第2序列。一次以上的第1序列中的各个序列和一次以上的第2序列中的各个序列包含:第1工序,在该第1工序中,在被处理体上形成含有碳氟化合物的堆积物;以及第2工序,在该第2工序中,利用堆积物所含有的碳氟化合物的自由基来对第1区域进行蚀刻。第1区域被一次以上的第1序列中的各个序列蚀刻的量少于第1区域被一次以上的第2序列中的各个序列蚀刻的量。 | ||
| 搜索关键词: | 蚀刻 方法 | ||
【主权项】:
1.一种蚀刻方法,其利用针对被处理体的等离子体处理来相对于由氮化硅构成的第2区域而选择性地对由氧化硅构成的第1区域进行蚀刻,其中,/n所述被处理体具有划分出凹部的所述第2区域、以将该凹部填埋且覆盖所述第2区域的方式设置的所述第1区域、以及设置在所述第1区域上的掩模,该掩模在所述凹部之上提供具有宽度比该凹部的宽度大的开口,/n该蚀刻方法包括:/n一次以上的第1序列,其是为了对所述第1区域进行蚀刻而执行的;以及/n一次以上的第2序列,其是为了对所述第1区域进一步进行蚀刻而在执行所述一次以上的第1序列之后执行的,/n所述一次以上的第1序列中的各个序列和所述一次以上的第2序列中的各个序列包含:/n第1工序,在该第1工序中,在容纳有所述被处理体的处理容器内生成含有碳氟化合物气体的处理气体的等离子体,从而在所述被处理体上形成含有碳氟化合物的堆积物;以及/n第2工序,在该第2工序中,在容纳有所述被处理体的处理容器内生成非活性气体的等离子体,并利用所述堆积物所含有的碳氟化合物的自由基来对所述第1区域进行蚀刻,/n所述一次以上的第1序列是在包括使所述第2区域暴露时在内的期间内执行的,/n所述第1区域被所述一次以上的第1序列中的各个序列蚀刻的量少于所述第1区域被所述一次以上的第2序列中的各个序列蚀刻的量,/n在所述第1工序和所述第2工序之间执行第3工序,在该第3工序中,在容纳有所述被处理体的所述处理容器内生成含有含氧气体和非活性气体的处理气体的等离子体,从而使得在所述被处理体上形成的所述堆积物的量减少,/n其中,在所述第2区域暴露后,在该第2区域受到所述堆积物的保护的状态下对所述第1区域进行蚀刻。/n
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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