[发明专利]一种用FPGA实现通用串行总线触发与解码的方法在审
| 申请号： | 201510956422.0 | 申请日： | 2015-12-21 |
| 公开（公告）号： | CN105608040A | 公开（公告）日： | 2016-05-25 |
| 发明（设计）人： | 刘永;刘洪庆;向前;刘纪龙;姜正吉;贺增昊 | 申请（专利权）人： | 中国电子科技集团公司第四十一研究所 |
| 主分类号： | G06F13/42 | 分类号： | G06F13/42 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 266555 山东省*** | 国省代码： | 山东;37 |
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| 摘要： | 本发明公开了一种用FPGA实现通用串行总线触发与解码的方法，其具有步骤：参数设置，通过软件在FPGA的触发模块设置触发条件；总线解码，由FPGA的解码模块对总线的输入信号进行解码，且产生由标签类型、解码数据和数据地址组成的结构数组，多组所述的结构数组异步储存于FPGA的存储模块；总线触发，触发模块在判断触发条件满足后，产生触发信号；总线解标签，在触发信号产生时，FPGA的解标签模块读取地址计数器的计数值至软件；同步控制，软件根据地址计数器的计数值读取储存模块中的结构数组，且根据读取的结构数组，实时地显示采集波形和数字信号。 | ||
| 搜索关键词： | 一种 fpga 实现 通用 串行 总线 触发 解码 方法 | ||
【主权项】：
一种用FPGA实现通用串行总线触发与解码的方法，其特征在于具有步骤：(1)参数设置，通过软件在FPGA的触发模块设置触发条件；(2)总线解码，由FPGA的解码模块对总线的输入信号进行解码，且产生由标签类型、解码数据和数据地址组成的结构数组，多组所述的结构数组异步储存于FPGA的存储模块；(3)总线触发，触发模块在判断触发条件满足后，产生触发信号；(4)总线解标签，在触发信号产生时，FPGA的解标签模块读取地址计数器的计数值至软件；(5)同步控制，软件根据地址计数器的计数值读取储存模块中的结构数组，且根据读取的结构数组，实时地显示采集波形和数字信号。
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