[发明专利]存储电路有效
| 申请号： | 201380025692.9 | 申请日： | 2013-02-19 |
| 公开（公告）号： | CN104303234B | 公开（公告）日： | 2017-12-12 |
| 发明（设计）人： | 山本修一郎;周藤悠介;菅原聪 | 申请（专利权）人： | 国立研究开发法人科学技术振兴机构 |
| 主分类号： | G11C11/15 | 分类号： | G11C11/15;G11C11/413 |
| 代理公司： | 中科专利商标代理有限责任公司11021 | 代理人： | 朴英淑 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种存储电路，具备双稳态电路(30)，存储数据；非易失性元件(MTJ1、MTJ2)，将存储在上述双稳态电路中的数据非易失性地进行保存，并将非易失性地保存的数据恢复到上述双稳态电路中；和判定部(50)，在上述双稳态电路与上述非易失性元件的数据一致的情况下，不将上述双稳态电路的数据保存于上述非易失性元件中，在上述双稳态电路与上述非易失性元件的数据不一致的情况下，将上述双稳态电路的数据保存于上述非易失性元件中。 | ||
| 搜索关键词： | 存储 电路 | ||
【主权项】：
一种存储电路，其特征在于，具备：存储器区域，该存储器区域矩阵状地配置了多个存储单元，每个存储单元具有存储数据的双稳态电路和非易失性元件，该非易失性元件非易失性地保存存储在上述双稳态电路中的数据，并将非易失性地保存的数据恢复到上述双稳态电路中；控制线，与上述非易失性元件连接；和控制部，设置在上述存储器区域的外部，在多个上述存储单元中的每个存储单元中，判定上述双稳定电路与上述非易失性元件的数据是否一致，在判定为上述双稳态电路与上述非易失性元件的数据一致的情况下，不向上述控制线施加用于将上述双稳态电路的数据保存于上述非易失性元件中的电压，而在判定为上述双稳态电路与上述非易失性元件的数据不一致的情况下，向上述控制线施加用于将上述双稳态电路的数据保存于上述非易失性元件中的电压。
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