[发明专利]等离子体蚀刻方法有效
申请号: | 201280042052.4 | 申请日: | 2012-08-16 |
公开(公告)号: | CN103828028A | 公开(公告)日: | 2014-05-28 |
发明(设计)人: | 村上彰一;池本尚弥 | 申请(专利权)人: | SPP科技股份有限公司 |
主分类号: | H01L21/3065 | 分类号: | H01L21/3065 |
代理公司: | 北京科龙寰宇知识产权代理有限责任公司 11139 | 代理人: | 孙皓晨 |
地址: | 日本东京都千代田区大*** | 国省代码: | 日本;JP |
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摘要: | 本发明的解决课题在于提供一种可于宽能隙半导体基板形成锥形的凹部的等离子体蚀刻方法。解决手段如下:在宽能隙半导体基板K的表面,形成蚀刻速度大于该宽能隙半导体基板K的高速蚀刻膜E,并于其上形成具有开口部的屏蔽M。然后,将形成有高速蚀刻膜E及屏蔽M的宽能隙半导体基板K载置于基台上,并将该宽能隙半导体基板K加热至200℃以上,之后,将供给至处理腔室内的蚀刻气体等离子体化并且对基台供给偏压电位,由此蚀刻宽能隙半导体基板K。 | ||
搜索关键词: | 等离子体 蚀刻 方法 | ||
【主权项】:
一种等离子体蚀刻方法,其特征在于:其为使用等离子体化的反应性蚀刻气体,对载置于处理腔室内的基台上的宽能隙半导体基板进行等离子体蚀刻的方法;且进行以下步骤:成膜步骤,利用上述反应性蚀刻气体等离子体化而生成的反应种,而将包含以快于上述宽能隙半导体基板的构成成分的速度蚀刻的成分的高速蚀刻膜形成于所述宽能隙半导体基板的表面;屏蔽形成步骤,在形成于所述宽能隙半导体基板的表面的高速蚀刻膜上,形成具有开口部的屏蔽;及蚀刻步骤,将所述宽能隙半导体基板载置于所述处理腔室内的基台上,并将该宽能隙半导体基板加热至200℃以上,将所述反应性蚀刻气体供给至所述处理腔室内进行等离子体化,并且对载置有所述宽能隙半导体基板的基台施加偏压电位,利用所述等离子体化的反应性蚀刻气体而通过所述开口部蚀刻所述高速蚀刻膜及所述宽能隙半导体基板。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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