[发明专利]控制移位分组数据的位校正的装置无效
申请号: | 201210574965.2 | 申请日: | 1996-07-17 |
公开(公告)号: | CN103092563A | 公开(公告)日: | 2013-05-08 |
发明(设计)人: | A.D.佩勒格;Y.雅里;M.米塔尔;L.M.门内梅尔;B.艾坦;A.F.格卢;C.杜龙;E.科瓦施;W.维特 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F7/57 | 分类号: | G06F7/57;G06F7/544;G06F7/60;G06F9/30;G06F15/78 |
代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 徐予红;朱海煜 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | 一种在处理器中加入支持典型的多媒体应用所要求的分组数据上的操作的指令集的装置。在一个实施例中,本发明包括具有存储区(150)、解码器(165)及多个电路(130)的处理器。该多个电路提供若干指令的执行来操作分组数据。在这一实施例中,这些指令包含组装、分解、分组乘法、分组加法、分组减法、分组比较及分组移位。 | ||
搜索关键词: | 控制 移位 分组 数据 校正 装置 | ||
【主权项】:
一种处理装置,包括:支持触摸屏输入的显示器;通信总线(101);高速缓冲存储器(206);解码器(165),用于解码分组指令集(140);第一组寄存器(201),用于存储32位整数;第二组寄存器(209),用于存储包括第一多个数据元素的第一分组数据和包括第二多个数据元素的第二分组数据;执行单元(130),耦合至所述高速缓冲存储器、所述第一组寄存器、所述第二组寄存器和所述通信总线,所述执行单元用于执行所述分组指令集的解码的指令,包括指定下列操作的指令:组装操作,用于组装来自至少两个分组数据中的数据元素的一部分位以形成第三分组数据;分解操作,用于生成包含来自所述第一分组数据的至少一个数据元素和来自所述第二分组数据的至少一个相对应的数据元素的第四分组数据。
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