[实用新型]一种时钟动态切换电路有效
| 申请号： | 201120190118.7 | 申请日： | 2011-06-08 |
| 公开（公告）号： | CN202171760U | 公开（公告）日： | 2012-03-21 |
| 发明（设计）人： | 李大伟;朱建彰;王强;王潘丰;邹丽娜 | 申请（专利权）人： | 京微雅格（北京）科技有限公司 |
| 主分类号： | G06F1/04 | 分类号： | G06F1/04;G06F1/12 |
| 代理公司： | 北京亿腾知识产权代理事务所 11309 | 代理人： | 陈霁 |
| 地址： | 100473 北京市大兴区北京*** | 国省代码： | 北京;11 |
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| 摘要： | 本实用新型公开了一种时钟动态切换电路，包括时钟同步电路、时钟选择器，其特征在于：所述时钟同步电路包括两个或更多个时钟路径，并且每个时钟路径分别由两个D触发器和一个锁存器级联构成；所述时钟选择器在选择控制信号的控制之下从两个或更多个时钟信号中选择源时钟信号和目的时钟信号；所述时钟选择器的输出连接到每个时钟路径上的每个D触发器的时钟输入端；以及每个时钟信号分别输入到各自的时钟路径上的锁存器的时钟输入端，并且所述源时钟信号输入到第一时钟路径上的第一锁存器的时钟输入端，并且所述目的时钟信号输入到第二时钟路径上的所述第二锁存器的时钟输入端。 | ||
| 搜索关键词： | 一种 时钟 动态 切换 电路 | ||
【主权项】：
一种时钟动态切换电路，包括时钟同步电路和时钟选择器，其特征在于：所述时钟同步电路包括两个或更多个时钟路径，并且每个时钟路径分别由两个D触发器和一个锁存器级联构成；所述时钟选择器在选择控制信号的控制之下从两个或更多个时钟信号中选择源时钟信号和目的时钟信号；所述时钟选择器的输出连接到每个时钟路径上的每个D触发器的时钟输入端；以及每个时钟信号分别输入到各自的时钟路径上的锁存器的时钟输入端，并且所述源时钟信号输入到第一时钟路径上的第一锁存器的时钟输入端，并且所述目的时钟信号输入到第二时钟路径上的所述第二锁存器的时钟输入端。
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