[发明专利]高速缓存系统无效
申请号: | 201110037745.1 | 申请日: | 2011-02-10 |
公开(公告)号: | CN102156676A | 公开(公告)日: | 2011-08-17 |
发明(设计)人: | 平野孝仁 | 申请(专利权)人: | 富士通株式会社 |
主分类号: | G06F12/08 | 分类号: | G06F12/08 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 杜诚;陈炜 |
地址: | 日本神*** | 国省代码: | 日本;JP |
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摘要: | 一种高速缓存系统,包括:一级高速缓冲存储器,其被配置为在计算单元之间输入和输出数据,一级高速缓冲存储器包括多端口存储器单元,多端口存储器单元中的每个包括:存储单元,其存储具有第一数据大小的单元数据;写入单元,其将顺序输入的多个单元数据同时写入到存储单元的连续位置;以及输出单元,其读出并输出被写入存储单元的单元数据,其中,当将具有作为第一数据大小的任意多倍的第二数据大小、并且被分割为单元数据的数据写入一级高速缓冲存储器中时,通过将顺序的单元数据写入到多端口存储器单元的子集中,并且将其它顺序的单元数据写入到多端口存储器单元的另一子集中,来将数据存储在不同的多端口存储器单元中。 | ||
搜索关键词: | 高速缓存 系统 | ||
【主权项】:
一种高速缓存系统,包括:计算单元;一级高速缓冲存储器,其被配置为在所述计算单元之间输入和输出数据;其中,所述一级高速缓冲存储器包括多端口存储器单元,每个多端口存储器单元包括:存储单元,其存储具有第一数据大小的单元数据;写入单元,其将经由输入端口寄存器顺序输入的多个单元数据同时写入到所述存储单元的连续位置;以及输出单元,其读出由所述写入单元写入所述存储单元的所述多个单元数据,并将其输出到多个输出端口寄存器;其中,当将具有作为第一数据大小的任意多倍的第二数据大小并且被分割为单元数据的数据写入所述一级高速缓冲存储器中时,通过进行第一写入操作和第二写入操作将数据存储在不同的多端口存储器单元中,所述第一写入操作将顺序的单元数据写入到所述多端口存储器单元的子集中的所述输入端口寄存器中,所述第二写入操作将所述顺序的单元数据写入到所述多端口存储器单元的另一子集中的所述输入端口寄存器中;并且当从所述一级高速缓冲存储器读出数据时,通过进行第一读取操作和第二读取操作,从不同的多端口存储器单元读出数据,所述第一读取操作从所述多端口存储器单元的子集的所述输出端口寄存器读取顺序的单元数据,所述第二读取操作从所述多端口存储器单元的剩余子集的所述输出端口寄存器读取顺序的单元数据。
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