[发明专利]基于硅/碳材料的PMOS与NMOS晶体管的性能提升有效
申请号: | 200980129329.5 | 申请日: | 2009-07-31 |
公开(公告)号: | CN102105977A | 公开(公告)日: | 2011-06-22 |
发明(设计)人: | J·霍尼舒尔;V·帕帕耶奥尔尤;B·香农 | 申请(专利权)人: | 格罗方德半导体公司 |
主分类号: | H01L21/8238 | 分类号: | H01L21/8238;H01L21/336;H01L21/265;H01L29/78 |
代理公司: | 北京戈程知识产权代理有限公司 11314 | 代理人: | 程伟;靳强 |
地址: | 英国开*** | 国省代码: | 英国;GB |
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摘要: | 一种硅/锗材料和硅/碳材料可以根据适当的制造制度提供在不同导电类型(150P、150N)的晶体管,而不会不当地增加整体的工艺复杂度。再者,在形成相应的应变半导体合金(153)之前可以透过空腔(103P、103N)的暴露表面区域提供适当的植入物种,由此额外地提供增强的整体晶体管性能。在其他的实施例中,硅/碳材料可以形成在P沟道晶体管(150P)和N沟道晶体管(150N)中,同时在P沟道晶体管中,可以通过应力记忆技术而过度补偿相应的拉伸应变成分。于是,碳物种的有利的效果,例如增强P沟道晶体管的整体掺杂剂分布,可以结合有效的应变成分,同时可以达成提升的整体工艺一致性。 | ||
搜索关键词: | 基于 材料 pmos nmos 晶体管 性能 提升 | ||
【主权项】:
一种在第一导电类型的第一晶体管(150P)和第二导电类型的第二晶体管(150N)中形成受应变半导体材料的方法,该方法包括下列步骤:在该第一晶体管(150P)的第一栅极电极结构和该第二晶体管(150N)的第二栅极电极结构上方形成层堆栈,该第一和第二栅极电极结构包括各自的盖层(15K),该层堆栈包括间隔件层(104A)和形成在该间隔件层(104A)上方的蚀刻终止层(104B);在该第二晶体管(150N)上方和该蚀刻终止层(104B)上方形成掩模(105);在该第一栅极电极结构从该间隔件层(104A)形成第一间隔件元件(104S);使用该第一间隔件元件(104S)作为掩模而在该第一晶体管(150P)的漏极和源极区域形成第一空腔(103P);在该第一空腔(103P)中形成第一受应变半导体材料(153P);使用从该间隔件层(104A)形成的第二间隔件元件(104R)作为掩模而于该第二晶体管(150N)之漏极和源极区域中形成第二空腔(103N);以及在该第二空腔(103N)中形成第二受应变半导体材料(153N),该第一和第二受应变半导体材料(153P、153N)具有不同的材料成分。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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